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  1. 定点原码两位乘法器的设计

  2. 定点原码两位乘法器的设计定点原码两位乘法器的设计
  3. 所属分类:其它

    • 发布日期:2009-07-08
    • 文件大小:319kb
    • 提供者:qls870228
  1. 1602 4×4键盘显示两位十进制计算器

  2. 1602 4×4键盘显示两位十进制计算器·· 可计数加 减 乘 除 以及开方运算 只能显示整数位
  3. 所属分类:C/C++

    • 发布日期:2009-07-24
    • 文件大小:12kb
    • 提供者:candy1451
  1. 组成原理乘法器FPGA电路图

  2. Mul.bdf为主文件(包含启停逻辑),time.bdf合成了time.bsf输出时序控制(M1控制计算结果,M2送到AC里头去,M3移位送到Y),Mul.vwf为波形图。该png图为仿真波形图(X补=11010110(前两位为符合位),Y补=10011010(第一位为符号位,最后为添加位),结果=out12依次到out0(第一位为符号位))。详情请看电路图。
  3. 所属分类:嵌入式

    • 发布日期:2010-04-13
    • 文件大小:35kb
    • 提供者:llhuii5614
  1. 汇编两位乘代码,详细准确

  2. 两位乘代码,汇编语言,在一位乘的基础上改变,注释多,易懂
  3. 所属分类:硬件开发

    • 发布日期:2010-07-05
    • 文件大小:3kb
    • 提供者:sealmao
  1. 定点补码一位乘法器的设计

  2. 讨论当相乘的两个数中有一个或二个为负数的情况,在讨论补码乘法运算时,对被乘数或部分积的处理上与原码乘法有某些类似,差别仅表现在被乘数和部分积的符号位要和数值一起参加运算
  3. 所属分类:专业指导

    • 发布日期:2011-01-03
    • 文件大小:257kb
    • 提供者:longxingxueyuan
  1. 原码一位乘法器——组成原理课程设计

  2. 原码一位乘,两个原码数相乘,其乘积的符号为相乘两数符号的异或值,数值则为两数绝对值之积。
  3. 所属分类:专业指导

    • 发布日期:2011-01-03
    • 文件大小:348kb
    • 提供者:longxingxueyuan
  1. 各届组成原理课程设计及报告

  2. 各届组成原理课程设计 阵列乘法器的设计 CRC码生成与校验电路的设计 磁记录波形发生器的设计 超前进位加法器的设计 定点原码一位乘法器的设计 海明码生成与校验电路的设计 定点原码两位乘器设计
  3. 所属分类:专业指导

    • 发布日期:2011-01-08
    • 文件大小:8mb
    • 提供者:wo453344
  1. 乘法器的演化生成vc++

  2. 本程序,使用演化硬件算法实现了一个两位乘以两位的乘法器,平均演化代数为1500代左右
  3. 所属分类:硬件开发

  1. 数字电路乘法器设计

  2. 本实验利用两位二进制数乘法中乘数各位与被乘数相乘后移位相加的原理,拓展得到两个四位二进制数相乘原理。在max+plus2上进行原理图设计和软件仿真,软件通过后,下载到EPF10K10中,在GW48系列EDA/SOC实验开发系统完成硬件调试。
  3. 所属分类:其它

    • 发布日期:2013-10-20
    • 文件大小:397kb
    • 提供者:u012515736
  1. Verilog 16位乘法器

  2. 通过移位相加的方法,实现两个16位二进制数据的相乘。经过测试,能够得到正确的结果。
  3. 所属分类:硬件开发

    • 发布日期:2014-03-30
    • 文件大小:2kb
    • 提供者:mzy00001
  1. 用vhdl编写的四位乘法器

  2. 用vhdl编写的四位乘法器,完成两个4位二进制数相乘
  3. 所属分类:其它

    • 发布日期:2008-10-16
    • 文件大小:4kb
    • 提供者:zhaoyufeng007
  1. 64位乘除法

  2. 64位乘除法适合于32位嵌入式平台的开发 位乘除算法功能: 给定两组数,分别为10元素无符号整型数组,计算出分子数组(前n_size个,n_size为0~10之间)之积与分母数组(前d_size个,d_size为0~10之间)之积,再将分子之积除以分母之积,得出四舍五入的整型商。 如果分子或分母之积溢出,则需进行低精确除,即将对应位置的分子和分母相除,最后将这些结果相乘得出最终商,注意此时是不会对每对分子分母的除法进行结果补偿(即对商进行四舍五入)的。 若计算中输入不合法或者计算结果溢出,
  3. 所属分类:C

  1. 计算机组成原理实验—补码两位乘

  2. 计算机组成原理实验—COP2000实现的补码两位乘,包含代码
  3. 所属分类:嵌入式

    • 发布日期:2017-11-12
    • 文件大小:122kb
    • 提供者:wdoves
  1. Verilog原码二位乘法器

  2. Verilog原码二位乘法器,其中两个操作数位宽为5。文件中含解释文档,代码中含tb文件和详细注释。配合https://blog.csdn.net/qq_42334072/article/details/105928385食用更佳
  3. 所属分类:硬件开发

    • 发布日期:2020-05-05
    • 文件大小:1mb
    • 提供者:qq_42334072
  1. 计算机组成原理源码两位乘课程设计报告.docx

  2. 计算机组成原理源码两位乘课程设计报告 题目是设计并实现定点原码两位乘法器,要求使用伟福COP2000 实验箱并使用实验箱提供的汇编语言完成该程序的设计与实现。使用计算机连接伟福COP2000 实验箱,用试验箱的开关输入两个八位二进制定点原码数到编写的程序中(首位为符号位),通过计算机运行程序,计算出两个定点原码数的乘积,运算的结果在寄存器中显示。要求独立设计、编程、调试、通过指导教师现场验收并撰写课程设计报告。
  3. 所属分类:C/C++

    • 发布日期:2019-12-30
    • 文件大小:1mb
    • 提供者:qq_43472321
  1. 补码阵列乘法器

  2. 1、通过multisim仿真平台设计一个能计算含符号位的4位乘法器,即内部为一个3×3阵列乘法器,符号位单独处理,如图7所示。 2、输入为两个4位含符号位的补码数,输出结果亦是含符号位的数补码。 图7带求补级的阵列乘法器方框图 要求: 1、能够正确输入两个4位(含符号位)的补码,并通过计算得到正确的结果。 2、验证结果,输入两个均为补码的数据,验证并得到正确的仿真结果。 3、通过指示灯或者数码管显示为输入和输出的数据。
  3. 所属分类:互联网

  1. 原码一位乘法器.rar

  2. 原码一位乘,两个原码数相乘,其乘积的符号为相乘两数符号的异或值,数值则为两数绝对值之积。这里是原码的设计与实现,包括说明
  3. 所属分类:其它

    • 发布日期:2020-07-11
    • 文件大小:287kb
    • 提供者:u012429555
  1. 定点补码一位乘法器的设计.rar

  2. (1)用[X]补×[Y]补直接求[X×Y]补 讨论当相乘的两个数中有一个或二个为负数的情况,在讨论补码乘法运算时,对被乘数或部分积的处理上与原码乘法有某些类似,差别仅表现在被乘数和部分积的符号位要和数值一起参加运算。 若[Y]补=Y0Y1Y2…Yn 当Y0为1时,则有Y=-1+Yi×2-i 故有 X×Y=X×Yi×2-1-X当Y为负值时,用补码乘计算[X×Y]补,是用[X]补乘上[Y]补的数值位,而不理[Y]补符号位上的1,乘完之后,在所得的乘积中再减X,即加-[X]补。实现补码乘法的
  3. 所属分类:其它

    • 发布日期:2020-07-11
    • 文件大小:252kb
    • 提供者:u012429555
  1. 基于绝热逻辑的低功耗乘法器电路设计

  2. 本文首先介绍了单相能量回收反相器电路,详细讨论电路的工作原理,同时用PSpice工具仿真了基于静态CMOS电路和单相能量回收电路构成的两位乘法器电路。仿真结果表明本文介绍的单相能量回收电路能够极大地降低电路功耗。今后的工作还应继续优化电路结构,稳定电路的输出状态,增强电路的抗干扰能力。
  3. 所属分类:其它

    • 发布日期:2020-10-26
    • 文件大小:222kb
    • 提供者:weixin_38556416
  1. 基础电子中的电容器的标称容量三位数字的表示法

  2. 三位数字的表示法也称电容量的数码表示法。三位数字的前两位数字为标称容量的有效数宇,第三位数宇表示有效数字后面零的个数,它们的单位都是pF。   如:102表示标称容量为1000pF。  221表示标称容量为220pF。  224表示标称容量为22x10(4)pF。   在这种表示法中有一个特殊情况,就是当第三位数字用"9"表示时,是用有效数宇乘上10-1来表示容量大小。   如:229表示标称容量为22x(10-1)pF=2.2pF。  
  3. 所属分类:其它

    • 发布日期:2020-11-24
    • 文件大小:17kb
    • 提供者:weixin_38500117
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