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  1. 使用NCVERILOG仿真mos数字电路

  2. 在cadence中，使用mos管和电阻构建了数字电路，但是要对这电路进行功能仿真，仿真的激励也比较复杂，不能使用简单的信号源产生，这个时候，就会考虑使用verilog，编写testbench来进行仿真。

  3. 所属分类：其它

    • 发布日期：2020-08-10
    • 文件大小：299kb
    • 提供者：weixin_38621870