根据JESD204B标准构建的转换器非常适合新型高速FPGA.在采用这些器件进行设计时，应考虑I/O注意事项。 　　随着数据转换器架构和FPGA不断采用更更小型化几何体，系统设计人员面临着新的数据接口挑战。更小工艺几何体支持更高带宽转换器在不断提高的分辨率及速度下运行，其可实现更高的数据吞吐量。而且，它们还可提供更高的串行/解串（串行解串器）速率，以适应在以前较大几何体上无法实现的带宽占用。更小的工艺几何体也可实现将更多的数据转换器集成在单个器件中。这些数据转换器的接口解决方案不仅需要支持高数