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同步和异步FIFOVerilog源码
使用Verilog，编写了同步FIFO和异步FIFO，其中异步FIFO可以用来处理跨时钟域问题，文件中包含了Testbench，已在Modelsim中经过仿真
所属分类：
硬件开发
发布日期：2020-07-27
文件大小：2kb
提供者：
weixin_43459619
