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  1. 基于FPGA的模拟信号源设计(中英文翻译)

  2. 为频率捷变应用选择信号发生器 根据信号发生器的主要用途或公司的预算,设计师通常会采用传统的信号发生器设计,如YIG调谐或带状合成器。然而,最近出现的基于合成仪器(Synthetic-instrument,SI)架构的信号发生器有望改变这种选择。 当测试频率捷变无线电时,找到能够跟随所期望的跳频图案的信号发生器(跳变速率和延迟时间都很快的仪器)使用户受到了限制。如果测试系统只要求产生简单的频率调制,或仅作为快速跳变的本地振荡器,那么选择快速调谐信号发生器就行了。不过,这种信号发生器是无法产生最近
  3. 所属分类:硬件开发

    • 发布日期:2010-03-08
    • 文件大小:141kb
    • 提供者:zhujiqq
  1. 基于FPGA的DDS_DPLL跳频信号源设计_杨红.pdf

  2. 针对跳频通信系统有固有噪声的特点,结合 DDS+DPLL高分辨率、高频率捷变速度的优点,并采用 Altera公 司的 Quartus - Ⅱ _ 10.1 软 件 进 行 设 计 综 合,提 出 了 一 种 新 型 的 跳 频 信 号 源。结 果 表 明,该 设 计 中 DPLL 时 钟 可 达 到 120MHz ,性能较高,而仅使用了30个 LUT和18个触发器,占用资源很少。
  3. 所属分类:硬件开发

    • 发布日期:2019-06-13
    • 文件大小:1mb
    • 提供者:candy123_0_19
  1. 基于FPGA的跳频信号源设计_姚磊.pdf

  2. 针对跳频通信系统有固有噪声的特点,结合 DDS+DPLL高分辨率、高频率捷变速度的优点,并采用 Altera公 司的 Quartus - Ⅱ _ 10.1 软 件 进 行 设 计 综 合,提 出 了 一 种 新 型 的 跳 频 信 号 源。结 果 表 明,该 设 计 中 DPLL 时 钟 可 达 到 120MHz ,性能较高,而仅使用了30个 LUT和18个触发器,占用资源很少。
  3. 所属分类:硬件开发

    • 发布日期:2019-06-13
    • 文件大小:1mb
    • 提供者:candy123_0_19
  1. FPGA自学笔记——设计与验证VIP版.pdf

  2. 开始有计划写这本书的时候, Altera 还叫 Altera, 还没有加入 Intel 的大家庭, Xilinx 的 ZYNQ 也才刚刚开始有人探索, Altera 大学计划第一次将亚洲创新大赛由传统的 SOPC 大赛 换成了 SOC 大赛,软核变硬核,性能翻几番。 那个时候,能出一本认认真真讲 FPGA 设计的 书, 会得到非常高的评价。 而我,则由于工作变动, 中间拖沓了半年,当半年后再来准备动 笔时,才恍然领悟到, Altera 即将成为 Intel 的可编程事业部, 基于嵌入式硬核的 S
  3. 所属分类:硬件开发

    • 发布日期:2019-09-03
    • 文件大小:16mb
    • 提供者:qq_30307853
  1. 基于FPGA和Si4463的跳频语音通信系统设计与实现

  2. 跳频通信作为扩频通信的一种,具有抗干扰、抗截获以及多址组网等优点,在现代军事通信尤其是战术抗干扰电台中获得了广泛的应用。近年来,跳频通信技术在民用通信系统中的应用也越来越广泛,例如GSM、无线局域网、Bluetooth等应用了跳频技术,矿井救援通信系统使用了跳频通信的组网能力应对灾变现场的复杂环境,语音电台也常常使用跳频通信来保证语音信号安全可靠地传输。
  3. 所属分类:其它

    • 发布日期:2020-07-31
    • 文件大小:98kb
    • 提供者:weixin_38528939
  1. 基于DSP/FPGA的超高速跳频系统基带设计

  2. 绍某超高速跳频通信系统基带部分的设计与实现,该系统选用2FSK调制方式,并选择合适跳频频带以抑制镜像频率;讨论了跳频器、跳频序列、快速位同步以及跳频图案同步以及跳频信号解调等跳频通信系统的关键技术,给出了基于DSP和FPGA的发射/接收系统的详细软/硬件架构设计及关键核心模块的设计方案,最后给出系统的实测结果。
  3. 所属分类:其它

    • 发布日期:2020-07-30
    • 文件大小:93kb
    • 提供者:weixin_38684892
  1. 基于DSP/FPGA的超高速跳频系统基带设计与实现

  2. 跳频通信系统作为扩频通信体制中的一种重要类型,以其出色的抗远近效应、抗干扰能力,在军用、民用通信领域得到了广泛应用。跳频通信方式是指载波受一伪随机码的控制, 不断地、随机地跳变,可看成载波按照一定规律变化的多频频移键控(MFSK)。
  3. 所属分类:其它

    • 发布日期:2020-08-08
    • 文件大小:185kb
    • 提供者:weixin_38660802
  1. 基于FPGA的跳频通信系统设计

  2. 本文对跳频通信技术及基带各关键模块进行了深入探讨和分析,给出了高速跳频通信系统的系统设计,并通过软件无线电技术对其进行实现。
  3. 所属分类:其它

    • 发布日期:2020-08-08
    • 文件大小:180kb
    • 提供者:weixin_38663595
  1. 基于多路并行DDS的快跳频信号发生器设计实现

  2. 针对新型干扰功率大、频带宽、样式多等特点,采用相干快跳频体制可提高无线通信系统抗干扰能力。为满足相干快跳体制中跳频信号载波相位严格连续的需求,基于多路并行的直接频率合成(DDS)技术,利用FPGA+DAC的硬件平台,设计并实现了一种快跳频信号发生器,并通过实际测试,验证了其性能特性符合设计需求。
  3. 所属分类:其它

    • 发布日期:2020-10-15
    • 文件大小:541kb
    • 提供者:weixin_38629939
  1. 基于FPGA的跳扩频信号发送系统设计

  2. 依据跳扩频通信信号的需求,设计了以FPGA和DDS为架构,用VHDL语言编程实现的跳扩频信号发送系统,该系统能以连续的4.8 Kb/s的速率、在108~155.975 MHz范围内宽间隔跳频发送数据。本设计的主要优点是采用了软件无线电技术,使用高速、高稳定性和高可靠性的集成芯片,体积小重量轻,性价比高。实验结果证明,该跳频信号发送系统可在其外部参数可控的情况下,稳定地传送全频段跳频信号,具有较高的应用价值。
  3. 所属分类:其它

    • 发布日期:2020-10-23
    • 文件大小:500kb
    • 提供者:weixin_38622962
  1. DSP中的基于DSP/FPGA的超高速跳频系统基带设计与实现

  2. 跳频通信方式是指载波受一伪随机码的控制, 不断地、随机地跳变,可看成载波按照一定规律变化的多频频移键控(MFSK)。跳频通信系统作为扩频通信体制中的一种重要类型,以其出色的抗远近效应、抗干扰能力,在军用、民用通信领域得到了广泛应用。跳频通信的频率受伪随机码控制不断跳变,跳频图案可以设置几千乃至上万个,收发两端只要跳频图案一致,跳频时间同步,就可在信息传输过程中不断跳变空间频率信道,实现跳频通信。   近年来随着半导体工艺和计算机技术的发展,DSP(Digital Signal Processor
  3. 所属分类:其它

    • 发布日期:2020-10-23
    • 文件大小:198kb
    • 提供者:weixin_38748055
  1. 基于DSP/FPGA的超高速跳频系统基带设计与实现

  2. 介绍某超高速跳频通信系统基带部分的设计与实现,该系统选用2FSK调制方式,并选择合适跳频频带以抑制镜像频率;讨论了跳频器、跳频序列、快速位同步以及跳频图案同步以及跳频信号解调等跳频通信系统的关键技术,给出了基于DSP和FPGA的发射/接收系统的详细软/硬件架构设计及关键核心模块的设计方案,最后给出系统的实测结果。
  3. 所属分类:其它

    • 发布日期:2020-10-23
    • 文件大小:174kb
    • 提供者:weixin_38621312
  1. 基于FPGA的DDS+DPLL跳频信号源设计

  2. 针对跳频通信系统有固有噪声的特点,结合DDS+DPLL高分辨率、高频率捷变速度的优点,并采用Altera公司的Quartus-Ⅱ_10.1软件进行设计综合,提出了一种新型的跳频信号源。结果表明,该设计中DPLL时钟可达到120 MHz,性能较高,而仅使用了30个LUT和18个触发器,占用资源很少。
  3. 所属分类:其它

    • 发布日期:2020-10-21
    • 文件大小:420kb
    • 提供者:weixin_38696458
  1. 基于多相滤波的数字信道化阵列接收机

  2. 传统的宽带阵列接收机用多台单通道接收机并行工作,并行的同时接收不同频点上的信号来达到全频域覆盖的目的,也可以用多通道接收机多个通道并行同步的工作来实现,前者增加了系统成本和让整个并行系统同步工作的复杂度,后者当信道数比较大和指标要求比较高时,信号处理的复杂度和器件实现的可行性要求很高。基于多相滤波的数字信道化阵列接收机在通信类电子战中对跳频信号的快速搜索以及雷达对抗中对捷变频雷达信号的全概率截获等表现出很高的潜在研究和应用价值。  1 系统组成  该系统设计是基于多相滤波的信道化原理,对宽带阵列
  3. 所属分类:其它

    • 发布日期:2020-10-19
    • 文件大小:305kb
    • 提供者:weixin_38675777
  1. 基于FPGA的跳频通信频率合成器实现

  2. 摘要:介绍了一种基于ARM平台、以太网和GPRS无线通信技术的智能家居远程监控系统,给出了系统的组成及工作原理,着重阐述了系统主要硬件和软件的设计。智能家居远程监控系统的核心是嵌入式Web服务器。通过该嵌入式We
  3. 所属分类:其它

    • 发布日期:2020-10-23
    • 文件大小:189kb
    • 提供者:weixin_38670529
  1. EDA/PLD中的基于FPGA的高速宽带跳频发射机的中频设计

  2. 摘要:结合软件无线电思想和架构,利用Altera EP3C16F4 84C6作为中频信号处理器,设计了一种基于统一硬件架构的数字化高速宽带跳频发射机,实现跳频速率125kHops/s,跳频带宽320MHz。   引言   跳频通信是在恶劣的电磁环境中保证正常通信的主要手段。提高跳频通信系统的跳频速率和跳频带宽可以有利于对抗单频窄带干扰,频带阻塞干扰以及跟踪干扰,是提高跳频通信系统抗干扰能力的主要手段。   传统的跳频发射机是通过模拟本振的跳变或切换来实现跳频的功能。采用模拟本振跳变的方案跳
  3. 所属分类:其它

    • 发布日期:2020-11-04
    • 文件大小:466kb
    • 提供者:weixin_38683895
  1. EDA/PLD中的基于FPGA的高速数字锁相环的设计与实现

  2. 摘 要:本文提出了一种利用边沿触发鉴相缩短锁相环捕获时间的方案,并详细介绍了该方案基于FPGA的实现方法。通过对所设计的锁相环进行计算机仿真和硬件测试,表明该方案确实可以提高锁相环的捕获性能。关键词:数字锁相环(DPLL);捕获时间;FPGA;VHDL 引言捕获时间是锁相环的一个重要参数,指的是锁相环从起始状态到达锁定状态所需时间。在一些系统中,如跳频通信系统,由于系统工作频率不断地发生快速变化(每秒几百次到几千次,甚至高达上万次),要求锁相环能够对信号相位快速捕获。因此研究具有较短捕获时
  3. 所属分类:其它

    • 发布日期:2020-12-09
    • 文件大小:68kb
    • 提供者:weixin_38607311
  1. 基于DDS的复杂信号模拟设计

  2. 引 言 在1992年5月美国电信系统会议上,JeoMitola首次提出了软件无线电概念,之后迅速引起了人们的关注,并开始对它进行广泛而深入的研究。具体地说,软件无线电是以可编程的DSP或CPU为中心,将模块化、标准化的硬件单元以总线方式连接起来,构成通用的基本硬件平台,并通过软件加载来实现各种无线通信功能的开放式的体系结构。本文以现场可编程逻辑门阵列(FPGA)和高性能直接数字合成(DDS)芯片AD9858构成一个通用的硬件平台,通过更新不同的数据及软件产生复杂调制信号、线性调频信号、背景多
  3. 所属分类:其它

    • 发布日期:2020-12-08
    • 文件大小:245kb
    • 提供者:weixin_38528180
  1. 基于FPGA和Si4463的跳频语音通信系统设计与实现

  2. 跳频通信具有抗干扰、抗截获以及多址组网等优点,在民用通信系统中的应用越来越广泛。基于FPGA和Si4463,设计并实现了跳频语音通信系统。首先对跳频通信系统抗干扰性能进行了建模仿真和分析,得到抗全频带干扰和抗跟踪式干扰性能。提出一种简化的基于TOD(Time of day)的跳频同步方案,使用本地计数器代替精确时间产生模块(例如GPS模块),降低系统实施复杂性,节约硬件资源和成本。最后设计并实现了基于FPGA和通用射频收发芯片Si4463的跳频语音通信系统,为复杂环境下民用语音通信提供了可行的方
  3. 所属分类:其它

  1. 基于FPGA的高速宽带跳频发射机的中频设计

  2. 摘要:结合软件无线电思想和架构,利用Altera EP3C16F4 84C6作为中频信号处理器,设计了一种基于统一硬件架构的数字化高速宽带跳频发射机,实现跳频速率125kHops/s,跳频带宽320MHz。   引言   跳频通信是在恶劣的电磁环境中保证正常通信的主要手段。提高跳频通信系统的跳频速率和跳频带宽可以有利于对抗单频窄带干扰,频带阻塞干扰以及跟踪干扰,是提高跳频通信系统抗干扰能力的主要手段。   传统的跳频发射机是通过模拟本振的跳变或切换来实现跳频的功能。采用模拟本振跳变的方案跳
  3. 所属分类:其它

    • 发布日期:2021-01-19
    • 文件大小:697kb
    • 提供者:weixin_38744902