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  1. 2006测试测量和自动化解决方案文集.pdf

  2. 2006测试测量和自动化解决方案文集pdf,该资料是基于计算机的测试测量和自动化应用方案2006年优秀论文的合订本，包含全部获奖论文。LabV正W特别奖 基丁虚拟仪器的发动机试验台架系统.… 行业:汽车 院校特别奖 基于LabⅤIEW的智能车仿真平台 64 行业:高校/教育 N系统联盟商特别奖 采用N模块化仪器构建业界领先的RFID测试系统. .67 行业:电信 一等奖 汽车 基于N产品的高压共轨柴油机电控单元测试系统的开发 作者:杭勇杨明陆娟 职务:高级工程师 公司:一汽无锡油泵油嘴研究所

  3. 所属分类：其它

    • 发布日期：2019-10-09
    • 文件大小：74mb
    • 提供者：weixin_38743481

  1. 数据采集系统中基于FPGA消除尖峰脉冲干扰.pdf

  2. 数据采集系统中基于FPGA消除尖峰脉冲干扰pdf,48 化工自动化及仪表 第36卷 WHEN C00]n= >daTA data dAtA datAdaTA NULL 号经过倍频、辨向、计数后的时序图。 END CASE 2μ4 3 5μs6 END IF 在该描述中可见,电路中还引人了一个时钟信 B 号来同步计数器的操作,此时钟信号除了驱动该计 数模块的比较和计数操作按一定的时间问隔执行 Ok 外,还起到了抗干扰的功能。采用了外部时钟来使 clk count 计数操作同步,只有在同步时

  3. 所属分类：其它

    • 发布日期：2019-09-14
    • 文件大小：265kb
    • 提供者：weixin_38744207

  1. 基于FPGA的高精度同步时钟系统设计

  2. 绍了精密时钟同步协议(PTP)的原理。本文精简了该协议，设计并实现了一种低成本、高精度的时钟同步系统方案。该方案中，本地时钟单元、时钟协议模块、发送缓冲、接收缓冲以及系统打时标等功能都在FPGA中实现。经过测试，该方案能够实现ns级同步精度。该方案成本低，并且易于扩展，非常适合局域网络时钟同步的应用领域。

  3. 所属分类：其它

    • 发布日期：2020-07-31
    • 文件大小：90kb
    • 提供者：weixin_38723699

  1. 时钟恢复及同步技术在地震勘探仪器中的应用

  2. 随着石油勘探的发展，在地震勘探仪器中越来越需要高精度的同步技术来支持高效采集。基于这种目的，采用FPGA技术设计了一种时钟恢复以及系统同步方案，并完成了系统的固件和嵌入式软件设计。

  3. 所属分类：其它

    • 发布日期：2020-08-29
    • 文件大小：289kb
    • 提供者：weixin_38645266

  1. 基于FPGA的多通道同步实时高速数据采集系统设计

  2. 为了满足精密设备监测过程中对数据采集的精确性、实时性和同步性的严格要求，设计了一种基于FPGA的多通道实时同步高速数据采集系统。本系统采用Xilinx公司的Spartan6系列的FPGA作为核心控制器件，实现了数据采集控制、数据缓存、数据处理、数据存储、数据传输和同步时钟控制等功能。经测试验证，该方案具有精度高、速率快、可靠性好、实时性强、成本低等特点。

  3. 所属分类：其它

    • 发布日期：2020-10-15
    • 文件大小：824kb
    • 提供者：weixin_38614484

  1. 基于FPGA和单片机的守时系统设计

  2. 介绍守时系统的重要作用及其发展现状，分析了守时系统发展过程中遇到的一些问题，设计了一个以GPS/北斗信号作为时标的守时系统。采用双恒温槽的恒温晶振MV180作为系统的输入时钟，使用单片机控制DAC7512对其频率进行调整。首先，系统对调整后的本地时钟信号进行分频处理，再与GPS/北斗接收到的标准秒信号进行比较，通过FPGA和单片机对分频后的信号进行相位的调整，最终输出标准秒脉冲信号，从而快速获得高精度的时间基准，并能在GPS/北斗失锁后对该信号进行保持，实现时间同步。

  3. 所属分类：其它

    • 发布日期：2020-10-17
    • 文件大小：289kb
    • 提供者：weixin_38678773

  1. EDA/PLD中的基于全数字锁相环的设计

  2. 本文在说明全数字锁相环的基础上，提出了一种利用FPGA设计一阶全数字锁相环的方法，并给出了关键部件的RTL可综合代码，并结合本设计的一些仿真波形详细描述了数字锁相环的工作过程，最后对一些有关的问题进行了讨论。关键词：全数字锁相环；DPLL；FSK；FPGA 引言　　锁相环(PLL)技术在众多领域得到了广泛的应用。如信号处理，调制解调，时钟同步，倍频，频率综合等都应用到了锁相环技术。传统的锁相环由模拟电路实现，而全数字锁相环(DPLL)与传统的模拟电路实现的PLL相比，具有精度高且不受温度和电压影

  3. 所属分类：其它

    • 发布日期：2020-11-24
    • 文件大小：77kb
    • 提供者：weixin_38717171

  1. 基于FPGA的高同步时钟系统设计

  2. 摘要: 介绍了精密时钟同步协议(PTP)的原理。本文精简了该协议，设计并实现了一种低成本、高精度的时钟同步系统方案。该方案中，本地时钟单元、时钟协议模块、发送缓冲、接收缓冲以及系统打时标等功能都在FPGA中实现。经过测试，该方案能够实现ns级同步精度。该方案成本低，并且易于扩展，非常适合局域网络时钟同步的应用领域。在很多大型物理实验和工业应用中，时钟同步技术都扮演着举足轻重的作用。比如在中国四川锦屏暗物质探测实验中，需要为多个独立探测装置提供相应的时间信息，这些探测器包括中心探测器（HpGe）、

  3. 所属分类：其它

    • 发布日期：2021-01-20
    • 文件大小：264kb
    • 提供者：weixin_38518722

  1. 基于全数字锁相环的设计

  2. 本文在说明全数字锁相环的基础上，提出了一种利用FPGA设计一阶全数字锁相环的方法，并给出了关键部件的RTL可综合代码，并结合本设计的一些仿真波形详细描述了数字锁相环的工作过程，对一些有关的问题进行了讨论。关键词：全数字锁相环；DPLL；FSK；FPGA 引言　　锁相环(PLL)技术在众多领域得到了广泛的应用。如信号处理，调制解调，时钟同步，倍频，频率综合等都应用到了锁相环技术。传统的锁相环由模拟电路实现，而全数字锁相环(DPLL)与传统的模拟电路实现的PLL相比，具有精度高且不受温度和电压影响，

  3. 所属分类：其它

    • 发布日期：2021-01-19
    • 文件大小：74kb
    • 提供者：weixin_38589812

  1. 通用高精度时钟同步单元的设计方案

  2. 根据对时钟同步装置守时误差的分析，提出了一种通过降低测量误差进一步提高守时精度的同步时钟装置设计方案。该方案利用时钟内插方法降低全球定位系统(GPS)秒脉冲周期测量误差，对秒脉冲均值进行余数补偿消除均值计算中的引入误差，从而提高同步时钟装置的守时精度。根据所提方案设计了基于AMBA APB总线的通用高精度同步时钟知识产权(IP)核，并利用ARM Cortex-M0内核在现场可编程门阵列(FPGA)中构建了具有高精度同步时钟IP的片上系统(SoC)进行测试验证。测试结果表明，基于所提方案设计的通用

  3. 所属分类：其它

  1. 一种基于卫星授时的异地时钟同步技术

  2. 针对多机通信联合作业中采用常规校时手段，无法满足单机间时钟同步精度要求的问题，提出了一种基于北斗导航系统的边沿累计差值同步方法。介绍了该方法的基本技术原理和工作流程，并专门设计了以支持北斗定位的国产AT6558D芯片为核心的测试验证模块，通过ARM11内核主控，与CYCLONE FPGA协作进行时钟同步处理。经野外测试，验证了在各向遮挡仰角＜20°的条件下，使用该方法的时钟同步精度可达到40 ns（99%以上），与常规方法相比性能提升超过50%。是多机通信联合测量、高速物体测控、目标投递时钟同步

  3. 所属分类：其它