智力竞赛抢答计时器的设计 一、 课题说明在许多比赛活动中，为了准确、公正、直观地判断出第一抢答者，通常设置一台抢答器，通过数显、灯光及音响等多种手段指示出第一抢答者。同时，还可以设置计时、计分、犯规奖惩计录等多种功能。 二、 设计要求 1、设计一个4组参加的智力竞赛抢答计时器。每组设置一个抢答按钮供抢答者使用。 2、电路具有第一抢答信号的鉴别和锁存功能。在主持人将系统复位并发出抢答指令后，当有某一组参赛者首先按下抢答开关时，数码管显示相应组别并伴有声响。此时，电路应具备自锁功能，使别组的抢答开

基于VHDL语言的智力竞赛抢答器课程设计 每个步骤都有仿真图和相应程序

抢答器是为智力竞赛参赛者答题时进行抢答而设计的一种优先判决器电路，竞赛者可以分为若干组，抢答时各组对主持人提出的问题要在最短的时间内做出判断，并按下抢答按键回答问题。当有人抢答则在显示器上显示该组组号，同时电路将其他各组按键封锁。若在规定时间内无人抢答，警报器发出警报。回答完问题后，由主持人将按键恢复，重新进行下一轮抢答。本设计应用EDA技术，在复杂可编程逻辑芯片EPF10K10LC84-4上用VHDL编写各个功能模块并联合外围电路完成了数字抢答器的设计。采用FPGA 控制增强了系统的灵活性，

本设计为四路智能抢答器，所以这种抢答器要求有四路不同组别的抢答输入信号，并能识别最先抢答的信号，直观地通过数显和蜂鸣等方式显示出组别；对回答问题所用的时间进行计时、显示、超时报警、预置答题时间，同时该系统还应有复位、倒计时启动功能。

基于FPGA的智力竞赛抢答器设计 1、设计一个4人参加的智力竞赛抢答器，当有某一参赛者首先按下抢答开关时，相应显示灯亮并伴有声响，此时抢答器不再接受其他输入信号。 2、电路具有回答问题时间控制功能，要求回答问题时间小于或等于100s（显示为0～99），时间显示采用倒计时方式。当达到限定时间时，发出声响以示警告。 3、使用工具软件MAX-PLUSⅡ，利用VHDL硬件描述语言进行各模块及整个系统 的仿真与分析。