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搜索资源 - 基于verilogHDL的FPGA工程，对m序列进行2psk调制解调，使用了相干解调，包括了testbench文件和测试报告。
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基于verilog HDL的FPGA工程，对m序列进行2psk调制解调，使用了相干解调，包括了testbench文件和测试报告。
基于verilog HDL的FPGA工程，对m序列进行2psk调制解调，使用乘法器进行相干解调，包括了testbench文件，仿真视图，和测试报告。代码没有严格编写，仅供参考，仅支持quartus17.0版本，其他版本请重建IP核。
所属分类：
其它
发布日期：2019-03-03
文件大小：49mb
提供者：
weixin_41830084
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