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搜索资源列表

  1. 数字逻辑课程设计——111序列检测器

  2. 一、实验目的： 1、深入了解与掌握同步时序逻辑电路的设计过程； 2、了解74LS74、74LS08、74LS32及74LS04芯片的功能； 3、能够根据电路图连接好实物图，并实现其功能。学会设计过程中的检验与完善。 二、实验内容描述： 题目：“1 1 1”序列检测器。 原始条件：使用D触发器( 74 LS 74 )、“与”门 ( 74 LS 08 )、“或”门( 74 LS 32 )、非门 ( 74 LS 04 )，设计“1 1 1”序列检测器。 集成电路引脚图： D触发器( 74 LS 74

  3. 所属分类：C

    • 发布日期：2010-01-26
    • 文件大小：523kb
    • 提供者：sunnyu1116

  1. 数字逻辑与数字系统设计习题答案王永军 李景华

  2. 第一章 数字逻辑基础 作业及参考答案 （2008.9.25） P43 1-11 已知逻辑函数 ，试用真值表、卡诺图和逻辑图表示该函数。 解：（1）真值表表示如下： 输 入 输出 A B C F 0 0 0 0 0 0 1 1 0 1 0 1 0 1 1 1 1 0 0 1 1 0 1 1 1 1 0 1 1 1 1 0 （2）卡诺图表示如下： 00 01 11 10 0 0 1 0 1 1 1 1 1 1 由卡诺图可得 ＝ （3）逻辑图表示如下： 1-12 用与非门和或非门实现下列函数，并画出

  3. 所属分类：C

    • 发布日期：2010-03-29
    • 文件大小：5mb
    • 提供者：cheerup8

  1. 触发器与时序逻辑电路

  2. 本章首先介绍触发器和同步时序电路的分析，然后介绍寄存器、计数器等常用集成时序电路，最后对异步时序电路的分析也给予了简单介绍。

  3. 所属分类：专业指导

    • 发布日期：2010-09-21
    • 文件大小：574kb
    • 提供者：superuser007

  1. ewb multisim 仿真实例电路图全集

  2. 多年收集的ewb和multisim电子电路仿真实例文件，压缩后有50多兆。 文件列表 ├─仿真实验 │ 555.ms10 │ Circuit1.ms10 │ Circuit2.ms10 │ CLOCK.ms10 │ FileList.txt │ 实验2.ms10 │ 实验3-一阶有源低通滤电路.ms10 │ 实验3-减法运算电路.ms10 │ 实验3-反相加法运算电路.ms10 │ 实验3-反相比例运算电路.ms10 │ 实验3-反相积分运算电路.ms10 │ 实验3-微分运算电路.ms10

  3. 所属分类：专业指导

    • 发布日期：2015-10-21
    • 文件大小：53mb
    • 提供者：freedom366

  1. 同步时序逻辑电路

  2. 数字电路课程小班课PPT

  3. 所属分类：讲义

    • 发布日期：2016-10-06
    • 文件大小：896kb
    • 提供者：u010385790

  1. 数字逻辑实验报告

  2. 一位全加器（综合验证性) 一位8421BCD码转换成余3码（综合设计性）三位纽环计数器（综合设计性） 四位二进制数左移、右移同步时序逻辑电路（综合设计性)

  3. 所属分类：硬件开发

    • 发布日期：2017-12-30
    • 文件大小：6mb
    • 提供者：chu1024

  1. 数字电路模拟试题

  2. 数字电路期末复习题，欢迎大家下载，复习 《数字逻辑分析与设计》模拟试题 一、 单项选择题 1. 只有在时钟的下降沿时刻，输入信号才能被接收，该种触发器是（ ）。 A. 高电平触发器 B.下降沿触发器 C. 低电平触发器 D. 上升沿触发器 2. 下列电路中，属于时序逻辑电路的是( ) A. 编码器 B. 译码器 C. 数值比较器 D. 计数器 3. 若将一个TTL与非门（设输入端为A、B）当作反相器使用，则A、B端应如何连接（ ） A. A、B两端并联使用 B. A或B中有一个接低电平0 C.

  3. 所属分类：专业指导

    • 发布日期：2018-06-28
    • 文件大小：891kb
    • 提供者：holal

  1. （北京大学 数字电路课程设计）八位数字抢答器 电路图

  2. 1）设计内容： 1，利用各种器件设计一个多路智力竞赛抢答器。 2，利用电路板对所设计的电路进行检验。 3，总结检验电路设计结果 2）学习要求： 1，复习编码器、十进制加/减计数器的工作原理，设计可预置时间的定时电路分析与设计时序控制电路。画出定时抢答器的整机逻辑电路图，掌握智力抢答器的工作原理及其设计方法，并对各种元器件的功能和应用有所了解。并能对其在电路中的作用进行分析。例如：555定时器，优先编码器74ls148和rs锁存器74ls279以及十进制同步加/减计数器74ls192。另外对电路

  3. 所属分类：硬件开发

    • 发布日期：2018-08-06
    • 文件大小：132kb
    • 提供者：qq_36589234

  1. 模电 数电 单片机笔试及面试问题.pdf

  2. 该文档包括数电、模电、单片机、计算机原理等笔试问题，还讲解了关于面试的问题该如何解答，对大家有一定的帮助电流放大就是只考虑输岀电流于输入电流的关系。比如说,对于一个uA级的信号,就需要放大后才能驱动 一些仪器进行识别(如生物电子),就需要做电流放大 功率放大就是考虑输出功率和输入功率的关系。 其实实际上,对于任何以上放大,最后电路中都还是有电压,电流,功率放大的指标在,叫什么放大,只 是重点突出电路的作用而已。 15.推挽结构的实质是什么? 般是指两个三极管分别受两互补信号的控制,总是在一个三极

  3. 所属分类：嵌入式

    • 发布日期：2019-10-12
    • 文件大小：649kb
    • 提供者：fromnewword

  1. 模拟电路和数字电路笔试知识和面试知识.pdf

  2. 每次面试都被问到模电和数电，因此想给大家分享一份关于模拟电子技术的面试题，希望有所帮助电流放大就是只考虑输出电流于输入电流的关系。比如说,对于一个uA级的信号,就需要放大后才能驱动 些仪器进行识别(如生物电子),就需要做电流放大。 功率放大就是老虑输出功率和输入功率的关系。 其实实际上,对于任何以上放大,最后电路中都还是有电压,电流,功率放大的指标在,叫什么放大,只 是重点突出电路的作用而已 15.推挽结构的实质是什么? 般是指两个三极管分别受两互补信号的控制,总是在一个三极管导通的时候另一个截

  3. 所属分类：讲义

    • 发布日期：2019-08-18
    • 文件大小：614kb
    • 提供者：maosheng007

  1. FPGA入门教程.pdf

  2. 1、数字电路设计入门 2、FPGA简介 3、FPGA开发流程 4、RTL设计 5、Quartus II 设计实例 6、ModelSim和Testbench112时序逻辑电路 时序逻辑电路由时钟的上升沿或下降沿驱动工作,其实真正被时钟沿驱动的是电路中的 触发器( Register),也称为寄存器。触发器的工作原理和参数如下图 Register的原理和参数 T DQ Clk Clk old tsu:建立时间,在时钟有效沿到来之前触发器数据输入应保持稳定的时间,如果建立时 间不够,数据将不能在这个时钟

  3. 所属分类：硬件开发

    • 发布日期：2019-07-28
    • 文件大小：6mb
    • 提供者：smart_devil

  1. 高级数字ic.docx

  2. 期末复习同步时序逻辑的优点 冒险不会影响功能 （时钟和异步复位除外） 电路中所有节点在存储操作时都已稳定。 在正确设计的电路中不会存在时序违规，免于亚稳态现象。 在设计时只需要考虑极少的时序约束。

  3. 所属分类：专业指导

    • 发布日期：2019-07-12
    • 文件大小：573kb
    • 提供者：hertzx

  1. 第5章同步时序逻辑电路

  2. 武大数字逻辑课件，供大家学习参考,多多交流

  3. 所属分类：专业指导

    • 发布日期：2013-10-04
    • 文件大小：1mb
    • 提供者：chenaili520

  1. 数字电路实验

  2. 数字电路实验，关于逻辑方面的，同步异步时序逻辑电路

  3. 所属分类：网络基础

  1. 大学数字逻辑老师讲课课件同步时序电路.ppt

  2. 大学数字逻辑老师讲课课件同步时序电路.ppt

  3. 所属分类：专业指导

    • 发布日期：2010-12-11
    • 文件大小：1mb
    • 提供者：xiaochun2012

  1. 数字电路同步时序逻辑电路

  2. 关于时序逻辑电路的知识，不错的，讲的还是比较好咯

  3. 所属分类：专业指导

    • 发布日期：2010-06-29
    • 文件大小：1mb
    • 提供者：lgiqz

  1. 基于FPGA的时序及同步设计

  2. 数字电路中,时钟是整个电路最重要、最特殊的信号。第一, 系统内大部分器件的动作都是在时钟的跳变沿上进行, 这就要求时钟信号时延差要非常小, 否则就可能造成时序逻辑状态出错.

  3. 所属分类：其它

    • 发布日期：2020-10-18
    • 文件大小：163kb
    • 提供者：weixin_38747917

  1. 基于可编程计数器的时序逻辑电路设计

  2. 0 引言 　　各种MSI中规模数字集成电路都有自己的主要特性和应用目标，如果进行非常规使用，则改变它的使用方向，就可进一步发挥其功能和作用。扩展专用集成电路的应用领域是一项有实际意义的研究。本文研究了MSI可编程计数器改变应用方向的逻辑修改方法及时序逻辑电路的设计技术。 　　1 基本原理 　　74LSl61是可编程中规模同步4位二进制加法计数器，图1为其图形符号。其中，Q3，Q2，Q1，Q0为计数状态输出端；C为进位输出端；EP，ET为计数控制端；为预置数控制端；D3～D0为预置数输入端；

  3. 所属分类：其它

    • 发布日期：2020-11-06
    • 文件大小：290kb
    • 提供者：weixin_38668672

  1. ⑤第五章同步时序逻辑电路.xmind

  2. 数字逻辑

  3. 所属分类：交通

  1. 介绍数字电路中的三种触发器类型

  2. 数字时序电路中通常用到的触发器有三种：电平触发器、脉冲触发器和边沿触发器。今天给大家介绍一下这三种触发器，话不多说，直接入正题。 　　1. 电平触发器 　　 　　介绍数字电路中的三种触发器类型 　　如上图所示就是电平触发器的逻辑结构图和图形符号图，只有CLK为高电平的时候才能接受输入信号，并按照输入信号将触发器输出置成相应的输出。它是由一个SR触发器和两个与非门组成，又称为同步SR触发器。 　 　　2. 脉冲触发器 　 　　如上图所示，脉

  3. 所属分类：其它

    • 发布日期：2021-01-20
    • 文件大小：55kb
    • 提供者：weixin_38738511
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