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搜索资源列表

  1. 基于S3C2410 的时钟频率小结

  2. 基于S3C2410 的时钟频率小结

  3. 所属分类：C

    • 发布日期：2007-11-26
    • 文件大小：2kb
    • 提供者：jiajia6254

  1. 芯片时钟频率

  2. 电脑中有许许多多的半导体芯片，每个芯片都是在特定的时钟频率下进行工作的。时钟发生器提供给芯片的时钟信号是一个连续的脉冲信号，而脉冲就相当于芯片的脉搏，每一次脉冲到来，芯片内的晶体管就改变一次状态，让整个芯片完成一定任务。

  3. 所属分类：嵌入式

    • 发布日期：2012-09-13
    • 文件大小：354kb
    • 提供者：lr1988

  1. MSP430时钟模块设置扩展

  2. 介绍了msp430的时钟模块的设置以及检测时钟频率的方法，具体的时钟设置方法请参考《MSP430F5系列时钟模块UCS通俗讲义》，《MSP430模块系列之二：时钟设置》

  3. 所属分类：软件测试

    • 发布日期：2013-05-03
    • 文件大小：509kb
    • 提供者：yinghao1991

  1. 电脑主板时钟频率检测小程序

  2. 电脑主板时钟频率检测小程序，可以在标题栏那里，看到自己电脑的主板时钟频率和精度。（i系列的Intel主板，因为改FSB总线为QPI总线，所以看到的是QPI的总线频率，超频不会增加这个数值）

  3. 所属分类：桌面系统

    • 发布日期：2013-06-05
    • 文件大小：3kb
    • 提供者：yeees

  1. MIPI的高速时钟频率与显示屏分辨率及帧率之间的计算关系

  2. MIPI高速时钟频率与驱动的LCD屏幕分辨率及刷新率之间的换算关系

  3. 所属分类：硬件开发

    • 发布日期：2018-07-10
    • 文件大小：17kb
    • 提供者：kecinchen

  1. 4-3-基于AM57x的CPU时钟频率修改方法.pdf

  2. 基于AM57x的CPU时钟频率修改方法 1 适用性说明 3 2 ARM时钟频率修改 3 3 DSP时钟频率修改 6 更多帮助 10

  3. 所属分类：嵌入式

    • 发布日期：2020-03-11
    • 文件大小：636kb
    • 提供者：Tronlong_

  1. 基于时钟频率调整的时间同步的FPGA实现及应用

  2. 本文研究了一种可对频率进行动态调整的时钟，通过对时钟频率的动态修正，实现主从时钟频率的同步，进而实现时间同步。

  3. 所属分类：其它

    • 发布日期：2020-07-30
    • 文件大小：129kb
    • 提供者：weixin_38526979

  1. 基于FPGA的时钟频率同步设计

  2. 基于时钟频率调整的时间同步方法，实现简单，而且没有复杂的软件同步协议，占用较小的网络带宽就可以实现高精度的时钟同步，在硬件上只需要低成本的FPGA支持。

  3. 所属分类：其它

    • 发布日期：2020-08-07
    • 文件大小：318kb
    • 提供者：weixin_38571878

  1. 为什么CPU时钟频率在过去5年里没有增加？

  2. CPU时钟频率在过去5年里没有增加是很多不同类别的原因导致的。当设计一个CPU的微架构时，其中一个关键的设计决策就是如何实现更高的性能。在奔腾4时代，英特尔选择了具有非常高的时钟频率和相对较窄的管道。这种方法有很多优点，其中之一就是它很容易加快单线程和串行代码。软件内并不需要操作很多的并行指令，因此大多数软件会立刻见其好处。

  3. 所属分类：其它

    • 发布日期：2020-08-04
    • 文件大小：90kb
    • 提供者：weixin_38743602

  1. 一种低时钟频率下UHF RFID标签芯片PIE解码电路的实现方案

  2. 对于标签芯片，降低系统时钟频率是降低功耗、提高通讯距离的最有效手段。首先从理论上按照一种等效判决方法推导出PIE解码电路的更低时钟频率，提出了一种低时钟频率下基于ISO 18000-6 TYPE C协议的UHF RFID标签芯片解码电路的实现方案。设计的解码电路大幅度降低了标签芯片解码电路功耗，提高了标签响应灵敏度。

  3. 所属分类：其它

    • 发布日期：2020-10-16
    • 文件大小：251kb
    • 提供者：weixin_38623919

  1. 基于FPGA的时钟频率同步设计与应用

  2. 文研究了一种可对频率进行动态调整的时钟，通过对时钟频率的动态修正，实现主从时钟频率的同步，进而实现时间同步。

  3. 所属分类：其它

    • 发布日期：2020-10-20
    • 文件大小：586kb
    • 提供者：weixin_38722721

  1. 微型高稳定锁相时钟频率源

  2. 本文介绍用集成电路MAX2620和集总LC元件构成窄带VCO电路模块，然后同集成锁相频率合成器芯片MB1504一起构成锁相环式低噪声、高稳定性的锁相频率源电路的设计方法。

  3. 所属分类：其它

    • 发布日期：2020-10-24
    • 文件大小：191kb
    • 提供者：weixin_38611230

  1. MBl504/MAX2620设计的微型高稳定锁相时钟频率源

  2. 由锁相环构成的间接式频率合成器在无线通信领域发挥着非常重要的作用。通常采用锁相频率合成器的输出信号来作为无线接收机中的本振信号，以使直接频率调制器、频率解调器能够从输入信号中再生载波。

  3. 所属分类：其它

    • 发布日期：2020-10-24
    • 文件大小：190kb
    • 提供者：weixin_38709379

  1. DSP中的可提供300MHz时钟频率的I/Q调制发生器

  2. 近日，Rohde & Schwarz推出R&S AFQ100A I/Q调制发生器，可提供存储时钟达300MHz及存储深度达1 Gsample，该产品适用于产生复杂的数字调制信号，其输出存储器可达256Msamples或1Gsample，除了模拟输出外，还可提供数字I/Q输出。 　　现代通信技术使用各种各样的数字调制方法。为了达到更高的数据率，需要不断研发出新的调制方式。因而，需要在研发和生产中生成这些复杂信号的灵活调制信号源。该产品具有1kHz至300MHz宽范围的内存时钟频率，及1Gsampl

  3. 所属分类：其它

    • 发布日期：2020-11-02
    • 文件大小：33kb
    • 提供者：weixin_38655496

  1. EDA/PLD中的FPGA的时钟频率同步设计

  2. 引 言 　　网络化运动控制是未来运动控制的发展趋势，随着高速加工技术的发展，对网络节点间的时间同步精度提出了更高的要求。如造纸机械，运行速度为1 500～1 800m／min，同步运行的电机之间1μs的时间同步误差将造成30 μm的运动误差。高速加工中心中加工速度为120 m／min时，伺服电机之间1μs的时间同步误差，将造成2 μm的加工误差，影响了加工精度的提高。 　　分布式网络中节点的时钟通常是采用晶振+计数器的方式来实现，由于晶振本身的精度以及稳定性问题，造成了时间运行的误差。时钟同

  3. 所属分类：其它

    • 发布日期：2020-11-08
    • 文件大小：166kb
    • 提供者：weixin_38550834

  1. Atmel推出时钟频率高达2.2Gsps的ADC

  2. Atmel公司日前推出业界最快速的商用10位ADC AT84AS008GL，时钟频率达2.2Gsps。     基于2.2GHz的采样率，AT84AS008GL模数据转换器在引脚上与TS83102G0BGL完全兼容，可无缝升级并提供第一Nyquist区中1.7Gsps的8位有效位。此外该器件还在第一Nyquist区2.2Gsps时，具有55dB SFDR与51dB SNR的动态性能。其3.3GHz输入带宽可扩展至第二Nyquist区，同时在55dB时，具有48dB SNR。     AT

  3. 所属分类：其它

    • 发布日期：2020-12-01
    • 文件大小：36kb
    • 提供者：weixin_38545332

  1. Atmel推出时钟频率高达2GSps的ADC模块

  2. Atmel公司近日发布其高速集成ADC和DMUX的系列器件的第二款产品。新模块采用最新的10位ADC，可提供时钟频率达2Gsps，具有一个嵌入式1:4 LVDS多路信号分离器，直接接口标准FPGA。       新发布的AT84AS004TP与Atmel之前发布的AT84AS003TP 10位1.5Gsps ADC和DMUX完全兼容。它采用与以往同样的格式、引脚和功能，允许从现有的设计方便地升级。新设计适用于更高速的数字应用领域，例如宽带测试、测量设备、高速数据采集、通信和控制。      A

  3. 所属分类：其它

    • 发布日期：2020-12-01
    • 文件大小：54kb
    • 提供者：weixin_38682076

  1. 智能卡时钟频率转换因子表

  2. 智能卡复位信息中时钟频率转换因子查询表

  3. 所属分类：其它

    • 发布日期：2020-12-31
    • 文件大小：16kb
    • 提供者：zhoubin0220

  1. Android获取设备CPU核数、时钟频率以及内存大小的方法

  2. 本文实例讲述了Android获取设备CPU核数、时钟频率以及内存大小的方法。分享给大家供大家参考，具体如下： 因项目需要，分析了一下 Facebook 的开源项目 – Device Year Class。 Device Year Class 的主要功能是根据 CPU核数、时钟频率 以及 内存大小 对设备进行分级。代码很简单，只包含两个类: DeviceInfo -> 获取设备参数， YearClass -> 根据参数进行分级。 下表是 Facebook 公司提供的分级标准，其中 Ye

  3. 所属分类：其它

    • 发布日期：2021-01-04
    • 文件大小：62kb
    • 提供者：weixin_38543280

  1. ASIC-Implementation-UART：本文介绍了用于串行通信的UART模块的设计，该模块用于短距离，低速以及计算机与外围设备之间的数据交换。 UART主要包含发送器，接收器和波特率发生器。 波特率发生器为UART产生时钟。 通过

  2. ASIC实现UART 本文介绍了用于串行通信的UART模块的设计，该模块用于短距离，低速和计算机与外围设备之间的数据交换。 UART主要包含发送器，接收器和波特率发生器。 波特率发生器为UART产生时钟。 通过使用系统时钟的分频因子，我们可以实现所需的波特率。 如果增加波特率，串行数据传输的速度将提高。 随着分频系数的降低，波特率增加。 在本文中，我们将系统时钟频率设置为50MHz，传输每个数据位的时间为23.75ns，波特率为42.1 Mbps（分频系数为32）。 由于波特率的增加，传输数据

  3. 所属分类：其它

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