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  1. 智能全数字锁相环的设计

  2. 在FPGA片内实现全数字锁相环用途极广。本文在集成数字锁相环74297的基础上进行改进，设计了锁相状态检测电路，配合CPU对环路滤波参数进行动态智能配置，从而使锁相环快速进入锁定状态，在最短时间内正常工作并且提高输出频率的质量。

  3. 所属分类：电信

    • 发布日期：2011-06-30
    • 文件大小：54kb
    • 提供者：daixizheng

  1. 基于FPGA的全数字锁相环设计

  2. 在FPGA片内实现全数字锁相环用途极广。本文在集成数字锁相环74297的基础上进行改进，设计了锁相状态检测电路，配合CPU对环路滤波参数进行动态智能配置，从而使锁相环快速进入锁定状态，在最短时间内正常工作并且提高输出频率的质量。

  3. 所属分类：电信

    • 发布日期：2011-06-30
    • 文件大小：291kb
    • 提供者：daixizheng

  1. 数字锁相环及其FPGA的实现

  2. 锁相环 (PLL) 的理论与研究日趋完善，应用范围遍及整个电子技术领域，如信号处理，调制解调，时钟同步，倍频，频率综合等都应用到了锁相环技术。 随着集成电路技术的发展，集成锁相环和数字锁相环技术日趋成熟，不仅能够制成频率较高的单片集成锁相环路，还可以把整个系统集成到一个芯片上去，实现所谓的片上系统 SOC 。 因此，可以把全数字锁相环路 (ADPLL) 作为一个功能模块嵌入 SOC ，构成片内锁相环。这里在简单介绍片内全数字锁相环系列结构的同时，给出一种智能控制捕获范围中全数字锁相环（ ADP

  3. 所属分类：专业指导

    • 发布日期：2015-12-13
    • 文件大小：385kb
    • 提供者：qq_33364719

  1. 上海范氏GSL智能型直行程电动执行器说明书.pdf

  2. 上海范氏GSL智能型直行程电动执行器说明书pdf,上海范氏GSL智能型直行程电动执行器说明书上海范氏自动化控制设备有限公司 实装在执行器內部,使执行器内部保持一定温度,以避免在低温(-20℃以下)使用时结霜而损坎执行器电气元件。 24智能位置变送器(K) 当不需配内置伺服功能,而只需要输出0~10mA/4~20mA阀位信号时选用 功能:带现场电动软手操功能,可用上升键或下降键进行操作;输岀阀位信号可选择0~10mA或420mA。 产品结构 GSL系列智能电动执行结构,电气部件布线严谨,并与传动部

  3. 所属分类：其它

    • 发布日期：2019-10-08
    • 文件大小：757kb
    • 提供者：weixin_38743602

  1. 智能全数字锁相环的设计

  2. 智能全数字锁相环,在单片FPGA中就可以实现,借助锁相环状态监测电路,通过CPU可以缩短锁相环锁定时间,并逐渐改进其输出频率的抖动特性。解决了锁定时间与相位抖动之间的矛盾,对信息的传输质量都有很大的提高。此锁相环已用于我校研发的数字通信产品中。

  3. 所属分类：其它

    • 发布日期：2020-08-11
    • 文件大小：95kb
    • 提供者：weixin_38628626

  1. EDA/PLD中的智能全数字锁相环的设计

  2. 1 引言 数字锁相环路已在数字通信、无线电电子学及电力系统自动化等领域中得到了极为广泛的应用。随着集成电路技术的发展，不仅能够制成频率较高的单片集成锁相环路，而且可以把整个系统集成到一个芯片上去。在基于FPGA的通信电路中，可以把全数字锁相环路作为一个功能模块嵌入FPGA中，构成片内锁相环。 锁相环是一个相位误差控制系统。它比较输入信号和振荡器输出信号之间的相位差，从而产生误差控制信号来调整振荡器的频率，以达到与输入信号同频同相。所谓全数字锁相环路(DPLL)就是环路部件全部数字化，采用

  3. 所属分类：其它

    • 发布日期：2020-12-13
    • 文件大小：75kb
    • 提供者：weixin_38687343