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搜索资源列表

  1. 4-16译码器vhedl源程序

  2. 用quartus7.2编写的4-16译码器的vhdl工程文件

  3. 所属分类：其它

    • 发布日期：2009-09-12
    • 文件大小：338kb
    • 提供者：nt321123

  1. 自己用VHDL编写的8*16点阵贪吃蛇源代码

  2. 初学VHDL在完成作业后心血来潮编写的贪吃蛇小程序，完全只使用最基本的语法，在学校机房试验箱上的altera flex10k 上使用一个8*16的led点阵进行了验证。有非随机的食物，蛇每吃3个食物张长并加速，游戏结束或没有进行则全部led均点亮……

  3. 所属分类：Web开发

    • 发布日期：2010-06-19
    • 文件大小：1mb
    • 提供者：zombiecry

  1. 用VHDL语言编写的VGA显示彩条

  2. 用VHDL语言编写的彩条显示，部分程序如下: architecture behave of VGA is -- horizontal timing signals constant h_data: integer:=640; constant h_front: integer:=16; constant h_back: integer:=48; constant h_sync: integer:=96; constant h_period: integer:= h_sync + h_data

  3. 所属分类：C++

    • 发布日期：2010-06-29
    • 文件大小：2kb
    • 提供者：l840854893

  1. ISP07大作业及参考答案

  2. 一 简答题(32分,每题8分) 101.什么是FPGA？它有哪些优点？ 102.什么是MAX+plus2？它的设计流程是怎样的？ 103.Quartus 2有什么特点？ 104.ISE5.2的IP核复用输入方法的操作过程是什么？ 二 说明题(32分,每题16分) 201.以一个JK触发器为例，说明Modelsim的仿真步骤与方法。 202.说明 ISE5.2的配置步骤。 三 综合题(36分,每题18分) 301登录www.xilin.com网站，查找全局时钟网络VHDL和Verilog编程模板

  3. 所属分类：网络基础

    • 发布日期：2010-07-02
    • 文件大小：415kb
    • 提供者：qq642481029

  1. VHDL编写的计算器很好

  2. 1、用键盘输入相对应的数字。 2、进行加减时，用0/1控制，当为1时，在16*16的显示板上显示加号或减号或等于号。 3、在显示加减号时，把数码管清空，以便输入第二个数。 4、在显示等号时，显示出相应的结果。 5、最多只可进行5位数字的加减运算，当输入数字式，输入到

  3. 所属分类：嵌入式

    • 发布日期：2011-05-14
    • 文件大小：139kb
    • 提供者：zhaoyuemei_1104

  1. VHDL编写16*16点阵

  2. 用VHDL编写的16*16点阵，学校布置的课程设计

  3. 所属分类：专业指导

    • 发布日期：2011-12-21
    • 文件大小：43kb
    • 提供者：qinshuixi

  1. VHDL编写的16位微处理器

  2. 用VHDL语言编写的16位微处理器，包括ADD SUB MOV MVI IN OUT 等指令

  3. 所属分类：其它

    • 发布日期：2012-04-28
    • 文件大小：1mb
    • 提供者：tzh9051

  1. 计算机组成原理 8位实验CPU设计与实现

  2. 1. 深入掌握CPU的工作原理，包括ALU、控制器、寄存器、存储器等部件的工作原理； 2. 熟悉和掌握指令系统的设计方法，并设计简单的指令系统； 3. 理解和掌握小型计算机的工作原理，以系统的方法建立起整机概念； 4. 理解和掌握基于VHDL语言和TEC-CA硬件平台设计模型机的方法。 二、设计要求 　　参考所给的16位实验CPU的设计与实现，体会其整体设计思路，并理解该CPU的工作原理。在此基础上，对该16位的实验CPU（称为参考CPU）进行改造，以设计得到一个8位的CPU。总的要求是将原来

  3. 所属分类：专业指导

    • 发布日期：2013-06-04
    • 文件大小：1mb
    • 提供者：u010241224

  1. fft16点vhdl

  2. 在quartus2 9.0中用vhdl编写各个模块，再用电路图形式连接起来。做的fft16点

  3. 所属分类：其它

    • 发布日期：2014-01-14
    • 文件大小：3mb
    • 提供者：plklklklkl

  1. 8段译码显示电路 VHDL语言编写

  2. 8段译码器的用VHDL语言编写，能用16进制10进制显示数字，在Quters Ⅱ环境下编写，能广泛用于其他电路

  3. 所属分类：其它

    • 发布日期：2008-12-16
    • 文件大小：198kb
    • 提供者：hugh709

  1. 基于FPGA的电子琴设计

  2. 介绍了基于FPGA的电子琴的工作原理和设计过程。用Altera公司的EP2C8Q208C8N芯片为核心器件，通过运用硬件编程语言VHDL描述，在Quartus II平台上，实现了电子琴的手动弹奏和自动演奏功能。本系统主要由音频发生模块，键盘控制模块和存储器模块组成。选择手动弹奏模式按键时，按下音符键后就会选通相应的频率输出；选择自动演奏模式按键时，储存器会将编写好的音乐信息依次取出，去选通各个对应的频率输出，实现自动演奏。音频发生器由分频器来实现，可产生16个频率，这些频率经放大后驱动喇叭，从

  3. 所属分类：机器学习

    • 发布日期：2019-01-28
    • 文件大小：376kb
    • 提供者：swq8001

  1. verilog代码风格VerilogCodingStyle

  2. verilog代码风格VerilogCodingStyle目录 Verilog hdl程序风格指导 目录 1.引言. 般的指导方针 命名规则 注释 格式 ·· 有限状态机实现风格 文件和目录结构 13444566777 3.逻辑实现.. 设计方法 组合逻辑… 时序逻辑 4. Verilog结构 赋值 always块 ······:4·····.·····.+·::·:···+·4··· ..···· 语句 if-then-else语句 端口声明 13 函数( function)和任务(task)

  3. 所属分类：硬件开发

    • 发布日期：2019-09-02
    • 文件大小：466kb
    • 提供者：drjiachen

  1. 单片机与DSP中的一种基于CPLD 的单片机与PCI 接口设计解决方案

  2. 摘要: 　　本文描述了用赛灵思公司的XC95216 系列CPLD 芯片实现扩展单片机与计算机PC104 的接口并行通信的方法, 解决了在嵌入式操作系统中单片机与主机总线设备打交道资源不足的固有缺陷, 把以太网卡的功能集成在一片XC95216 的 CPLD 中, 简化了硬件, 通信实时性强; 并给出用VHDL 编写的主要源程序。该方案在实践中检验通过。　　引 言　　8位单片机在嵌入式系统中应用广泛, 然而让它直接与PCI 总线设备打交道却有其固有缺陷。8 位单片机只有16 位地址线, 8 位数

  3. 所属分类：其它

    • 发布日期：2020-12-05
    • 文件大小：61kb
    • 提供者：weixin_38623366