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搜索资源列表

  1. 用VHDL语言设计组合逻辑电路

  2. 实验4：用VHDL语言设计组合逻辑电路（熟悉用VHDL语言设计4位全加器的方法。首先创建一个1位全加器实体，然后例化此1位全加器4次，创建一个更高层次的4位加法器。1位全加器的VHDL语言描述见例4-45，4位加法器的VHDL语言程序如例4-46，P161-162。）

  3. 所属分类：专业指导

    • 发布日期：2010-04-03
    • 文件大小：1048576
    • 提供者：vb123jia

  1. EDA—EDA技术实用教程(pdf影印)

  2. 学习VHDL和FPGA的经典资料 第 1 章 概述 1.1 EDA 技术及其发展 1.2 EDA 技术实现目标 1.3 硬件描述语言VHDL 1.4 VHDL 综合 1.5 基于VHDL 的自顶向下设计方法 1.3 EDA 技术的优势 1.3 EDA 的发展趋势 【习题】 第 2 章 EDA 设计流程及其工具 2.1 设计流程 2.1.1 设计输入(原理图／HDL 文本编辑) 2.1.2 综合 2.1.3 适配 2.1.4 时序仿真与功能仿真 2.1.5 编程下载 2.1.6 硬件测试 2.2

  3. 所属分类：硬件开发

    • 发布日期：2010-06-07
    • 文件大小：8388608
    • 提供者：zt839486421

  1. EDA—EDA技术实用教程

  2. 综合 1.5 基于VHDL 的自顶向下设计方法 1.3 EDA 技术的优势 1.3 EDA 的发展趋势 【习题】 第 2 章 EDA 设计流程及其工具 2.1 设计流程 2.1.1 设计输入(原理图／HDL 文本编辑) 2.1.2 综合 2.1.3 适配 2.1.4 时序仿真与功能仿真 2.1.5 编程下载 2.1.6 硬件测试 2.2 ASIC 及其设计流程 2.2.1 ASIC 设计方法 2.2.2 一般ASIC 设计的流程 2.3 常用EDA 工具 2.3.1 设计输入编辑器 2.3.2

  3. 所属分类：硬件开发

    • 发布日期：2010-11-19
    • 文件大小：8388608
    • 提供者：sundyqt

  1. 基于VHDL的多功能数字钟设计

  2. 数字钟是一种用数字电路技术实现时、分、秒计时的装置，与机械式时钟相比具有更高的准确性和直观性，且无机械装置，具有更长的使用寿命，已得到广泛的使用。数字钟从原理上讲是一种典型的数字电路，其中包括了组合逻辑和时序电路。

  3. 所属分类：专业指导

    • 发布日期：2010-11-29
    • 文件大小：493568
    • 提供者：hxwangyoucao

  1. EDA实验报告二

  2. 实验二 简单组合电路的设计 一、实验目的： 熟悉QuartusII VHDL文本设计流程全过程。学习简单组合电路的设计、多层次电路设计、仿真和硬件测试。 二、实验原理 VHDL硬件描述语言是一种可以从多个层次上对数字逻辑电路进行建模的国际标准(IEEE),本次实验是用VHDL设计一个简单的数字组合逻辑电路，并结合QuartusII环境和实验电路进行硬件测试。

  3. 所属分类：专业指导

    • 发布日期：2011-12-14
    • 文件大小：123904
    • 提供者：wiinggaf

  1. vhdl教程 挺好的资源

  2. vhdl学习资料，大家喜欢就看看吧VHDL培训教程 第一讲、VHDL简介及其结构 第二讲、VHDL中的对象、操作符、数据类型 第三讲、VHDL中的控制语句及模块 第四讲、状态机的设计VHDL培训教程 欢迎参加VHDL培训 浙江大学电子信息技术研究所 电子设计自动化(EDA)培训中心 编写:王勇 TEL:7951949或7951712 EMAIL:wangy@isee.zju.edu.cn第一讲、VHDL简介及其结构 • 通过本课的学习您可以了解以下几点 1、VHDL 的基本概念 2、VHDL的

  3. 所属分类：C

    • 发布日期：2008-10-27
    • 文件大小：490496
    • 提供者：ylw51100

  1. verilog黄金参考指南中文版

  2. FPGA（Field－Programmable Gate Array），即现场可编程门阵列，它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。它是作为专用集成电路（ASIC）领域中的一种半定制电路而出现的，既解决了定制电路的不足，又克服了原有可编程器件门电路数有限的缺点以硬件描述语言（Verilog或VHDL）所完成的电路设计，可以经过简单的综合与布局，快速的烧录至 FPGA 上进行测试，是现代 IC设计验证的技术主流。这些可编辑元件可以被用来实现一些基本的逻辑门电路（比如A

  3. 所属分类：硬件开发

    • 发布日期：2017-10-12
    • 文件大小：523264
    • 提供者：zml731211092

  1. FPGA设计与案例开发

  2. FPGA设计技巧与案例开发详解第二版，内容丰满详细.以硬件描述语言（Verilog或VHDL）所完成的电路设计，可以经过简单的综合与布局，快速的烧录至 FPGA 上进行测试，是现代 IC设计验证的技术主流。这些可编辑元件可以被用来实现一些基本的逻辑门电路（比如AND、OR、XOR、NOT）或者更复杂一些的组合功能比如解码器或数学方程式。在大多数的FPGA里面，这些可编辑的元件里也包含记忆元件例如触发器（Flip－flop）或者其他更加完整的记忆块。

  3. 所属分类：其它

    • 发布日期：2018-12-08
    • 文件大小：148897792
    • 提供者：weixin_41562694

  1. verilog代码风格VerilogCodingStyle

  2. verilog代码风格VerilogCodingStyle目录 Verilog hdl程序风格指导 目录 1.引言. 般的指导方针 命名规则 注释 格式 ·· 有限状态机实现风格 文件和目录结构 13444566777 3.逻辑实现.. 设计方法 组合逻辑… 时序逻辑 4. Verilog结构 赋值 always块 ······:4·····.·····.+·::·:···+·4··· ..···· 语句 if-then-else语句 端口声明 13 函数( function)和任务(task)

  3. 所属分类：硬件开发

    • 发布日期：2019-09-02
    • 文件大小：477184
    • 提供者：drjiachen

  1. 医用呼吸机主控系统设计与应用

  2. 目前以硬件描述语言（Verilog 或 VHDL）所完成的电路设计，可以经过简单的综合与布局，快速的烧录至 FPGA 上进行测试，是现代 IC 设计验证的技术主流。这些可编辑元件可以被用来实现一些基本的逻辑门电路（比如AND、OR、XOR、NOT）或者更复杂一些的组合功能比如解码器或数学方程式。在大多数的FPGA里面，这些可编辑的元件里也包含记忆元件例如触发器（Flip-flop）或者其他更加完整的记忆块。 　　以Altera公司FPGA芯片为平台，利用SoPC技术和Nios II处理器设计并实

  3. 所属分类：其它

    • 发布日期：2020-10-22
    • 文件大小：205824
    • 提供者：weixin_38693589

  1. 浅谈卫星定位接收机载波跟踪的设计与实现

  2. 载波跟踪技术是各种卫星导航定位系统中卫星定位接收机基带处理部分的关键技术之一。随着FPGA器件规模的扩大、处理速度的提高、成本的降低目前以硬件描述语言（Verilog 或 VHDL）所完成的电路设计，可以经过简单的综合与布局，快速的烧录至 FPGA 上进行测试，是现代 IC 设计验证的技术主流。这些可编辑元件可以被用来实现一些基本的逻辑门电路（比如AND、OR、XOR、NOT）或者更复杂一些的组合功能比如解码器或数学方程式。在大多数的FPGA里面，这些可编辑的元件里也包含记忆元件例如触发器（Fl

  3. 所属分类：其它

    • 发布日期：2020-10-22
    • 文件大小：303104
    • 提供者：weixin_38746926

  1. 电源技术中的分析多电源电路的可靠性设计

  2. 随着科学技术的发展，通信系统变得越来越发达，使得通信系统的电路中，大多存在两种以上的电源，实际工程应用中还常有蓄电池提供后备供电的情况，对于这些电路，在电压变化的过程中，可能会引发电路无效复位或上电失败的故障。对此，本文提出了一种实用的解决方案。 　　图1: FPGA的上电加载机制。 　　目前以硬件描述语言（Verilog 或 VHDL）所完成的电路设计，可以经过简单的综合与布局，快速的烧录至 FPGA 上进行测试，是现代 IC 设计验证的技术主流。这些可编辑元件可以被用来实现一些基本的逻辑门

  3. 所属分类：其它

    • 发布日期：2020-10-22
    • 文件大小：135168
    • 提供者：weixin_38624557

  1. 基于梯形图-VHDL的CPLD开发方法研究

  2. 如果直接采用原理图输入工具或VHDL语言描述的方法来设计顺序控制逻辑电路，则设计效率不高。这是因为顺序控制逻辑电路中包含大量的I/O信号，控制逻辑就是这些I/O信号的逻辑组合，这些I/O信号在整个控制逻辑中会被大量引用，而原理图输入工具中的元件如逻辑门和触发器等的输入引脚数是固定的，逻辑引用不够灵活，同时，I/O信号的大量引用又会使连线过于复杂。VHDL是一种文本设计工具，不是顺序控制逻辑电路设计的专用工具，直接用它编写的顺序控制逻辑程序结构零乱，不够直观，编程及调试效率都不高。

  3. 所属分类：其它

    • 发布日期：2020-10-22
    • 文件大小：89088
    • 提供者：weixin_38640473

  1. 嵌入式系统/ARM技术中的简述现场可编程门阵列的供电原理及应用

  2. FPGA概述 　　目前以硬件描述语言（Verilog 或 VHDL）所完成的电路设计，可以经过简单的综合与布局，快速的烧录至 FPGA 上进行测试，是现代 IC 设计验证的技术主流。这些可编辑元件可以被用来实现一些基本的逻辑门电路（比如AND、OR、XOR、NOT）或者更复杂一些的组合功能比如解码器或数学方程式。在大多数的FPGA里面，这些可编辑的元件里也包含记忆元件例如触发器（Flip-flop）或者其他更加完整的记忆块。 　　系统设计师可以根据需要通过可编辑的连接把FPGA内部的逻辑块连

  3. 所属分类：其它

    • 发布日期：2020-10-22
    • 文件大小：223232
    • 提供者：weixin_38504170

  1. 基于VHDL的密码控制系统设计方案

  2. 1引言随着电子技术和ASIC技术的发展.数字系统设计向速度快、容量大、体积小、重量轻的趋势发展。目前数字系统设计可直接面向用户需求，根据系统的行为和功能要求，自上而下地逐层完成设计过程：描述、综合、优化、仿真与验证，以及器件生成。该设计过程除系统行为和功能描述外，其他设计几乎都由计算机自动完成，从而实现电子设计自动化(EDA)。这样大大地缩短了系统的设计周期，适应当今品种多、批量小的电子市场要求，提高了产品的竞争能力。由于电子设计自动化是采用硬件描述语言描述硬件电路，所以研究硬件语言及仿真、综合

  3. 所属分类：其它

    • 发布日期：2020-10-19
    • 文件大小：499712
    • 提供者：weixin_38519082

  1. EDA/PLD中的基于梯形图-VHDL的CPLD开发方法研究

  2. 引言     顺序控制逻辑电路广泛应用于机器人、全自动家用电器、工业自动化设备及其它自动化装置中，它常采用CPLD器件进行设计与实现。     如果直接采用原理图输入工具或VHDL语言描述的方法来设计顺序控制逻辑电路，则设计效率不高。这是因为顺序控制逻辑电路中包含大量的I/O信号，控制逻辑就是这些I/O信号的逻辑组合，这些I/O信号在整个控制逻辑中会被大量引用，而原理图输入工具中的元件如逻辑门和触发器等的输入引脚数是固定的，逻辑引用不够灵活，同时，I/O信号的大量引用又会使连线过于复杂。VH

  3. 所属分类：其它

    • 发布日期：2020-12-13
    • 文件大小：87040
    • 提供者：weixin_38507208