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  1. SDRAM的原理和时序

  2. SDRAM的原理和时序 SDRAM 内存模组与基本结构 SDRAM 内存芯片的内部结构
  3. 所属分类:嵌入式

    • 发布日期:2009-06-28
    • 文件大小:1mb
    • 提供者:grwzh0761
  1. SDRAM的原理和时序

  2. 1、 物理 Bank 传统内存系统为了保证 CPU的正常工作,必须一次传输完 CPU在一个传输周期内所需要的 据。而 CPU在一个传输周期能接受的数 据容量就是 CPU数据总线的位宽,单位是 bit (位)。当时控制内存与 CPU之间数据交换的北桥芯片也因此将内存总线的数据位宽 等同 CPU数据总线的位宽,而这个位宽就称之为物理 Bank(Physical Bank,下文简称 P-Bank)的 位宽。所以,那时的内存必须要组织成 P-Bank来与 CPU打交道。资格稍老的玩家应该还记 Pent
  3. 所属分类:嵌入式

    • 发布日期:2009-07-19
    • 文件大小:1mb
    • 提供者:flying1104
  1. SDRAM的原理和时序

  2. SDRAM 的原理和时序 SDRAM内存模组与基本结构 SDRAM内存芯片的内部结构 ......
  3. 所属分类:嵌入式

    • 发布日期:2009-08-13
    • 文件大小:1mb
    • 提供者:nevlater
  1. 夏普3.5"液晶屏LCD控制器与LCD屏LQ035Q7DH01在数据格式及显示时序上无法匹配,需要选用一种时序控制IC或者用CPLD来对不同数据格式的数据接口进行映射。由于CPLD面积较大、成本较高,因而通常只在需要对电路进行灵活

  2. LQ035Q7DH01 3.5"的时序,引脚定义,设计指南。LCD控制器与LCD屏LQ035Q7DH01在数据格式及显示时序上无法匹配,需要选用一种时序控制IC或者用CPLD来对不同数据格式的数据接口进行映射。由于CPLD面积较大、成本较高,因而通常只在需要对电路进行灵活配置的情况下才使用。本文时序控制IC选用夏普公司的LZ9FC22,该芯片体积小、性能稳定、专用于QVGA屏幕TFT-LCD。这是一个18位(R6G6B6)的控制器,由于本文采用的是RGB565 16位工作模式,所以将芯片输入引
  3. 所属分类:嵌入式

    • 发布日期:2009-09-29
    • 文件大小:827kb
    • 提供者:dede2009
  1. SDRAM的原理和时序

  2. SDRAM内存模组与基本结构 SDRAM内存芯片的内部结构 SDRAM的引脚与封装 SDRAM的内部基本操作与工作时序
  3. 所属分类:嵌入式

    • 发布日期:2009-10-09
    • 文件大小:1mb
    • 提供者:eagler_hzh
  1. I2C总线时序分析及其模拟

  2. 根据 I 。 C总线的特 点, 作者已在多项科研项 目 中对不 同的芯片进行 了使用。实践证明 , 用 I C总 线组成的控制系统 , 占用 I / 0线少 , 功耗低 ( 可用电 池供电) , 特别适合无电源场所安装( 例如野外 、 随身 携带控制仪器等 ) 。由于 I 。 C总线为串行扩展总线, 故不适用于实时数据采集等速度要求较高的系统, 设计时应予以注意
  3. 所属分类:C

    • 发布日期:2009-10-14
    • 文件大小:138kb
    • 提供者:cherish_only
  1. ADE7758 芯片中文手册

  2. 本文介绍基于 ADE7758 和 PIC 系列 MCU的多相多功能电能测量电表,本文重点介绍 ADE7758 的引脚及设计要点、内部寄存器功能和工作原理,以及 ADE7758 与PIC16F877 的中断接口时序。
  3. 所属分类:嵌入式

    • 发布日期:2010-01-13
    • 文件大小:112kb
    • 提供者:lessheng2004
  1. 静态时序分析基础及应用

  2. 在制程进入深次微米世代之后,芯片(IC)设计的高复杂度及系统单芯片(SOC)设计方式兴起。此一趋势使得如何确保IC质量成为今日所有设计从业人员不得不面临之重大课题。静态时序分析(Static Timing Analysis简称STA)经由完整的分析方式判断IC是否能够在使用者的时序环境下正常工作,对确保IC质量之课题,提供一个不错的解决方案。然而,对于许多IC设计者而言,STA是个既熟悉却又陌生的名词。本文将力求以简单叙述及图例说明的方式,对STA的基础概念及其在IC设计流程中的应用做详尽的介
  3. 所属分类:嵌入式

    • 发布日期:2010-03-03
    • 文件大小:745kb
    • 提供者:hugine
  1. SDRAM时序详解与基础

  2. SDRAM内存系统必须要组成一个P-Bank的位宽,才能使CPU正常工作,那么这个P-Bank位宽怎么得到呢 ?这就涉及到了内存芯片的结构。 每个内存芯片也有自己的位宽,即每个传输周期能提供的数据量。
  3. 所属分类:嵌入式

    • 发布日期:2010-03-27
    • 文件大小:1mb
    • 提供者:wolf_l_h
  1. DS1302时序详解

  2. DS1302时序详解,在网上找到的一篇文章,自己就是初学,感觉还是有点用的
  3. 所属分类:嵌入式

    • 发布日期:2010-04-03
    • 文件大小:362kb
    • 提供者:yinguangwei
  1. 基于PLD芯片的时序逻辑设计与实现I

  2. 基于PLD芯片的时序逻辑设计与实现 不错的ppt 可以看看
  3. 所属分类:嵌入式

    • 发布日期:2010-04-12
    • 文件大小:4mb
    • 提供者:gnmxd
  1. sdram的原理和时序.pdf

  2. 一、 SDRAM内存模组与基本结构 二、 SDRAM内存芯片的内部结构 三、 SDRAM的引脚与封装 ...............
  3. 所属分类:嵌入式

    • 发布日期:2010-04-27
    • 文件大小:1mb
    • 提供者:anchorxing
  1. 读时序图的好方法,比较经典!

  2. 教会你如何读芯片的时序图,好好学!比较经典!
  3. 所属分类:硬件开发

    • 发布日期:2010-06-07
    • 文件大小:169kb
    • 提供者:greg_8588
  1. 静态时序分析(Static Timing Analysis)基础及应用.pdf

  2. 静态时序分析(Static Timing Analysis)基础及应用 在制程进入深次微米世代之后,芯片(IC)设计的高复杂度及系统单芯片(SOC)设计方式兴起。此一趋势使得如何确保IC质量成为今日所有设计从业人员不得不面临之重大课题。静态时序分析(Static Timing Analysis简称STA)经由完整的分析方式判断IC是否能够在使用者的时序环境下正常工作,对确保IC质量之课题,提供一个不错的解决方案。然而,对于许多IC设计者而言,STA是个既熟悉却又陌生的名词。本文将力求以简单叙述
  3. 所属分类:嵌入式

    • 发布日期:2010-06-30
    • 文件大小:745kb
    • 提供者:yuguan
  1. 线阵CCD芯片TCD1209D驱动时序图

  2. 这个是东芝一款线阵型CCD芯片的驱动时序图
  3. 所属分类:嵌入式

    • 发布日期:2010-07-21
    • 文件大小:21kb
    • 提供者:maomaonvwang
  1. 如何看一些芯片的时序图

  2. 我们在一些文件中,比如12864的使用说明中,会有时序图。这时将教我们怎么看时序图。
  3. 所属分类:嵌入式

    • 发布日期:2010-08-08
    • 文件大小:169kb
    • 提供者:xiaoxiguangda
  1. 教会你应该如何读写芯片时序

  2. 现在很多初学者都对时序图很困惑,不知道如何下手。等看了这资料的介绍后,相信你以后看时序图编写程序不会再是问题了。。。
  3. 所属分类:硬件开发

    • 发布日期:2011-04-11
    • 文件大小:197kb
    • 提供者:snailhuang123
  1. 如何看懂时序图,并根据时序图来写程序

  2. 以后我们会遇到各种芯片,如何根据芯片时序图来写程序
  3. 所属分类:C/C++

    • 发布日期:2011-08-22
    • 文件大小:169kb
    • 提供者:zhonghang1126
  1. 如何看芯片时序

  2. 很好的介绍了时序的分析方法。可以很好的移植操作不同的芯片
  3. 所属分类:C

    • 发布日期:2014-11-17
    • 文件大小:766kb
    • 提供者:u014425718
  1. 嵌入式PCI总线主模式应用中时序转换模块设计

  2. 本文在分析嵌入式处理器与PCI接口芯片时序的基础上,详细介绍了时序转换模块的可编程逻辑设计。最后,通过仿真验证了转换模块内部逻辑设计的正确性。
  3. 所属分类:其它

    • 发布日期:2020-07-26
    • 文件大小:85kb
    • 提供者:weixin_38639642
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