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搜索资源列表

  1. 数字电子技术课程设计报告

  2. 多数表决器 --选优秀班委 一、 设计目的： 本次数字电路课程设计，我们设计了一个选优秀班委的多数表决器。在投票过程中， 有不及格科目具有最终否决权，而团委(团支书，宣传委员，组织委员)或者班级(班长，学委，体委)就按多人表决通过的方案。最后由各组的结果与是否有不及格一同进行多人表决制度。

  3. 所属分类：专业指导

  1. 设计一个6人表决电路

  2. 设计一个6人表决电路：表决输入采用自恢复按键（即点动后能够自动复位的那种）表决结果用数码管显示：几人同意、几人反对，几人弃权；

  3. 所属分类：专业指导

    • 发布日期：2010-01-03
    • 文件大小：406kb
    • 提供者：fujx333

  1. 数字电子课程设计报告

  2. 自主设计一个能实现表决功能的组合逻辑电路，要求输出信号的电平与输入信号中的多数电平一致。

  3. 所属分类：专业指导

    • 发布日期：2010-07-02
    • 文件大小：200kb
    • 提供者：ningmeng1129

  1. 十人表决器

  2. 本课程设计主要利用PLC来完成一个十人投票机，能够对十人投票表决结果进行判断，并通过不同的LED数码管进行显示。该设计的硬件电路主要由三个部分组成：PLC模块、输入按钮开关及输出发光二级管。信号处理和转换由PLC模块来完成，其负责把按钮开关传送来的信号经一定的处理，并发出相应的输出信号。按钮开关进行输入，包括十个投票端、一个总开关和一个复位按钮。四个发光二极管包括一个电源显示和三个结果显示，不同结果对应亮不同发光二级管。

  3. 所属分类：专业指导

    • 发布日期：2012-08-02
    • 文件大小：461kb
    • 提供者：zdq920293058

  1. 三人表决器设计

  2. 设计一个A、B、C三人表决电路。当表决某个提案时，多数人同意，提案通过，同时A具有否决权

  3. 所属分类：C

    • 发布日期：2013-01-12
    • 文件大小：1mb
    • 提供者：qq839988927

  1. 数字逻辑实验指导书

  2. 目录 第一部分 实验准备 第一章 数字逻辑实验要求 预备-1 第二章 数字逻辑实验基本知识 预备-2 第三章 MAX+plus II实验操作步骤 预备-5 第二部分 实验 实验一 逻辑门电路的功能与测试 实验-1 （一） 或门的逻辑功能测试 （二） 与非门74LS00的逻辑功能测试 （三） 或非门74LS02的逻辑功能测试 （四） 与非门74LS20的逻辑功能测试 （五） 异或门74LS86的逻辑功能测试 实验二 复合逻辑电路功能的实现测试 实验-6 （一） 用与非门组成异或门并测试验证其功能

  3. 所属分类：讲义

    • 发布日期：2018-11-27
    • 文件大小：720kb
    • 提供者：qq_41614770

  1. 四人多数表决器电路 源码+test+仿真截图（ise）

  2. 设计一个四人多数表决器电路：当有3人或3人以上同意，表决结果F=1，否则F=0。

  3. 所属分类：其它

    • 发布日期：2018-12-23
    • 文件大小：224kb
    • 提供者：weixin_43809352

  1. 罗克韦尔自动化 XM360过程量模块产品介绍（中文）.pdf

  2. 罗克韦尔自动化 XM360过程量模块产品介绍（中文）pdf,罗克韦尔自动化 XM360过程量模块产品介绍（中文）报 非易失的组态信息 敷形涂覆 所有的印刷电路板都进行敷形涂覆 数量:对报警和危险 符合材料技术指标 运算符 模块的组态信息备份在非易失的存 所有的印刷电路 大十 储器内,当系统上电时从该存储器符合 小于 中读取组态信息。 板都进行敷形涂覆 符合材料技术指标 范围内 范围欠 存储在扑易失存储器4的组态信息只能 利用串口组态软件递过口,或者从任符 滞值:由用户定义 何 的兼容软件中发送模

  3. 所属分类：其它

    • 发布日期：2019-10-19
    • 文件大小：250kb
    • 提供者：weixin_38743506

  1. 数字电路报告

  2. 实验内容 1．初步掌握大规模可编程数字逻辑器件开发软件MAX-plusⅡ的最基本操作和使用方法。 2．设计一个三输入表决逻辑功能电路。 3．用GDF原理图输入法、TDF逻辑表达式输入法、TDF真值表输入法建立该电路功能，并且需要进行逻辑仿真。 4．编译和仿真正确后下载到实验箱，证明设计的正确性。

  3. 所属分类：专业指导

    • 发布日期：2012-10-29
    • 文件大小：47kb
    • 提供者：baobao3456810

  1. 单片机与DSP中的单片机多机冗余设计及控制模块的VHDL语言描述

  2. 摘要：以三个单片机组成的系统为例介绍一种单片机多机冗余容错设计。阐述设计中关键的时钟同步技术和总线仲裁方法，给出控制模块的VHDL语言描述。 　　关键词：单片机 冗余容错 时钟 总线 VHDL 本文提出一种表决式单片机多机冗余设计方案。该方案不同于中央系统的多机冗余设计。大规模系统冗余大多采用完善而复杂的机间通讯协议实现系统重构，不太注重系统的实时性。本方案结构简单，易于实现，具有极强的实时性，没有电子开关切换总线的咔嗒声输出。单片机价格低廉、功能灵活，也使得该设计在类似仪器仪表的小系统中

  3. 所属分类：其它

    • 发布日期：2020-12-07
    • 文件大小：128kb
    • 提供者：weixin_38515362

  1. 单片机多机冗余设计及控制模块的VHDL语言描述

  2. 摘要：以三个单片机组成的系统为例介绍一种单片机多机冗余容错设计。阐述设计中关键的时钟同步技术和总线仲裁方法，给出控制模块的VHDL语言描述。 本文提出一种表决式单片机多机冗余设计方案。该方案不同于中央系统的多机冗余设计。大规模系统冗余大多采用完善而复杂的机间通讯协议实现系统重构，不太注重系统的实时性。本方案结构简单，易于实现，具有极强的实时性，没有电子开关切换总线的咔嗒声输出。单片机价格低廉、功能灵活，也使得该设计在类似仪器仪表的小系统中的运用成为可能。1设计原理设计结构如图1所示。完成整个冗余

  3. 所属分类：其它

    • 发布日期：2021-02-03
    • 文件大小：115kb
    • 提供者：weixin_38665411