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搜索资源列表

  1. veriloghdl教程

  2. 随着电子设计技术的飞速发展，专用集成电路(ASIC)和用户现场可 编程门阵列（FPGA）的复杂度越来越高。数字通信、工业自动化控制等领 域所用的数字电路及系统其复杂程度也越来越高，特别是需要设计具有实 时处理能力的信号处理专用集成电路，并把整个电子系统综合到一个芯片 上。设计并验证这样复杂的电路及系统已不再是简单的个人劳动，而需要 综合许多专家的经验和知识才能够完成。由于电路制造工艺技术进步非常 迅速，电路设计能力赶不上技术的进步。在数字逻辑设计领域，迫切需要 一种共同的工业标准来统一对数字逻

  3. 所属分类：其它

    • 发布日期：2009-05-30
    • 文件大小：1mb
    • 提供者：zhmjava

  1. Verilog HDL设计方法概述

  2. 随着电子设计技术的飞速发展，专用集成电路(ASIC)和用户现场可编程门阵列（FPGA）的复杂度越来越高。数字通信、工业自动化控制等领域所用的数字电路及系统其复杂程度也越来越高，特别是需要设计具有实时处理能力的信号处理专用集成电路，并把整个电子系统综合到一个芯片上。设计并验证这样复杂的电路及系统已不再是简单的个人劳动，而需要综合许多专家的经验和知识才能够完成。由于电路制造工艺技术进步非常迅速，电路设计能力赶不上技术的进步。在数字逻辑设计领域，迫切需要一种共同的工业标准来统一对数字逻辑电路及系统的

  3. 所属分类：其它

    • 发布日期：2010-05-28
    • 文件大小：196kb
    • 提供者：boytodance

  1. 基于8051软核的SOPC系统设计与实现

  2. 绍了基于IP的可重用的SOC设计方法；选用MC8051 IP 核为核心控制器，自主开发了UART IP核、I2C IP核、USB IP核，采用Wishbone 片上总线架构，集成了一个MCU系统；同时设计了针对此MCU系统的微机调试软件和硬件调试器，并实现了MCU系统的FPGA验证和整个系统的功能验证。设计中采用了开发8051行为模型的方式，缩短了系统仿真的时间；而USB IP核设计则采用双缓冲区结构，方便了系统集成，提高了传输速度。

  3. 所属分类：嵌入式

    • 发布日期：2011-03-03
    • 文件大小：123kb
    • 提供者：cy935397994

  1. 软软核验证方法

  2. 软核验证方法研究

  3. 所属分类：硬件开发

    • 发布日期：2013-03-12
    • 文件大小：4mb
    • 提供者：zzg207

  1. 16Kbs类MELP语音压缩编码器的FPGA实现

  2. 基于"CPU软核+模块算法IP"的方法对一个1.6Kb／s类MELP语音压缩编码算法进行了实现，并将整个语音压缩编码器在FPGA上进行了整体验证，实验结果说明本文给出的语音压缩编码器的实现结构是可行的，能够满足语音压缩编码 算法对实时性的要求，从而为下一阶段语音压缩编码器的芯片设计提供有力的可行性论据．同时，由于本文给出的语音压缩编码器的实现结构中的各模块算法IP对于许多语音压缩编码算法中都适用，因此该语音压缩编码器的实现结构对不同的语音压缩编码算法具有一定的通用性．

  3. 所属分类：硬件开发

    • 发布日期：2014-03-09
    • 文件大小：373kb
    • 提供者：sunnyapi163com

  1. 基于C51软核的SOC温度检测系统

  2. 本课题就是要以FPGA/CPLD器件作为载体，以现代EDA技术为手段，利用自顶向下的设计方法，通过VHDL语言，实现一个与8051系列单片机指令兼容的微控制器芯片的 IP核。并利用C语言编写一个LCD温度显示系统，在EP4CE115F29C7（FPGA）芯片上对设计8051IP 核进行验证。

  3. 所属分类：嵌入式

    • 发布日期：2016-04-11
    • 文件大小：17mb
    • 提供者：yexiang520

  1. FPGA黑金开发板用户手册

  2. 本手册中描述了”黑金动力”系列开发板的设计原理和使用方法,作为开发板的配套 说明材料. 这套开发板主要是面向 FPGA 的初级,中级开发人员,或者对 FPGA 感兴趣的爱好者, 偏向个人用户.这套开发板采用核心板与扩展板分离的方式,简单实用,扩展性好,特别适 合爱好者的快速入门和开发人员的产品开发验证,也适合做更深入的 IC 前端设计.在这 套开发板上,一切皆有可能. 同时,这套开发板也提供了一个 SOPC 平台,可以实现嵌入式的软核,如 NIOSII,Open RISC 等,为嵌入式电子产品

  3. 所属分类：硬件开发

    • 发布日期：2018-01-10
    • 文件大小：1mb
    • 提供者：qq_31254409

  1. 并行数据采集模块研制

  2. 在硬件逻辑研制过程中，采用了基于 IP 核的片上系统设计方法，充分利用 了 Quartus 软件平台的各项功能，在深入理解各器件功能和时序特征的基础上 设计了自定义的数据采样和数据通信 IP 核，配置了 DDR II 存储器 IP 核，增大 了模块功能的灵活性。随后搭建了基于 Qsys 和 NIOS 处理器软核的片上系统， 并对系统的逻辑功能进行了仿真验证。在软件设计中，说明了片上系统的软件 设计过程，并利用 VISA 函数库设计了符合 VPP 规范的驱动程序，给出了驱动 函数树和主要函数的功

  3. 所属分类：专业指导

    • 发布日期：2018-03-16
    • 文件大小：4mb
    • 提供者：qq_41755356

  1. 基于改进PSO-SVM的燃煤电厂烟气含氧量软测量

  2. 针对燃煤电厂烟气含氧量测量成本高、使用过程复杂且精度低等问题，应用软测量的方法来代替氧量传感器估计锅炉烟气含氧量。首先分析烟气含氧量的化学原理和锅炉工艺，初步选取合理的辅助变量，同时引入邓氏关联度分析法对燃煤电厂数据做降维处理，利用支持向量机建立辅助变量与烟气含氧量之间的软测量模型。其次，针对软测量模型参数优化问题，提出一种改进的粒子群优化算法，并对模型中的惩罚参数和核函数参数进行优化，进而利用算法得到的优化值构建改进的烟气含氧量软测量模型。最后，通过仿真验证改进的粒子群优化算法的有效性，并与传

  3. 所属分类：其它

  1. FPGA自学笔记——设计与验证VIP版.pdf

  2. 开始有计划写这本书的时候， Altera 还叫 Altera， 还没有加入 Intel 的大家庭， Xilinx 的 ZYNQ 也才刚刚开始有人探索， Altera 大学计划第一次将亚洲创新大赛由传统的 SOPC 大赛 换成了 SOC 大赛，软核变硬核，性能翻几番。 那个时候，能出一本认认真真讲 FPGA 设计的 书， 会得到非常高的评价。 而我，则由于工作变动， 中间拖沓了半年，当半年后再来准备动 笔时，才恍然领悟到， Altera 即将成为 Intel 的可编程事业部， 基于嵌入式硬核的 S

  3. 所属分类：硬件开发

    • 发布日期：2019-09-03
    • 文件大小：16mb
    • 提供者：qq_30307853

  1. 8位RISC MCU IP软核仿真的新方法

  2. 本文使用Microchip的PIC系列汇编器MPASM汇编生成HEX文件rom.hex，HEX文件由一条或多条记录组成，每行是一条16进制表示的记录。通过分析HEX文件的格式，可以通过转化HEX文件中的记录得到所需的ROM文件。本文使用VC设计了转化程序HEX2ROM，用来完成HEX文件到ROM文件的自动转化，rom.hex文件经程序转化后生成rom.dat。仿真时在测试文件中读入rom.dat完成对虚拟程序存储器初始化，模拟程序存储器模块对MCU核进行验证。

  3. 所属分类：其它

    • 发布日期：2020-10-22
    • 文件大小：205kb
    • 提供者：weixin_38515362

  1. 基于ADSP-BF537的视频SOC验证方案

  2. 随着硅片集成技术的高速发展，片上系统SoC(system-on-a-Chip)已经成为现代数字系统设计的必然趋势。SoC和一般数字系统最主要的区别是前者在单一硅片内集成了独立的嵌入式CPU，必要的存储器控制器也要求集成到SoC芯片内，所以对SoC系统的软硬件协同实时验证便成为SoC设计的难点。基于IP的可重用设计方法已经成为数字系统设计工程师普遍采用的系统设计方法。于是，设计者采用第三方IP或自行设计的软核或两者的组合来搭建符合要求的系统。对于一个SoC系统，嵌入式CPU的选择至关重要。

  3. 所属分类：其它

    • 发布日期：2020-10-22
    • 文件大小：535kb
    • 提供者：weixin_38706531

  1. 基于FPGA的32位ALU软核设计

  2. 介绍了一种基于可编程逻辑器件FPGA和硬件描述语言VHDL的32位ALU的设计方法。该ALU采取层次化设计方法，由控制模块、逻辑模块、加减法模块、乘法模块和除法模块组成，能实现32位有符号数和无符号数的加减乘除运算，另外还能实现9种逻辑运算、6种移位运算以及高低字节内容互换。该ALU在QuartuslI软件环境下进行了功能仿真，通过验证表明，所设计的ALU完全正确，可供直接调用。

  3. 所属分类：其它

    • 发布日期：2020-10-23
    • 文件大小：135kb
    • 提供者：weixin_38720322

  1. 嵌入式系统/ARM技术中的AEMB软核处理器的SoC系统验证平台

  2. 引  言 　　SoC芯片的规模一般远大于普通的ASIC，同时深亚微米工艺带来的设计困难等使得SoC设计的复杂度大大提高。仿真与验证是SoC设计流程中最复杂、最耗时的环节，约占整个芯片开发周期的50％～80％，采用先进的设计与仿真验证方法成为SoC设计成功的关键。一个简单可行的SoC验证平台，可以加快SoC系统的开发与验证过程。FPGA器件的主要开发供应商都针对自己的产品推出了SoC系统的开发验证平台，如基于NiosII微处理器的SOPC系统与基于MicroBlaze微处理器的SOPC系统等。它

  3. 所属分类：其它

    • 发布日期：2020-11-07
    • 文件大小：175kb
    • 提供者：weixin_38627104

  1. 单片机与DSP中的基于ADSP-BF537的视频SOC验证方案设计

  2. (1．华中科技大学电子科学与技术系，湖北武汉430074；2．深圳艾科创新微电子有限公司，广东深圳518057) 随着硅片集成技术的高速发展，片上系统SoC(system-on-a-Chip)已经成为现代数字系统设计的必然趋势。SoC和一般数字系统最主要的区别是前者在单一硅片内集成了独立的嵌入式CPU，必要的存储器控制器也要求集成到SoC芯片内，所以对SoC系统的软硬件协同实时验证便成为SoC设计的难点。基于IP的可重用设计方法已经成为数字系统设计工程师普遍采用的系统设计方法。于是，设

  3. 所属分类：其它

    • 发布日期：2020-12-10
    • 文件大小：304kb
    • 提供者：weixin_38628612

  1. 电源技术中的M8051 IP软核的改进性设计及其在视频字符叠加器中的重应用

  2. 摘要：介绍了系统芯片SOC的概念和M8051 IP软核的原理，给出了视频字符叠加器VAD——SOC中M8051 IP软核的作用，详细介绍了I2C主控制器模块的设计，给出了功能信真波形，最后对M8051 IP软核在视频字符叠加器中的重应用进行了深入研究。 关键词：系统芯片 微控制器 M8051 IP软核 视频字符叠加器随着集成电路制造技术的快速发展，集成电路的规模不断扩大。这使得将复杂系统集成在单个芯片上成为可能，于是便出现了系统芯片SOC（System on a Chip）。传统芯片设计方

  3. 所属分类：其它

    • 发布日期：2020-12-10
    • 文件大小：92kb
    • 提供者：weixin_38694355

  1. 嵌入式系统/ARM技术中的基于8051软核的SOPC系统设计与实现

  2. 摘要：介绍了基于IP的可重用的SOC设计方法；选用MC8051 IP核为核心控制器，自主开发了UART IP核、I2C IP核、USB IP核，采用Wishbone片上总线架构，集成了一个MCU系统；同时设计了针对此MCU系统的微机调试软件和硬件调试器，并实现了MCU系统的FPGA验证和整个系统的功能验证。设计中采用了开发8051行为模型的方式，缩短了系统仿真的时间；而USB IP核设计则采肜双缓冲区结果，方便了系统做成，提高了传输速度。 关键词：SOPC IP核 WISHBONE 片上总

  3. 所属分类：其它

    • 发布日期：2020-12-10
    • 文件大小：120kb
    • 提供者：weixin_38671628

  1. 单片机与DSP中的基于ADSP—BF537的视频SOC验证方案设计

  2. 随着硅片集成技术的高速发展，片上系统SoC(system-on-a-Chip)已经成为现代数字系统设计的必然趋势。SoC和一般数字系统最主要的区别是前者在单一硅片内集成了独立的嵌入式CPU，必要的存储器控制器也要求集成到SoC芯片内，所以对SoC系统的软硬件协同实时验证便成为SoC设计的难点。基于IP的可重用设计方法已经成为数字系统设计工程师普遍采用的系统设计方法。于是，设计者采用第三方IP或自行设计的软核或两者的组合来搭建符合要求的系统。对于一个SoC系统，嵌入式CPU的选择至关重要。第三方提

  3. 所属分类：其它

    • 发布日期：2020-12-06
    • 文件大小：97kb
    • 提供者：weixin_38687277

  1. 应用于SoC设计中IP核的接口技术

  2. 引言 　　随着半导体技术的发展,深亚微米工艺加工技术允许开发上百万门级的单芯片，已能够将系统级设计集成到单个芯片中即实现片上系统SoC。IP核的复用是SoC设计的关键，但困难在于缺乏IP核与系统的接口标准，因此，开发统一的IP核接口标准对提高IP核的复用意义重大。本文简单介绍IP核概念，然后从接口标准的角度讨论在SoC设计中提高IP核的复用度，从而简化系统设计和验证的方法，主要讨论OCP(开放核协议)。 　　图1 OCP工作原理示意图 　　图2  读/写操作的时序 　　图3  读/

  3. 所属分类：其它

    • 发布日期：2020-12-07
    • 文件大小：138kb
    • 提供者：weixin_38690830

  1. 基于携带证明代码的IP核安全性验证方法

  2. 针对集成电路在RTL代码级设计阶段由于使用第三方IP软核引入的安全性问题，现有的功能测试方法较难实现全覆盖检测无法保障电路安全性。本文在已有基于携带证明代码思想的基础上改进提出一种安全性验证方法。该方法结合形式化验证平台coq，运用形式化逻辑描述电路代码和安全性假设，构造证明过程并采用系统的证明检查器验证证明过程。通过在DES电路代码的实验，说明了该验证方法能有效检测出电路中后门路径类型的硬件*。相比较于测试类方法覆盖率不能达到100%而无法确定电路是非安全性，本文提出的方法可以确定电路是安全

  3. 所属分类：其它

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