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搜索资源列表

  1. PCB高速板 布线 信号完整性分析

  2. 很有用的pcb高速板 布线规则 信号完整性分析 其实我也还没看完呢 不过感觉挺有用的~~~

  3. 所属分类：专业指导

    • 发布日期：2009-12-06
    • 文件大小：31457280
    • 提供者：fangyu20

  1. protel软件的PCB布线规则

  2. 讲述PCB布线规则，含电磁兼容，电磁干扰 注意事项 高速电路板布线规则

  3. 所属分类：硬件开发

    • 发布日期：2009-12-29
    • 文件大小：95232
    • 提供者：yyw_1980

  1. High-speed Board Design Techniques

  2. AMD公司高速板设计指南，PCBlayout必读教程。 INTRODUCTION The most important factor in the design of many systems today is speed. 66-MHz thru 200-MHz processors are common; 233 and 266MHz processors are becoming readily available. The demand for high speed results f

  3. 所属分类：专业指导

    • 发布日期：2010-04-10
    • 文件大小：1048576
    • 提供者：linhu139

  1. pcb布线规则与信号完整性

  2. 该文档主要讲的是PCB相关的布线规则，以及什么情况下的该怎么布线，布线的要点，不同速度下的布线情况，主要分为高速和低速布线相关注意事项.例如电源、地线的处理； 数字电路与模拟电路的共地处理； 信号线布在电（地）层上 在多层印制板布线时，由于在信号线层没有布完的线剩下已经不多，再多加层数就会造成浪费也会给生产增加一定的工作量，成本也相应增加了，为解决这个矛盾，可以考虑在电（地）层上进行布线。 大面积导体中连接腿的处理；布线中网络系统的作用等

  3. 所属分类：网络基础

  1. PCB 高速布线法则

  2. 该文档详细的解说关于PCB高速信号布线的规则

  3. 所属分类：专业指导

    • 发布日期：2010-04-14
    • 文件大小：403456
    • 提供者：uwjun

  1. DSP硬件设计指南实战篇

  2. 高速DSP 布线规则，模拟和数字信号相互干扰问题的解决 时钟线的处理，低功耗的设计注意事项

  3. 所属分类：硬件开发

    • 发布日期：2011-02-19
    • 文件大小：1048576
    • 提供者：billcai1120

  1. pcb布线规则的总结，pcb板子的设计规则

  2. 1.1 PCB板上预划分数字、模拟、DAA信号布线区域。 1.2 数字、模拟元器件及相应走线尽量分开并放置於各自的布线区域内。 1.3 高速数字信号走线尽量短。 1.4 敏感模拟信号走线尽量短。 1.5 合理分配电源和地。 1.6 DGND、AGND、实地分开。 1.7 电源及临界信号走线使用宽线。 1.8 数字电路放置於并行总线/串行DTE接口附近，DAA电路放置於电话线接口附近。

  3. 所属分类：专业指导

    • 发布日期：2011-03-06
    • 文件大小：1048576
    • 提供者：seanh1234

  1. 华为布线规则（pcb设计）

  2. 华为pcb的布线规则，很实用。画pcb板的时候参考这个比较规范。特别是高速板。

  3. 所属分类：硬件开发

    • 发布日期：2011-09-02
    • 文件大小：486400
    • 提供者：kixicc

  1. DDR高速布线规则

  2. DDR高速布线规则，基本的几个要点，那些需要等长，差分

  3. 所属分类：嵌入式

    • 发布日期：2011-12-06
    • 文件大小：25600
    • 提供者：love44570510

  1. PADS 2005高速布线

  2. PADS 2005高速布线规则全集 高速问题探讨 – 高速现象描述 – 高速的概念及分类 – 高速问题产生机理 – 从仿真波形识别高速问题 – 高速问题解决方案

  3. 所属分类：硬件开发

    • 发布日期：2012-03-27
    • 文件大小：5242880
    • 提供者：ltlt66126

  1. ALLEGRO 高级约束规则 _ .pdf

  2. ALLEGRO约束规则_ .pdf 在进行高速布线时，一般都需要进行线长匹配，这时我们就需要设置好 constraint 规则，并将这些规则分配到各类 net group 上。下面以 ddr 为例，具体说明这些约束设置的具体步骤。 1． 布线要求 DDR 时钟: 线宽 10mil，内部间距 5mil，外部间距 30mil，要求差分布线，必需精确匹配差分对走线误差，允许在＋20mil 以 内 DDR 地址、片选及其他控制线：线宽 5mil，内部间距 15mil，外部间距 20mil，应走成菊花链

  3. 所属分类：硬件开发

    • 发布日期：2013-04-23
    • 文件大小：1048576
    • 提供者：yuanqing17

  1. BGA 布线规则

  2. BGA布线规则 BGA布线规则 可能对你高速布线有用

  3. 所属分类：硬件开发

    • 发布日期：2013-08-03
    • 文件大小：247808
    • 提供者：mengzhizui2

  1. 高速pcb设计指南

  2. 高速pcb设计指南，学习高速PCB布局布线规则。

  3. 所属分类：硬件开发

    • 发布日期：2014-04-20
    • 文件大小：403456
    • 提供者：handsomeboy1033

  1. DDR布局布线规则与实例【中为电子科技工作室】

  2. DDR属于高速电子电路范畴，在Layout时需要做等长处理，本文介绍了DDR的布局布线规则，图文并茂，易学易懂。

  3. 所属分类：硬件开发

    • 发布日期：2015-02-04
    • 文件大小：4194304
    • 提供者：u010315448

  1. 高速数字设计与信号完整性分析布线规则

  2. 高速数字设计与信号完整性分析布线规则,有用到的可以看看

  3. 所属分类：专业指导

    • 发布日期：2008-11-19
    • 文件大小：45056
    • 提供者：supremeqi

  1. DDR布线规则与过程

  2. 讲述DDR颗粒从布局到布线的一些实践经验，有效的帮助初学者提高对高速芯片布局布线的理解。

  3. 所属分类：硬件开发

    • 发布日期：2018-05-31
    • 文件大小：1048576
    • 提供者：sramer

  1. DLP350推荐PCB布线规则.docx

  2. DLP350芯片，高速信号有两部分，一个是HDMI部分，一个是DMD信号部分。对阻抗匹配，长度，等长，有较严格要求。

  3. 所属分类：嵌入式

    • 发布日期：2020-04-17
    • 文件大小：248832
    • 提供者：zxq46964890

  1. PCB高速线总体布线规则

  2. 本文主要为PCB高速线总体布线规则，下面一起来学习下

  3. 所属分类：其它

    • 发布日期：2020-07-16
    • 文件大小：27648
    • 提供者：weixin_38659622

  1. pcb布线规则经典必读

  2. pcb布线规则,布板需要注意的点很多，但是基本上注意到了下面的这此规则，LAYOUT PCB应该会比较好，不管是高速还是低频电路，都基本如此。

  3. 所属分类：其它

    • 发布日期：2020-08-19
    • 文件大小：103424
    • 提供者：weixin_38628150

  1. PCB布线规则大全

  2. 1.1 PCB板上预划分数字、模拟、DAA信号布线区域。 1.2 数字、模拟元器件及相应走线尽量分开并放置於各自的布线区域内。 1.3 高速数字信号走线尽量短。 1.4 敏感模拟信号走线尽量短。

  3. 所属分类：其它

    • 发布日期：2020-08-26
    • 文件大小：117760
    • 提供者：weixin_38698860
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