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搜索资源列表

  1. 基于CPLD的出租车计价器

  2. 本出租车计价器由XC95108CPLD处理主要逻辑，主要判断速度，处理路程和价格。单片机产生速度判断标准信号送入CPLD，并负责显示部分。该系统计程范围0~999.9km，计价范围0~999.9元。采用TTL电平标准。在频率范围0~100Hz内最大误差为0.5%，通过12864实时显示行驶时间，行驶路程，当前费用，是理想出租车计价系统的解决方案。

  3. 所属分类：硬件开发

    • 发布日期：2009-05-21
    • 文件大小：499kb
    • 提供者：yanshunfei

  1. 基于CPLD&FPGA的出租车计费器

  2. ：介绍一种以单片机AT89S52为核心的多功能出租车计价器的设计，阐述软硬件设计过程中关键技术的处理。 仿真结果表明该计价器具有集计程、计时、计费、存储、查看、统计等多种计量功能，并且具有超速提醒、防止司机作弊、语音、 打印和显示等多种功能。与已有的系统相比，该系统具有超速提醒等更强的功能。

  3. 所属分类：硬件开发

    • 发布日期：2009-06-15
    • 文件大小：392kb
    • 提供者：lzwsdu

  1. Verilog语言编写的VGA显示-俄罗斯方块

  2. 这是我们CPLD课程设计所作，VGA显示。俄罗斯方块的一部分

  3. 所属分类：C/C++

    • 发布日期：2009-07-19
    • 文件大小：2mb
    • 提供者：yangxiaoyu1987

  1. CPLD在显示屏系统中的应用.pdf

  2. NIOS的字符液晶显示控制专业文章，有需要做NIOS并且不是很熟悉LCD接口的可以看下。

  3. 所属分类：iOS

    • 发布日期：2009-09-13
    • 文件大小：116kb
    • 提供者：anning0432

  1. 夏普3.5"液晶屏LCD控制器与LCD屏LQ035Q7DH01在数据格式及显示时序上无法匹配，需要选用一种时序控制IC或者用CPLD来对不同数据格式的数据接口进行映射。由于CPLD面积较大、成本较高，因而通常只在需要对电路进行灵活

  2. LQ035Q7DH01 3.5"的时序，引脚定义，设计指南。LCD控制器与LCD屏LQ035Q7DH01在数据格式及显示时序上无法匹配，需要选用一种时序控制IC或者用CPLD来对不同数据格式的数据接口进行映射。由于CPLD面积较大、成本较高，因而通常只在需要对电路进行灵活配置的情况下才使用。本文时序控制IC选用夏普公司的LZ9FC22，该芯片体积小、性能稳定、专用于QVGA屏幕TFT-LCD。这是一个18位（R6G6B6）的控制器，由于本文采用的是RGB565 16位工作模式，所以将芯片输入引

  3. 所属分类：嵌入式

    • 发布日期：2009-09-29
    • 文件大小：827kb
    • 提供者：dede2009

  1. C51+CPLD的点阵LED显示(包括时间/BBS/年月日)

  2. 压缩包里面有C51和CPLD的相关程序；还有C51、CPLD、大功率三级管TIP127和时钟芯片DS1687的PDF资料。如果有感性趣的朋友，希望会对你们有帮助。

  3. 所属分类：C

    • 发布日期：2009-10-13
    • 文件大小：6mb
    • 提供者：ssssaaaa_aa

  1. CPLD 电子钟设计全套程序

  2. 用CPLD设计电子时钟 具有 1、时、分、秒六位数码管显示（标准时间）； 2、具有小时、分钟校准和清零暂停功能； 3．具有定时闹钟功能； 4．具有跑秒功能； 5．整点报时：55，56，57，58，59低音响，正点高音，间断振铃。

  3. 所属分类：专业指导

    • 发布日期：2009-11-06
    • 文件大小：485kb
    • 提供者：hbycxy123

  1. 基于CPLD的LED显示控制板

  2. ：介绍LED点阵屏显示的机制和软件、硬件的设计实现．分析了LED点阵显示屏驱动机制，以 及点阵显示的系统框架．系统硬件以CPU(89C51)和CPLD(EPM7128SLC8)为基础．89C51的主程 序用于接受RS232串口数据、根据内码搜索汉字库、将点阵码输出等功能；EPM7128SLC8代替 89C51的外围电路，实现点阵码移位和行扫描功能，减轻了CPU的处理任务，设计灵活、可靠，使刷 屏率比普通的LED显示控制板明显提高

  3. 所属分类：C

    • 发布日期：2009-12-12
    • 文件大小：189kb
    • 提供者：adwardray

  1. Altera杯CPLD电路设计竞赛基于SOPC的倒计时牌

  2. 本作品以Alter公司的CPLD——EPM1270为开发平台，通过扩展必要的外围显示电路，从而完成了基于SOPC的倒计时牌的设计。该倒计时牌的倒计时时间可在1秒到1000天之间任意设定。除倒计时的功能之外，还增加了万年历的功能，可正确显示2000～2099年的日期和时间。

  3. 所属分类：专业指导

    • 发布日期：2009-12-27
    • 文件大小：409kb
    • 提供者：huangqj77

  1. CPLD与ＰＣ机通信

  2. 假设在软件Test_uart里选择“2”发送，对应发送5BH(01011011)，南低位到高位发送顺序：11011010。仿真波形图如图3所示，若干时间段后，seg_D从00变成5B。而信号seg_D连接数码管，此时数码管显示“2”。

  3. 所属分类：嵌入式

    • 发布日期：2009-12-27
    • 文件大小：199kb
    • 提供者：llllgggg123

  1. CPLD/FPGA 出租车计价器的设计

  2. 设计一个出租车计价器，能按照路程计费，具体要求如下： （1）里程计费：按照行驶里程计费，起步价为6.00元，并在车行驶3Km后按1.5元/Km计费，当行车距离大于10km后，每千米加收50%的车费，车停止和暂停不计费。 （2）面板显示：设计车费和路程显示器，分别采用3位数码管动态扫描电路实现，即各有一位小数。 （3）采用开关模拟出租车的起动（司机翻下空车标牌）、停止（司机翻上空车标牌）、暂停。 2. 设计要求： 本设计中分模块必须由VHDL语言编程实现，总系统可以采用原理图或VHDL文本实现，

  3. 所属分类：硬件开发

    • 发布日期：2010-01-08
    • 文件大小：138kb
    • 提供者：fuchanghu

  1. 出租车计费显示系统设计

  2. 出租车计费显示系统设计 基于CPLD的设计

  3. 所属分类：专业指导

    • 发布日期：2010-03-03
    • 文件大小：161kb
    • 提供者：lw5936139706

  1. 基于CPLD数字函数信号发生器的设计

  2. 针对传统信号源精度低的特点 , 提出一种新的函数信号发生器设计方案 。这里介绍的函数信号发生器由 CPL D 、单片机控制模块 、键盘、L ED 显示 、D/ A 转换模块组成 。采用直接数字频率合成 (DD FS) 技术 ,用单片机控制 CPL D 的 方法产生正弦波 、方波 、三角波和占空比可调的矩形波 。该系统具有频率范围宽 ,步进小 ,幅度和频率的精度高等特点 。

  3. 所属分类：硬件开发

    • 发布日期：2010-03-20
    • 文件大小：110kb
    • 提供者：a375996882

  1. 基于单片机和CPLD共同控制的LED大屏幕显示系统的设计与实现

  2. 本文给出了基于单片机AT91SAM7SE32和CPLD EPM3128ALC100为核心控制的LED大屏幕显示器的设计方案,本方案设计的主要目的是在保证系统稳定的前提下实现对LED显示屏灵活多样的控制并扩展其它功能的目的。

  3. 所属分类：硬件开发

    • 发布日期：2010-06-01
    • 文件大小：647kb
    • 提供者：zwr8749

  1. cpld EP240电路原理图

  2. cpld EP240电路原理图 内有led灯 数码管 点阵显示 串口 VGA输出 AD/DA lcd1602，12864等模块电路图

  3. 所属分类：硬件开发

    • 发布日期：2010-06-16
    • 文件大小：68kb
    • 提供者：mlk321

  1. CPLD实用设计50例，比较全的资料

  2. CPLD实用设计50例 CPLD 的EL 显示系统 CPLD 在等精度测频系统中的应用 CPLD 在视频采集系统中的应用和设计

  3. 所属分类：专业指导

    • 发布日期：2010-07-10
    • 文件大小：7mb
    • 提供者：mczpj2001

  1. FPGA-CPLD芯片设置方法

  2. 谢谢你选择LYC EDA 开发板—学习板 FPGA-CPLD 芯片设置方法 1 打开Quartus II 软件。Assignments->Devices 如下图: 谢谢你选择LYC EDA 开发板—学习板 2 出现下面的对话框，在Family 选择器件(是那个家簇的)， EPM240 属于MAX II 家簇；如我们这里选择的是Cyclone II : 谢谢你选择LYC EDA 开发板—学习板 3 如下图: 选择芯片的封装. 谢谢你选择LYC EDA 开发板—学习板 4 选择芯片的管脚数目

  3. 所属分类：嵌入式

    • 发布日期：2010-08-13
    • 文件大小：974kb
    • 提供者：fym891116

  1. 实验一 七段数码显示译码器

  2. 7段数码是纯组合电路，通常的小规模专用IC，如74或4000系列的器件只能作十进制BCD码译码，然而数字系统中的数据处理和运算都是2进制的，所以输出表达都是16进制的，为了满足16进制数的译码显示，最方便的方法就是利用译码程序在FPGA/CPLD中来实现。但为了简化过程，首先完成7段BCD码译码器的设计。如图3-1作为7段BCD码译码器，输出信号LED7S的7位分别接如图3-1数码管的7个段，高位在左，低位在右。例如当LED7S输出为“1101101”时，数码管的7个段：g、f、e、d、c、b

  3. 所属分类：C

    • 发布日期：2010-12-08
    • 文件大小：369kb
    • 提供者：XUQIWEN1

  1. 基于DSP和CPLD的液晶显示控制器的设计

  2. 基于DSP和CPLD的液晶显示控制器的设计 基于DSP和CPLD的液晶显示控制器的设计

  3. 所属分类：硬件开发

    • 发布日期：2011-04-06
    • 文件大小：292kb
    • 提供者：Augusdi

  1. TMS320VC5509 音频采集，CPLD显示 电路图

  2. TMS320VC5509 音频采集，CPLD显示 电路图

  3. 所属分类：硬件开发

    • 发布日期：2017-03-20
    • 文件大小：260kb
    • 提供者：vestiges
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