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  1. 基于FPGA的16阶FIR滤波器的设计与实现.pdf

  2. 数字滤波器是一种用来过渡时间离散信号的数字系统,通过对抽样数据进行数学处理来达到频域 滤波的目的. 根据其单位冲激响应函数的时域特性可分为两类:无限冲激响应( IIR)滤波器和有限冲激 响应( F IR)滤波器. 与IIR滤波器相比, F IR的实现是非递归的,总是稳定的;更重要的是, F IR滤波器是 线性相位的,能保证信号在传输过程中不会产生失真[ 1 ] . 因此在高保真的信号处理领域,如数字音频、 图像处理、数据传输、生物医学等领域得到了广泛应用. 然而,数字滤波器的应用场合大部分都要

  3. 所属分类：硬件开发

    • 发布日期：2009-12-23
    • 文件大小：374kb
    • 提供者：qin0820222

  1. DSP中的一种FIR数字滤波器设计与仿真

  2. 1 引言     实现数字化是控制系统的重要发展方向，而数字信号处理已在通信、语音、图像、自动控制、雷达、军事、航空航天等领域广泛应用。数字信号处理方法通常涉及变换、滤波、频谱分析、编码解码等处理。数字滤波是重要环节，它能满足滤波器对幅度和相位特性的严格要求，克服模拟滤波器所无法解决的电压和温度漂移以及噪声等问题。而有限冲激响应FIR滤波器在设计任意幅频特性的同时能够保证严格的线性相位特性。利用FPGA可以重复配置高精度的FIR滤波器，使用VHDL硬件描述语言改变滤波器的系数和阶数，并能实现大量

  3. 所属分类：其它

    • 发布日期：2020-10-23
    • 文件大小：756kb
    • 提供者：weixin_38512659

  1. DSP中的一种FIR滤波器的DSP设计和实现

  2. 数字滤波器是一个离散时间系统（按预定的算法，将输入离散时间信号转换为所要求的输出离散时间信号的特定功能装置）。应用数字滤波器处理模拟信号时，首先须对输入模拟信号进行限带、抽样和模数转换。数字滤波器输入信号的抽样率应大于被处理信号带宽的两倍，其频率响应具有以抽样频率为间隔的周期重复特性，且以折叠频率即1／2抽样频率点呈镜像对称。为得到模拟信号，数字滤波器处理的输出数字信号须经数模转换、平滑。数字滤波器具有高精度、高可靠性、可程控改变特性或复用、便于集成等优点。数字滤波器在语言信号处理、图像信号处理

  3. 所属分类：其它

    • 发布日期：2020-10-21
    • 文件大小：328kb
    • 提供者：weixin_38678172

  1. DSP中的基于DSP的自适应滤波器的设计方案

  2. 根据自适应滤波的原理，主要论述和分析了易于实现的最小均方差算法，通过比较IIR结构和FIR结构滤波器的优缺点，采用横向FIR结构的自适应滤波器来实现。为了满足自适应滤波的实时性要求，采用TMS320F28234芯片的系统设计，并设计了其硬件最小系统和软件系统，最后用TMS320F28234实现自适应滤波器。仿真结果表明，本方案的自适应滤波器滤波效果优越，具有较强的实用性。 　　0 引言 　　滤波是信号处理领域的一种最基本而又极其重要的技术。利用滤波技术可以从复杂的信号中提取所需要的信号，同时

  3. 所属分类：其它

    • 发布日期：2020-10-19
    • 文件大小：208kb
    • 提供者：weixin_38663415

  1. 单片机与DSP中的基于FPGA分布式算法的滤波器设计

  2. 0 引言 　　传统数字滤波器硬件的实现主要采用专用集成电路(ASIC)和数字信号处理器(DSP)来实现。FPGA内部的功能块中采用了SRAM的查找表(lo-ok up table，LUT)结构，这种结构特别适用于并行处理结构，相对于传统方法来说，其并行度和扩展性都很好，它逐渐成为构造可编程高性能算法结构的新选择。 　　分布式算法是一种适合FPGA设计的乘加运算，由于FPGA中硬件乘法器资源有限，直接应运乘法会消耗大量的资源。本文利用了丰富的存储器资源进行查找表运算，设计了一种基于分布式算法低

  3. 所属分类：其它

    • 发布日期：2020-11-05
    • 文件大小：233kb
    • 提供者：weixin_38729108

  1. 单片机与DSP中的一种低功耗64 倍降采样多级数字抽取滤波器设计

  2. 摘　要：经典多级结构的数字抽取滤波器占用系统大量的功耗与面积资源，文章设计的改进型64倍降采样数字抽取滤波器采用由级联积分梳状滤波器、补偿FIR 滤波器和半带滤波器组成，在保持∑- Δ ADC 转换精度的约束下，实现了最大程度降低系统功耗与面积的设计目标。在多级级联积分梳状（CIC）滤波器的设计中，充分运用置换原则以优化各级级数并采用非递归结构实现方式，同时将多相结构运用到补偿滤波器与半带滤波器中，获得电路功耗与面积的明显降低。将∑- Δ调制器输出信号作为测试激励，通过Matlab 系统仿真、F

  3. 所属分类：其它

    • 发布日期：2020-11-03
    • 文件大小：572kb
    • 提供者：weixin_38713586

  1. 单片机与DSP中的基于FPGA的高效FIR滤波器设计与实现

  2. 摘要： 给出了一种基于FPGA的数字滤波器的设计方法。该方法先通过MATLAB设计出一个具有具体指标的FIR滤波器， 再对滤波器系数进行处理， 使之便于在FPGA中实现， 然后采用基于分布式算法和CSD编码的滤波器结构进行设计， 从而避免了乘法运算， 节约了硬件资源，其流水线的设计方式也提高了运行速度。Matlab和Modelsim仿真表明， 该设计功能正确， 能实现快速滤波。 　　0 引言 　　数字滤波器在语音与图像处理、模式识别、雷达信号处理、频谱分析等应用中都具有重要作用。它能避免模拟

  3. 所属分类：其它

    • 发布日期：2020-11-03
    • 文件大小：439kb
    • 提供者：weixin_38563176

  1. 单片机与DSP中的一种高阶音频均衡滤波器的设计实现

  2. 音频均衡器作为高品质音响不可或缺的关键附属调节设备，在音效调整修饰方面起着至关重要的作用。一般音频均衡器有数字和模拟两种实现方法，模拟方法用有源和无源滤波器组实现，受器件温度等特性的影响，难以达到较高的可靠性和一致性，且成本较高。数字实现方法采用数字滤波器，具有较高的灵活性和可靠性。常用的数字滤波器有IIR和FIR两种。IIR滤波器结构简单，所需的存储空间小，但其相位是非线性；FIR滤波器是线性相位滤波器，这对高品质音效处理是必要的。本文通过在FPGA内设计了1 024阶FIR滤波器实现数字均衡

  3. 所属分类：其它

    • 发布日期：2020-11-03
    • 文件大小：470kb
    • 提供者：weixin_38750644

  1. 单片机与DSP中的4抽头直接FIR滤波器

  2. 系数为{－1，3，75， 3.75，-1}的滤波器的VHDL设计如下： 　　这一设计是对图中直接FIR滤波器结构的文字解释，这种设计对对称和非对称滤波器都适用。抽头延迟线每个抽头的输出分别乘以相应加权的二进制值，再将结果相加。对应脉冲10的滤波器脉冲响应y如图2所示。注意：MaxPlusll是以无符号数显示-10的，也就是256-10＝246。 　　图1 直接形式的FIR滤波器 　　图2 脉冲输入为1O时FIR滤波器的VHDL仿真结果 　　有3种显而易见的措施可以改进这一设计

  3. 所属分类：其它

    • 发布日期：2020-11-13
    • 文件大小：211kb
    • 提供者：weixin_38747917

  1. 单片机与DSP中的基于多速率DA的根升余弦滤波器的FPGA实现

  2. 0 引 言 　　根升余弦成形滤波器是数字信号处理中的重要部件，它能对数字信号进行成形滤波，压缩旁瓣，减少干扰的影响，从而降低误码率。根据文献[1]，它的传统FP-GA实现方式基于乘累加器(Multiplier Add Cell，MAC)结构，设计方便，只需要乘法器、加法器和移位寄存器即可实现，但是在FPGA中实现硬件乘法器十分耗费资源。特别是当滤波器阶数很高时，资源耗费不可忽视。若采用乘法器复用的结构，运算速度较慢。分布式算法(Distribute Arithmetic，DA)是另一种应用在F

  3. 所属分类：其它

    • 发布日期：2020-11-09
    • 文件大小：494kb
    • 提供者：weixin_38517728

  1. 单片机与DSP中的基于DSP/BIOS的FIR数字滤波器设计与实现

  2. 1 引言 　　数字信号处理器(DSP)拥有强大的数字信号处理能力，与其配套的集成可视化开发环境CCS(Coder Composer Stu-dio)更方便了 DSP应用程序的开发。DSP／BIOS是CCS的重要组成部分，它实质上是一种基于DSP平台的规模可控的实时操作系统内核。这里主要研究在DSP上利用DSP，BIOS实现FIR数字滤波器的方法。 　　2 TMS320F2812及DSP/BIOS内核介绍 　　TMS320F2812是基于TMS320C2XXX内核的定点数字信号处理器，具有数

  3. 所属分类：其它

    • 发布日期：2020-11-09
    • 文件大小：140kb
    • 提供者：weixin_38617297

  1. 单片机与DSP中的于脉动阵列的FIR滤波器设计

  2. 1引 言 　　有限长冲激响应(FIR)滤波器在数字信号处理中是一种基本的处理单元。无限长单位冲激响应(IIR)数字滤波器的优点是可以利用模拟滤波器设计的结果，但其缺点是不具有线性相位性。图像处理以及数据传输都要求信道具有线性相位特性，FIR滤波器可以做成严格的线性相位，避免被处理信号产生相位失真，还可以具有任意的幅度特性。此外，FIR滤波器的单位冲激响应是有限长的，因而滤波器一定是稳定的。　　在数字滤波器的研究中，已经提出多种FIR滤波器的设计和实现方法，如并行结构、流水线结构、分布式结构等

  3. 所属分类：其它

    • 发布日期：2020-11-25
    • 文件大小：118kb
    • 提供者：weixin_38745434

  1. 单片机与DSP中的基于脉动阵列的FIR滤波器设计

  2. 1 引言 　　有限长冲激响应(FIR)滤波器在数字信号处理中是一种基本的处理单元。无限长单位冲激响应(IIR)数字滤波器的优点是可以利用模拟滤波器设计的结果，但其缺点是不具有线性相位性。图像处理以及数据传输都要求信道具有线性相位特性，FIR滤波器可以做成严格的线性相位，避免被处理信号产生相位失真，还可以具有任意的幅度特性。此外，FIR滤波器的单位冲激响应是有限长的，因而滤波器一定是稳定的。 　　在数字滤波器的研究中，已经提出多种FIR滤波器的设计和实现方法，如并行结构、流水线结构、分布式结构

  3. 所属分类：其它

    • 发布日期：2020-12-01
    • 文件大小：110kb
    • 提供者：weixin_38515362

  1. 单片机与DSP中的基于DSPBuilder的FIR滤波器的设计与实现

  2. 引言     在信息信号处理过程中，如对信号的过滤、检测、预测等，都要使用滤波器，数字滤波器是数字信号处理（DSP，DigitalSignalProcessing）中使用最广泛的一种器件。常用的滤波器有无限长单位脉冲响应（ⅡR）滤波器和有限长单位脉冲响应（FIR）滤波器两种[1]，其中，FIR滤波器能提供理想的线性相位响应，在整个频带上获得常数群时延从而得到零失真输出信号，同时它可以采用十分简单的算法实现，这两个优点使FIR滤波器成为明智的设计工程师的首选，在采用VHDL或VerilogHD

  3. 所属分类：其它

    • 发布日期：2020-12-10
    • 文件大小：161kb
    • 提供者：weixin_38529293

  1. 单片机与DSP中的基于FPGA的FIR滤波器的实现

  2. 摘 要： 提出了一种采用现场可编程门阵列器件FPGA并利用窗函数法实现线性FIR数字滤波器硬件电路的方案，并以一个十六阶低通FIR数字滤波器电路的实现为例说明了利用Xilinx公司XC4000系列芯片的设计过程。设计的电路通过软件程序进行了验证和硬件仿真，结果表明电路工作正确可靠，能满足设计要求。 关键词： FPGA FIR数字滤波器 窗函数 全加器 随着微电子技术的发展，采用现场可编程门阵列FPGA进行数字信号处理得到了飞速发展。由于FPGA具有现场可编程的特点，可以实现专用集成电路，因

  3. 所属分类：其它

    • 发布日期：2020-12-10
    • 文件大小：83kb
    • 提供者：weixin_38560502

  1. 单片机与DSP中的快速实现基于FPGA的脉动FIR滤波器

  2. 引言 　　目前，用FPGA(现场可编程门阵列)实现FIR(有限冲击响应)滤波器的方法大多利用FPGA中LUT(查找表)的特点采用DA(分布式算法)或CSD码等方法，将乘加运算操作转化为位与、加减和移位操作。这些结构需要占用器件较多的LE(逻辑元件)资源，设计周期长，工作频率低，实时性差。本文提出一种基于Stratix系列FPGA器件的新的实时高速脉动FIR滤波器的快速实现方法。利 用FGPA集成的DSP(数字信号处理器)乘加模块定制卷积运算单元，利用VHDL(甚高速集成电路硬件描述语言)元件

  3. 所属分类：其它

    • 发布日期：2020-12-07
    • 文件大小：129kb
    • 提供者：weixin_38603704

  1. 单片机与DSP中的基于FPGA的数字滤波器的设计与实现

  2. 在信息信号处理过程中,如对信号的过滤、检测、预测等,都要使用到滤波器,数字滤波器是数字信号处理中使用最广泛的一种方法,常用的数字滤波器有无限长单位脉冲响应（IIR）滤波器和有限长单位脉冲响应（FIR）滤波器两种[1]。对于应用设计者,由于开发速度和效率的要求很高,短期内不可能全面了解数字滤波器相关的优化技术,需要花费很大的精力才能使设计出的滤波器在速度、资源利用、性能上趋于较优。而采用调试好的IP核需要向Altera公司购买。本文采用了一种基于DSP Builder的FPGA设计方法,以一个低通

  3. 所属分类：其它

    • 发布日期：2020-12-06
    • 文件大小：139kb
    • 提供者：weixin_38712279

  1. 单片机与DSP中的基于 DSP Builder的FIR滤波器的设计与实现

  2. 1 引言 　　在信息信号处理过程中，如对信号的过滤、检测、预测等，都要使用滤波器，数字滤波器是数字信号处理（DSP，DigitalSignalProcessing）中使用最广泛的一种器件。常用的滤波器有无限长单位脉冲响应（ⅡR）滤波器和有限长单位脉冲响应（FIR）滤波器两种[1]，其中，FIR滤波器能提供理想的线性相位响应，在整个频带上获得常数群时延从而得到零失真输出信号，同时它可以采用十分简单的算法实现，这两个优点使FIR滤波器成为明智的设计工程师的首选，在采用VHDL或VerilogHD

  3. 所属分类：其它

    • 发布日期：2020-12-06
    • 文件大小：93kb
    • 提供者：weixin_38688969

  1. 单片机与DSP中的基于FPGA的FIR抽取滤波器设计

  2. 摘   要：本文介绍了FIR抽取滤波器的工作原理，重点阐述了用XC2V1000实现FIR抽取滤波器的方法，并给出了仿真波形和设计特点。关键词：FIR抽取滤波器；流水线操作；FPGA 　　用FPGA实现抽取滤波器比较复杂，主要是因为在FPGA中缺乏实现乘法运算的有效结构，现在，FPGA中集成了硬件乘法器，使FPGA在数字信号处理方面有了长足的进步。本文介绍了一种采用Xilinx公司的XC2V1000实现FIR抽取滤波器的设计方法。 具体实现结构设计　　基于抽取滤波器的工作原理，本文采用XC2V

  3. 所属分类：其它

    • 发布日期：2020-12-13
    • 文件大小：70kb
    • 提供者：weixin_38556668

  1. 单片机与DSP中的基于Verilog HDL的FIR数字滤波器设计与仿真

  2. 摘要：本文主要分析了FIR数字滤波器的基本结构和硬件构成特点，简要介绍了FIR滤波器实现的方式优缺点；结合Altera公司的Stratix系列产品的特点，以一个基于MAC的8阶FIR数字滤波器的设计为例，给出了使用Verilog 硬件描述语言进行数字逻辑设计的过程和方法，并且在QuartusII的集成开发环境下编写HDL代码，进行综合；利用QuartusII内部的仿真器对设计做脉冲响应仿真和验证       关键词：CPLD/FPGA  Verilog HDL  FIR  仿真      

  3. 所属分类：其它

    • 发布日期：2020-12-08
    • 文件大小：193kb
    • 提供者：weixin_38752074
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