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  1. FPGA中使用Verilog语言实现Hanming码（行列监督码）

  2. 本工程实现的是48bit数据生成 12bitECC码，外加4bit无用数据（全部置1）共64bit数据生成（hanming_gen_bc.v），以及从64bit数据中解析出48bit裸数据的代码（tb_hanming_ecc_bc.v）

  3. 所属分类：硬件开发

    • 发布日期：2020-07-23
    • 文件大小：857kb
    • 提供者：qq_29051107