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  1. IEEE-754浮点标准

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  3. 所属分类:嵌入式

    • 发布日期:2009-05-14
    • 文件大小:86016
    • 提供者:wswss11986
  1. IEEE754 浮点标准 IEEE Standard 754 for Binary Floating-Point Arithmetic

  2. IEEE754 浮点标准 IEEE Standard 754 for Binary Floating-Point Arithmetic
  3. 所属分类:其它

    • 发布日期:2009-09-16
    • 文件大小:117760
    • 提供者:softradio
  1. 华信单片机——51四字节浮点库

  2. 华信单片机工作室 卢先生 http://www.hx51.com/ ;* 整理验证日期: 2003/12/04, 更新日期:2005/08/01 ;------------------------------------------------------------------------------ ;* 标题:MCS-51单片机浮点子程序库,程序名:ZZ51.A51 ;* 描述: ;* 以下浮点数格式与标准的IEEE浮点数格式不尽相同,是IEEE-754标准的变异型,称作为IEEE-75
  3. 所属分类:硬件开发

    • 发布日期:2010-04-06
    • 文件大小:293888
    • 提供者:boy_scarecrow
  1. 浮点数精度问题解答——浮点数

  2. 目前支持二进制浮点数的硬件和软件文档中,几乎都声称其浮点数实现符合IEEE 754标准。那么,什么是IEEE 754标准? 最权威的解释是IEEE754标准本身ANSI/IEEE Std 754-1985《IEEE Standard for Binary Floating-Point Arithmetic》,网上有PDF格式的文件,Google一下,下载即可。标准文本是英文的,总共才23页,有耐心的话可以仔细阅读。这里摘录前言中的一句: This standard defines a fami
  3. 所属分类:专业指导

    • 发布日期:2010-06-11
    • 文件大小:80896
    • 提供者:CQ_bigbird
  1. IEEE Standard 754 for Binary Floating-Point Arithmetic

  2. 对浮点数在计算机中的表示形式感兴趣的话,建议阅读此标准,IEEE754,二进制浮点算数标准
  3. 所属分类:专业指导

    • 发布日期:2010-07-03
    • 文件大小:117760
    • 提供者:goatdai
  1. IEEE754浮点运算标准

  2. ANSI/IEEE 754-1985; 这个是扫描的图片版;完全的版本
  3. 所属分类:专业指导

    • 发布日期:2010-08-23
    • 文件大小:928768
    • 提供者:oneinmore
  1. IEEE 754-2008 浮点算术标准(英文原版PDF)

  2. 此标准规定了计算机编程环境下,二进制和十进制浮点数及其运算的格式和方法,异常的出现条件以及它们的默认句柄。此规范中的浮点数系统可以通过软件、硬件,或者软硬件相结合的形式来实现。对于标准中规定的运算,输出的结果、异常有输入值、操作序列和结果的数据格式所唯一确定,完全在用户的掌控之下。 This standard specifies interchange and arithmetic formats and methods for binary and decimal floating-poin
  3. 所属分类:专业指导

    • 发布日期:2010-11-02
    • 文件大小:938414
    • 提供者:harrysummer
  1. 解读IEEE标准754-浮点数机制

  2. IEEE二进制浮点数算术标准(IEEE 754)是最广泛使用的浮点数运算标准,为许多CPU与浮点运算器所采用
  3. 所属分类:专业指导

    • 发布日期:2011-01-24
    • 文件大小:123904
    • 提供者:SeanQ
  1. 关于浮点数的存储格式的问题

  2. 浮点数的存储格式 基于IEEE 754的浮点数存储格式 IEEE(Institute of Electrical and Electronics Engineers,电子电气工程师协会)在I985年制定的IEEE 754(IEEE Standard for Binary Floating-Point Arithmetic, ANSI/IEEE Std 754-1985 )二进制浮点运算规范,是浮点运算部件事实上的工业标准。 在计算机系统的发展过程中,曾经提出过多种方法表示实数,但是到目前为止使
  3. 所属分类:Microsoft

    • 发布日期:2011-05-16
    • 文件大小:166912
    • 提供者:wanglf1986
  1. IEEE754浮点标准

  2. IEEE Standard 754 for Binary Floating-Point Arithmetic English Version
  3. 所属分类:其它

    • 发布日期:2008-10-18
    • 文件大小:117760
    • 提供者:crystalraying
  1. IEEE-754标准

  2. 介绍ieee-754标准,介绍浮点格式及加法,减法,乘法,除法等运算
  3. 所属分类:电信

    • 发布日期:2017-12-18
    • 文件大小:240640
    • 提供者:bzxylyz
  1. IEEE-754双精度数值至字符转换

  2. IEEE二进制浮点数算术标准(IEEE 754)是1980年代以来最广泛使用的浮点数运算标准,为许多CPU与浮点运算器所采用。这个标准定义了表示浮点数的格式(包括负零-0)与反常值(denormal number)),一些特殊数值(无穷与非数值(NaN)),以及这些数值的“浮点数运算符”;它也指明了四种数值舍入规则和五种例外状况(包括例外发生的时机与处理方式)。 IEEE 754规定了四种表示浮点数值的方式:单精确度(32位)、双精确度(64位)、延伸单精确度(43比特以上,很少使用)与延伸双
  3. 所属分类:其它

    • 发布日期:2017-12-21
    • 文件大小:6144
    • 提供者:vipcuiheng
  1. IEEE-754单精度数值至字符转换

  2. IEEE二进制浮点数算术标准(IEEE 754)是1980年代以来最广泛使用的浮点数运算标准,为许多CPU与浮点运算器所采用。这个标准定义了表示浮点数的格式(包括负零-0)与反常值(denormal number)),一些特殊数值(无穷与非数值(NaN)),以及这些数值的“浮点数运算符”;它也指明了四种数值舍入规则和五种例外状况(包括例外发生的时机与处理方式)。 IEEE 754规定了四种表示浮点数值的方式:单精确度(32位)、双精确度(64位)、延伸单精确度(43比特以上,很少使用)与延伸双
  3. 所属分类:其它

    • 发布日期:2017-12-21
    • 文件大小:6144
    • 提供者:vipcuiheng
  1. IEEE Std 754 IEEE Standard for Floating-Point Arithmetic

  2. 二进制浮点运算标准英文版 PDF格式,内容是英文的。。。
  3. 所属分类:专业指导

    • 发布日期:2009-01-06
    • 文件大小:832512
    • 提供者:yiyaoyao58958
  1. IEEE754 浮点标准 英文 (IEEE Standard 754 for Binary Floating-Point Arithmetic)

  2. IEEE754 浮点标准 英文 (IEEE Standard 754 for Binary Floating-Point Arithmetic) Prof. W. Kahan Elect. Eng. & Computer Science University of California Berkeley CA 94720-1776
  3. 所属分类:其它

    • 发布日期:2009-03-28
    • 文件大小:117760
    • 提供者:rokian
  1. 高速深流水线浮点加法单元的设计

  2. 在X87执行环境下,采用基于Two-Path算法的并行深度流水线优化算法,设计了一种能够实现符合IEEE-754标准的单精度、双精度和扩展双精度及整型数据且舍入模式可控的高速浮点加法器。采用并行深度流水设计,经验证,功能满足设计要求,使用TSMC 65 nm工艺库进行综合,其工作频率可达900 MHz。
  3. 所属分类:其它

    • 发布日期:2020-07-20
    • 文件大小:95232
    • 提供者:weixin_38684633
  1. DSP中的Altera: FPGA集成硬核浮点DSP

  2. 1 FPGA浮点运算推陈出新  以往FPGA在进行浮点运算时,为符合IEEE 754标准,每次运算都需要去归一化和归一化步骤,导致了极大的性能瓶颈。因为这些归一化和去归一化步骤一般通过FPGA中的大规模桶形移位寄存器实现,需要大量的逻辑和布线资源。通常一个单精度浮点加法器需要500个查找表(LUT),单精度浮点要占用30%的LUT,指数和自然对数等更复杂的数学函数需要大约1000个LUT。因此随着DSP算法越来越复杂,FPGA性能会明显劣化,对占用80%~90%逻辑资源的FPGA会造成严重的布线
  3. 所属分类:其它

    • 发布日期:2020-10-19
    • 文件大小:95232
    • 提供者:weixin_38721252
  1. 高速深流水线浮点加法单元的设计

  2. 在X87执行环境下,采用基于Two-Path算法的并行深度流水线优化算法,设计了一种能够实现符合IEEE-754标准的单精度、双精度和扩展双精度及整型数据且舍入模式可控的高速浮点加法器。采用并行深度流水设计,经验证,功能满足设计要求,使用TSMC 65 nm工艺库进行综合,其工作频率可达900 MHz。
  3. 所属分类:其它

    • 发布日期:2020-10-17
    • 文件大小:305152
    • 提供者:weixin_38502183
  1. EDA/PLD中的高速流水线浮点加法器的FPGA实现

  2. 0  引言   现代信号处理技术通常都需要进行大量高速浮点运算。由于浮点数系统操作比较复杂,需要专用硬件来完成相关的操作(在浮点运算中的浮点加法运算几乎占到全部运算操作的一半以上),所以,浮点加法器是现代信号处理系统中最重要的部件之一。FPGA是当前数字电路研究开发的一种重要实现形式,它与全定制ASIC电路相比,具有开发周期短、成本低等优点。但多数FPGA不支持浮点运算,这使FPGA在数值计算、数据分析和信号处理等方面受到了限制,由于FPGA中关于浮点数的运算只能自行设计,因此,研究浮点加法运
  3. 所属分类:其它

    • 发布日期:2020-11-09
    • 文件大小:203776
    • 提供者:weixin_38749863
  1. 高速流水线浮点加法器的FPGA实现

  2. 0  引言   现代信号处理技术通常都需要进行大量高速浮点运算。由于浮点数系统操作比较复杂,需要专用硬件来完成相关的操作(在浮点运算中的浮点加法运算几乎占到全部运算操作的一半以上),所以,浮点加法器是现代信号处理系统中重要的部件之一。FPGA是当前数字电路研究开发的一种重要实现形式,它与全定制ASIC电路相比,具有开发周期短、成本低等优点。但多数FPGA不支持浮点运算,这使FPGA在数值计算、数据分析和信号处理等方面受到了限制,由于FPGA中关于浮点数的运算只能自行设计,因此,研究浮点加法运算
  3. 所属分类:其它

    • 发布日期:2021-01-19
    • 文件大小:195584
    • 提供者:weixin_38710557
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