数据进入FPGA的速率高于传出的速率，持续的传输会造成数据的溢出，断续的传输可能会造成数据不连续。使用基于LabVIEW FPGA的DMA FIFO作为主控计算机和FPGA之间的缓存，若DMAFIFO深度设置的合适，FIFO不会溢出和读空，那么就能实现数据输出FPGA是连续的。 　　本文在介绍了LabVIEW FPGA模块程序设计特点的基础上，结合DMA FIFO的工作原理，提出了一种设定FIFO深度的方法，解决了FIFO溢出、读空的问题，实现了数据的连续传输。实验结果表明该方法正确、可行

为了解决基于LabVIEWFPGA模块的DMAFIFO深度设定不当带来的数据不连续问题，结合LabVIEWFPGA的编程特点和DMAFIFO的工作原理，提出了一种设定FIFO深度的方法。对FIFO不同深度的实验表明，采用该方法设定的FIFO深度能够比较好地满足系统对数据连续传输的要求。研究结果对深入展开研究和工程设计具有一定的指导意义。