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  1. 黑客防线2010年07期杂志

  2. 黑客防线2010年07期杂志 动易SiteWeaver6.8短消息Oday跨站漏洞（爱无言） 基于Minifilter进程衍生物跟踪技术（小华子） ActiveX控件引发的泄密（爱无言） 金笛邮件系统ODay（爱无言） 闪游浏览器URL黑名单绕过漏洞（爱无言） W-SVD数字水印系统性能分析（王丽婧 尹晓丹） 基于混沌细胞自动机数字水印的嵌入及检测（王丽婧 尹晓丹） Python编写post注入脚本（oyea91e） 记一次安全检测笔记（814ckhum0r） 简单渗透IBM AIX 5.3（

  3. 所属分类：系统安全

    • 发布日期：2015-03-05
    • 文件大小：19mb
    • 提供者：johnllon

  1. nosql 入门教程

  2. 第一部分 　NoSQL入门 第1章 　NoSQL的概念及适用范围　2 1.1 　定义和介绍　3 1.1.1 　背景与历史　3 1.1.2 　大数据　5 1.1.3 　可扩展性　7 1.1.4 　MapReduce　8 1.2 　面向列的有序存储　9 1.3 　键/值存储　11 1.4 　文档数据库　14 1.5 　图形数据库　15 1.6 　小结　16 第2章 　NoSQL上手初体验　17 2.1 　第一印象——两个简单的例子　17 2.1.1 　简单的位置偏好数据集　17 2.1.2 　存储

  3. 所属分类：MySQL

    • 发布日期：2017-10-25
    • 文件大小：15mb
    • 提供者：u012296096

  1. Python数据分析

  2. 本书是一本介绍如何用Python进行数据分析的学习指南。全书共12章，从Python程序库入门、NumPy数组、matplotlib和pandas开始，陆续介绍了数据加工、数据处理和数据可视化等内容。同时，本书还介绍了信号处理、数据库、文本分析、机器学习、互操作性和性能优化等高级主题。在本书的结尾，还采用3个附录的形式为读者补充了一些重要概念、常用函数以及在线资源等重要内容。

  3. 所属分类：Python

    • 发布日期：2018-02-28
    • 文件大小：5mb
    • 提供者：zy1761069

  1. Exploring Zynq MPSoC 最详细的MPSoC开发教程

  2. 本书是使用Zynq MPSoC的开发人员的实用指南，同样也是希望熟悉器件及其相关设计方法的技术人员的有效参考。 Zynq MPSoC（多处理器片上系统）是Xilinx公司推出的第二代SoC系列产品，集成了复杂的处理系统，包括ARM Cortex-A53应用程序处理器和ARM Cortex-R5实时处理器，以及FPGA可编程逻辑。 来自苏格兰斯特拉斯克莱德大学（University of Strathclyde）的Louise Crockett团队基于这一平台的软件和硬件结构，撰写了Explor

  3. 所属分类：硬件开发

    • 发布日期：2019-06-11
    • 文件大小：58mb
    • 提供者：dctme

  1. Python性能分析指南

  2. 尽管并非每个你写的Python程序都需要严格的性能分析，但了解一下Python的生态系统中很多优秀的在你需要做性能分析的时候可以使用的工具仍然是一件值得去做的事。 尽管并非每个你写的Python程序都需要严格的性能分析，但了解一下Python的生态系统中很多优秀的在你需要做性能分析的时候可以使用的工具仍然是一件值得去做的事。 分析一个程序的性能，最终都归结为回答4个基本的问题： 程序运行速度有多快？

  3. 所属分类：其它

    • 发布日期：2021-03-23
    • 文件大小：42kb
    • 提供者：weixin_38622475

  1. React水-源码

  2. python'./app.py ReactTesserac 用户指南 这是与萨里大学CES系联合建立的网页。 它包含微生物燃料电池的计算和图表。 它包含涉及单个ODE和线性耦合ODE的动态仿真。 从根本上讲，该站点允许基于浏览器的各种科学模型的建模，包括但不限于模型 代数的 线性ODE ODE系统 微分+代数系统 Tesarrec:trade_mark: 资源回收的技术经济和可持续性分析工具循环经济的工程解决方案新一代工程技术，可持续性和循环经济的解决方案我们开发了用于以下方面的计算机软件：

  3. 所属分类：其它

  1. Approximate-1D-DCT-architecture:这是用于1D 8点DCT计算的流水线体系结构的Verilog实现。 这是一个近似的体系结构，整个计算仅使用12个加法器，而没有乘法器-源码

  2. 近似1D-DCT体系结构 介绍： 这是1-D 8点DCT架构的Verilog实现。 它实现了一个近似设计，整个计算仅使用12个加法器，而没有乘法器。 流水线由8个加法器块组成，它们计算流水线中连续操作数的不同位位置。 由于产生纹波进位而引起的延迟被用于执行其他独立任务，以提高性能。 要求： Xilinx Vivado设计套件（Vivado 2019.1）用于HDL合成和分析。 安装指南在。 在Vivado Simulator上可以看到仿真波形，用户需要将输入文本文件提供给测试台。 定制输入：

  3. 所属分类：其它

    • 发布日期：2021-03-29
    • 文件大小：445kb
    • 提供者：weixin_42122878