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UART干扰算法.zip
使用verilog HDL语言实现串口通信，接收部分添加防干扰算法。 操作平台vivado2017.4，FPGA芯片K732T。 如有错误请私信，虚心求教，谢谢。
所属分类：
Microsoft
发布日期：2020-08-26
文件大小：33mb
提供者：
huangshanhu
