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搜索资源列表

  1. uart 源码 (Verilog)

  2. 使用verilog实现uart功能，可在FPGA或CPLD中实现UART模块，实现串口通信。

  3. 所属分类：硬件开发

    • 发布日期：2009-05-24
    • 文件大小：10kb
    • 提供者：mouseboy1022

  1. VHDL编写的UART模块，已经调试通过。。

  2. VHDL编写的UART模块，已经调试通过。。我是在quartus7.2编写的，已经在EP1C6T144C8芯片上调试通过。。。希望对大家有所帮助

  3. 所属分类：C

    • 发布日期：2010-01-17
    • 文件大小：1mb
    • 提供者：shan182

  1. TI群星系列UART的使用示例

  2. // UART初始化 void uartInit(void) { SysCtlPeripheralEnable(SYSCTL_PERIPH_UART0); // 使能UART模块 SysCtlPeripheralEnable(SYSCTL_PERIPH_GPIOA); // 使能RX/TX所在的GPIO端口 GPIOPinTypeUART(GPIO_PORTA_BASE, // 配置RX/TX所在管脚为 GPIO_PIN_0 | GPIO_PIN_1); // UART收发功能 UARTCon

  3. 所属分类：嵌入式

    • 发布日期：2011-05-06
    • 文件大小：6kb
    • 提供者：qqmyfeng

  1. verilog的spi时序加上uart模块

  2. verilog的SPI时序，分了几个模块，但看明白了用起来还是很方便的，里面还包含uart模块，可以看发出的命令

  3. 所属分类：硬件开发

    • 发布日期：2011-05-15
    • 文件大小：2mb
    • 提供者：qdxiaoliu

  1. s3c2440 11章 UART

  2. 三星s3c2440第11章UART模块中文详细资料

  3. 所属分类：硬件开发

    • 发布日期：2011-09-08
    • 文件大小：220kb
    • 提供者：woshifennu1234

  1. 基于FPGA的UART模块的设计

  2. 基于FPGA的UART模块的设计，很好的资源。模块化讲解。

  3. 所属分类：嵌入式

    • 发布日期：2011-12-17
    • 文件大小：422kb
    • 提供者：maryhuyiqu

  1. MSP430F2XX中文手册_11.通用串行通信接口UART模块

  2. MSP430 UART模块 ，UART模式下的硬件介绍，相关寄存器的配置

  3. 所属分类：专业指导

    • 发布日期：2013-04-04
    • 文件大小：510kb
    • 提供者：w463854329

  1. UART模块 代码及文档

  2. UART模块 代码及文档 verilog语言实现收发模块 还有测试代码

  3. 所属分类：其它

  1. usb转uart模块的驱动

  2. usb转uart模块的驱动，装在电脑上的usb转uart模块的驱动

  3. 所属分类：其它

    • 发布日期：2015-05-15
    • 文件大小：3mb
    • 提供者：iamzuoyuwen

  1. verilog实现的带FIFO的UART模块

  2. verilog实现的带FIFO的UART模块，代码风格良好，模块化，具有较高的参考价值。

  3. 所属分类：硬件开发

    • 发布日期：2016-01-01
    • 文件大小：975kb
    • 提供者：mircode

  1. fpga设计串口通信UART模块

  2. fpga设计串口通信UART模块 验证过的

  3. 所属分类：硬件开发

    • 发布日期：2009-04-21
    • 文件大小：22kb
    • 提供者：xiachong001

  1. WIFI转SPI&UART模块WSUM102A用户手册

  2. WSUM102A模块是一款WIFI转串口和SPI接口的通信模块，使用本模块您可以方便的在各种电子设备之间建立高速稳定和安全的无线通信，借助AP建立无线物联网，或者将您的电子设备接入互联网，实现远程控制等等。WSUM102A集成了TCP/IP协议栈，只需要几个简单的命令就可以实现SOCKET网络通信，为您的产品开发节省宝贵的时间。

  3. 所属分类：嵌入式

    • 发布日期：2013-06-16
    • 文件大小：804kb
    • 提供者：lck3578

  1. verilog uart模块

  2. verilog 写uart模块，例化时可以配置模块时钟与波特率时钟，内部集成了晶振--波特率计数器偏差校正部分(通过最小边沿校正)，校正范围-10%~10%，接收部分使用7点采样。 例化示例： uart #( .freq_clk(24), .freq_baud(57600) ) m1( .clk(24m), .reset_n(reset_n), .tx(uart_tx1), .rx(uart_rx1), .data_to_tx_flag(tx_flag), .data_to_t

  3. 所属分类：嵌入式

    • 发布日期：2020-07-18
    • 文件大小：16kb
    • 提供者：a768560125

  1. ATK-USB-UART模块

  2. ATK-USB-UART模块开发资料。

  3. 所属分类：硬件开发

    • 发布日期：2020-07-25
    • 文件大小：49mb
    • 提供者：Gravitas

  1. 基于Verilog HDL的UART模块设计与仿真

  2. 通用异步收发器UART常用于微机和外设之间的数据交换，针对UART的特点，提出了一种基于Verilog HDL的UART设计方法。采用自顶向下的设计路线，结合状态机的描述形式，使用硬件描述语言设计UART的顶层模块及各个子模块，从而使整个设计更加紧凑、可靠。同时采用参数化的设计方法，增强系统的可移植性。仿真结果表明，该系统可支持标准异步串行传输RS-232协议，可集成到FPGA芯片中使用。

  3. 所属分类：其它

    • 发布日期：2020-08-05
    • 文件大小：82kb
    • 提供者：weixin_38709511

  1. 基于FPGA的UART模块的设计

  2. 通用异步收发器(UniversalAsynchronotlsReceiv—er／Transmitter，UART)是辅助计算机与串行设备之间的通信，作为RS232通信接口的一个重要的部分，目前大部分的处理器都集成了UART。

  3. 所属分类：其它

    • 发布日期：2020-10-20
    • 文件大小：270kb
    • 提供者：weixin_38744803

  1. 基于Verilog HDL的UART模块设计与仿真

  2. 文章标题：基于Verilog HDL的UART模块设计与仿真。中国IT实验室嵌入式开发频道提供最全面的嵌入式开发培训及行业的信息、技术以及相关资料的下载.

  3. 所属分类：其它

    • 发布日期：2020-10-26
    • 文件大小：269kb
    • 提供者：weixin_38681628

  1. EDA/PLD中的基于Verilog HDL的UART模块设计与仿真

  2. 摘要：通用异步收发器UART常用于微机和外设之间的数据交换，针对UART的特点，提出了一种基于Ver4log HDL的UART设计方法。采用自顶向下的设计路线，结合状态机的描述形式，使用硬件描述语言设计UART的顶层模块及各个子模块，从而使整个设计更加紧凑、可靠。同时采用参数化的设计方法，增强系统的可移植性。仿真结果表明，该系统可支持标准异步串行传输RS-232协议，可集成到FPGA芯片中使用。 　　随着微机应用和计算机网络的发展，计算机与外界之间的信息交换变得越来越重要，为了保证串行通信的正

  3. 所属分类：其它

    • 发布日期：2020-11-06
    • 文件大小：236kb
    • 提供者：weixin_38721119

  1. ASIC-Implementation-UART：本文介绍了用于串行通信的UART模块的设计，该模块用于短距离，低速以及计算机与外围设备之间的数据交换。 UART主要包含发送器，接收器和波特率发生器。 波特率发生器为UART产生时钟。 通过

  2. ASIC实现UART 本文介绍了用于串行通信的UART模块的设计，该模块用于短距离，低速和计算机与外围设备之间的数据交换。 UART主要包含发送器，接收器和波特率发生器。 波特率发生器为UART产生时钟。 通过使用系统时钟的分频因子，我们可以实现所需的波特率。 如果增加波特率，串行数据传输的速度将提高。 随着分频系数的降低，波特率增加。 在本文中，我们将系统时钟频率设置为50MHz，传输每个数据位的时间为23.75ns，波特率为42.1 Mbps（分频系数为32）。 由于波特率的增加，传输数据

  3. 所属分类：其它

  1. 基于Verilog HDL的UART模块设计与仿真

  2. 摘要：通用异步收发器UART常用于微机和外设之间的数据交换，针对UART的特点，提出了一种基于Ver4log HDL的UART设计方法。采用自顶向下的设计路线，结合状态机的描述形式，使用硬件描述语言设计UART的顶层模块及各个子模块，从而使整个设计更加紧凑、可靠。同时采用参数化的设计方法，增强系统的可移植性。仿真结果表明，该系统可支持标准异步串行传输RS-232协议，可集成到FPGA芯片中使用。 　　随着微机应用和计算机网络的发展，计算机与外界之间的信息交换变得越来越重要，为了保证串行通信的正

  3. 所属分类：其它

    • 发布日期：2021-01-19
    • 文件大小：294kb
    • 提供者：weixin_38587509
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