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  1. Xlinx ISE 9.X FPGA_CPLD设计指南

  2. Xilinx ISE 9.x FPGA/CPLD设计指南 目录 （这是本书的第1页到76页，只因只能上传小于20M的文件，其它的也已上传） 第1章　FPGA设计简介　1 1.1　FPGA结构简介　2 1.1.1　总体结构　2 1.1.2　可配置逻辑块CLB　3 1.1.3　输入输出模块(Input/Output Block)　6 1.1.4　块RAM(BlockRAM)　9 1.2　最新FPGA产品──Virtex-5　10 1.2.1　Virtex-5的特点　10 1.2.2　Virtex-

  3. 所属分类：硬件开发

    • 发布日期：2009-11-27
    • 文件大小：18mb
    • 提供者：jiemizhe000

  1. Xilinx FPGA开发全攻略(技巧篇)

  2. 强烈推荐 Xili FPGA开发全攻略(技巧篇)

  3. 所属分类：硬件开发

    • 发布日期：2010-07-13
    • 文件大小：4mb
    • 提供者：hglikun

  1. Xili 曦力 DVD 转换 专家 旗舰版 v7.7.2 +key

  2. Xili 曦力 DVD 转换 专家 旗舰版 v7.7.2 注册

  3. 所属分类：桌面系统

    • 发布日期：2013-04-26
    • 文件大小：35mb
    • 提供者：manstain

  1. XINLIXUEKEJIAN

  2. XINLIXUEFANGMIANDEZHISHI

  3. 所属分类：Veritas

    • 发布日期：2008-09-19
    • 文件大小：710kb
    • 提供者：QQXIAOBING

  1. xilinx FPGA开发软件

  2. 软件很大 无法上传 特此分享我的网盘链接 供大家下载使用 Xilinx(赛灵思)是全球领先的可编程逻辑完整解决方案的供应商。Xilinx研发、制造并销售范围广泛的高级集成电路、软件设计工具以及作为预定义系统级功能的IP（Intellectual Property）核。客户使用Xilinx及其合作伙伴的自动化软件工具和IP核对器件进行编程，从而完成特定的逻辑操作。Xilinx公司成立于 1984年，Xilinx首创了现场可编程逻辑阵列（FPGA）这一创新性的技术，并于1985年首次推出商业化产品

  3. 所属分类：其它

    • 发布日期：2016-07-05
    • 文件大小：229byte
    • 提供者：qq_27504763

  1. DDR3L_device_operation_timing_diagram_computing.pdf

  2. 该文档主要讲解了DDR3/DDR3L的各种控制命令时序，以及读写操作各信号之间的关系，对理解DDR3的应用有很大的帮做。SK hynix SK hynix SK hynix plied Power Reset S,MPR) Procedure -(Initialization Write Self Refresh SRE ZQCL from any RESET state ZQCLZQC5 REF Calibrati Idle PDX Precharge Power Activating P

  3. 所属分类：硬件开发

    • 发布日期：2019-07-16
    • 文件大小：4mb
    • 提供者：wmjoin

  1. MQ的一些资料

  2. NULL 博文链接：https://ibmtech.iteye.com/blog/773100WebSphere MQ Programmable command Formats and Administration interface Version 70 sc34694201 Before using this information and the product it supports, be sure to read the general information under noti

  3. 所属分类：其它

  1. EDA/PLD中的基于FPGA内部的FIFO设计

  2. 在FPGA设计中，内部的FIFO设计是 个不可或缺的内容，其设计的质师会直接影响FPGA的逻辑容量和时序。在Xilinx中的某些高端器件是内置的FIFO控制器，在coregen中可以直接产生这的硬FIFO控制器， 强烈建议能够使用硬的HFO控制器的场合，直接的好处足节省逻辑资源和提高逻辑速度，对于绝大部分的HFO设计，推荐使用Xili coregm产生。这样可以保证功能正确，对于需要定制FIFO控制器的场合请小心。 　　下面将结合coregn来说明如何设计一个FIFO 　　产生FIFO时应使

  3. 所属分类：其它

    • 发布日期：2020-11-17
    • 文件大小：564kb
    • 提供者：weixin_38742656

  1. 嵌入式系统/ARM技术中的Coolbaze处理器设计范例

  2. 如何设计一个标准的PicoBlaze处理器已经在前面详细介绍，本节将对标准的PicoBlaze处理器进行简化，即减少不用的指令。采用尽可能少的CPLD逻辑资源来实现CoolBlaze处理器，用于控制一个小型的8位LED显示系统，其系统框图如图所示。 　　图 8位LED显示系统框图 　　1．设计说明 　　(1) 时钟采用CoolRunner-II器件内部的时钟分频模块。 　　(2) 外部通过一个按键来产生中断。 　　(3) 将8个8位的寄存器组去掉4个，仅保留4个8位寄存器，从而减少

  3. 所属分类：其它

    • 发布日期：2020-11-17
    • 文件大小：85kb
    • 提供者：weixin_38550812

  1. xili-task：毕设项目开发-源码

  2. 西里任务 毕设项目开发

  3. 所属分类：其它

  1. 基于FPGA内部的FIFO设计

  2. 在FPGA设计中，内部的FIFO设计是 个不可或缺的内容，其设计的质师会直接影响FPGA的逻辑容量和时序。在Xilinx中的某些高端器件是内置的FIFO控制器，在coregen中可以直接产生这的硬FIFO控制器， 强烈建议能够使用硬的HFO控制器的场合，直接的好处足节省逻辑资源和提高逻辑速度，对于绝大部分的HFO设计，推荐使用Xili coregm产生。这样可以保证功能正确，对于需要定制FIFO控制器的场合请小心。 　　下面将结合coregn来说明如何设计一个FIFO 　　产生FIFO时应使

  3. 所属分类：其它

    • 发布日期：2021-01-19
    • 文件大小：888kb
    • 提供者：weixin_38513794