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bcd修复工具
bcd修复工具,无需安装,点开选择自动修复,具体使用请参考我的博文
所属分类:
DOS
发布日期:2018-03-27
文件大小:398
提供者:
u010439582
BCD加法器的Multisim仿真图和Altium designer的PCB版图
这是我自己在数字电路课上的作业,BCD加法器的Multisim仿真图和AD的PCB版图,老师要求非常多,完成的效果应该挺好的
所属分类:
讲义
发布日期:2018-05-13
文件大小:854016
提供者:
weixin_40973904
BCD数码管显示程序
BCD码实现的数码管的显示,毕业设计程序,具体功能我忘记了
所属分类:
C
发布日期:2018-07-18
文件大小:56320
提供者:
laocui1
BCD转ASC显示.ASM
汇编程序,BCD转ASC显示
所属分类:
电信
发布日期:2020-05-18
文件大小:488
提供者:
qq_43689276
BCD码闹钟.zip
就是个BCD码显示的钟,一般人看不懂,觉得很高级,最后我自己看的也嫌烦了,最终雪藏。。。。。 h文件中有明确定义引脚。 stc,51系列单片机搭配ds1302经典时钟方案。 简单的入门级玩具,代码也是入门时写的,给大家玩玩。
所属分类:
嵌入式
发布日期:2020-05-16
文件大小:130048
提供者:
qq_41671300
BCD转余3码串进串出分析.pdf
BCD 转余 3 码串进串出分析,选自王建民书中例 8-17。余 3 码只要对 8421 编码加 3 即可得到。故,如果输入是并行的 8421 编码,输出是并行的余 3 码,则可以 直接通过一个加法器得到相应的余 3 码。但现在输入是串行的 8421 编码,输出是串行的余 3 码。一旦是串行的,就涉及到时序电路
所属分类:
其它
发布日期:2020-05-12
文件大小:578560
提供者:
ultra777
二进制转换BCD(16位verilog代码)Bin2BCD_16Bit.v
16位二进制转换BCD码的verilog代码,Quartus II软件打开。Keil也可以打开。EDA课程实验作业参考。
所属分类:
嵌入式
发布日期:2020-04-30
文件大小:2048
提供者:
weixin_42596755
数字电路课程设计之BCD加法器设计.doc
使用Verilog语言实现4bit*4bit 8421 BCD码加法器设计,并使用Quartes编写程序,使用modelsin进行仿真验证设计
所属分类:
专业指导
发布日期:2020-04-12
文件大小:276480
提供者:
succguan
二进制换BCD码(内含完整C语言的代码)
二进制换BCD码(内含完整C语言的代码)
所属分类:
C
发布日期:2020-04-11
文件大小:152576
提供者:
qq_36596540
BCD码大小写.rar
BCD码大小写.rar
所属分类:
其它
发布日期:2020-04-04
文件大小:2048
提供者:
m0_46790875
二进制转十六进制BCD码.vi
使用LABVIEW 生成的子VI 可以有效得将二进制数,转换成16进制数的BCD码。 常用于校验和分析上。
所属分类:
互联网
发布日期:2020-03-30
文件大小:31744
提供者:
gh997433
PLC程序下载--BCD数据.zip
PLC程序下载--BCD数据zip,PLC程序下载--BCD数据
所属分类:
其它
发布日期:2019-10-13
文件大小:149504
提供者:
weixin_38743737
VERILOG 编写的BCD码转2进制的参数化文件
VERILOG 编写的BCD码转2进制参数化文件,通过直接修改成所需位宽即可实现,工作可用。运行仿真平台quartues和modelsim。核心思想为移位后大4加3。
所属分类:
硬件开发
发布日期:2019-03-16
文件大小:1024
提供者:
weiyunguan8611
一种新型的BCD工艺
讲述一种新型的BCD工艺栅极驱动的集成电路!
所属分类:
其它
发布日期:2014-05-06
文件大小:242688
提供者:
u012599405
600V高低压兼容BCD工艺及驱动设计
600V高低压兼容BCD工艺及驱动设计
所属分类:
硬件开发
发布日期:2012-10-23
文件大小:557056
提供者:
jhua02210221
BCD工艺介绍文章
集成电路版图BCD工艺介绍文章一篇,全英文
所属分类:
制造
发布日期:2012-03-07
文件大小:811008
提供者:
prayer163
CIA讲义\CIA讲义\III\BCD经营分析.doc
CIA讲义\CIA讲义\III\BCD经营分析.doc
所属分类:
其它
发布日期:2012-02-10
文件大小:31744
提供者:
uc224
用verilog语言在FPGA通讯工程中实现BCD译码
用verilog的for循环实现了0-99999之间数据的BCD译码,方便FPGA中AD采集和串口通讯间等数据传输,一个时钟大概就可以实现一次译码。已经在8路16位的AD采集的FPGA程序中测试运行,可以实现采集数据后,发送到上位机通过ascl码显示8路数据。可以当成模块直接在自己的程序中调用译码即可
所属分类:
互联网
发布日期:2020-07-17
文件大小:2048
提供者:
qq_39521541
我与FPGA的恋爱之二进制码转换成BCD码
本文章是关于二进制码转换成BCD码的相关设计。
所属分类:
其它
发布日期:2020-07-21
文件大小:40960
提供者:
weixin_38625448
二进制或BCD的转换电路
本文为大家介绍了二进制或BCD的转换电路。
所属分类:
其它
发布日期:2020-07-19
文件大小:28672
提供者:
weixin_38690522
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