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  1. 一位全加器.circ

  2. logisim的设计文件，基于此可进行一位全加器实验

  3. 所属分类：EMC

    • 发布日期：2020-05-09
    • 文件大小：193kb
    • 提供者：mrzssss

  1. 一位的全加法器,四位加减法器设计(logisim).zip

  2. 在Logisim设计一个用4个FA4构成一个4位的加减法器：可以在引脚输出结果，并显示在LED上。输入采用手动设置引脚

  3. 所属分类：讲义

    • 发布日期：2020-04-29
    • 文件大小：3kb
    • 提供者：liuyiming2019

  1. logisim画CPU：8位可控加减法电路设计

  2. 一位全加器、八位串行可控加减法器。circ文件，下载后直接用logisim打开即可。只实现了一位全加器、八位串行可控加减法器，其他部分没有实现。

  3. 所属分类：硬件开发

    • 发布日期：2020-04-20
    • 文件大小：395kb
    • 提供者：qq_43588553

  1. logsim8位可控加减法电路设计.txt

  2. 帮助学生掌握一位全加器的实现逻辑，掌握多位可控加减法电路的实现逻辑，熟悉 Logisim 平台基本功能，能在 logisim 中实现多位可控加减法电路。仅供参考

  3. 所属分类：专业指导

    • 发布日期：2020-06-05
    • 文件大小：613kb
    • 提供者：m0_47399957