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资源分类
搜索资源列表
5阶fir滤波器,vhdl编写
基于fpga的fir数字滤波器,用vhdl编写,阶数位5阶,可以好好参考
所属分类:
硬件开发
发布日期:2009-05-25
文件大小:416kb
提供者:
tunkun
由VHDL编写的加法器代码
由VHDL编写的加法器代码实例。 由VHDL编写的加法器代码实例。 由VHDL编写的加法器代码实例。
所属分类:
其它
发布日期:2009-05-26
文件大小:662byte
提供者:
yanyinhong
VHDL编写的自动售货机
VHDL编写的自动售货机,有退毕,找零功能
所属分类:
其它
发布日期:2009-08-13
文件大小:4kb
提供者:
lovefengqiang
VHDL编写的24进制时钟
用vhdl编写的24进制时钟,能数码管显示时分秒。
所属分类:
C/C++
发布日期:2009-09-07
文件大小:70kb
提供者:
cpjnear
VHDL编写的三档控制频率计
这是一个用VHDL编写的三档频率计,用来测量信号的频率,频率计有三个档位,频率计可以根据信号频率的大小自动换挡。
所属分类:
专业指导
发布日期:2009-09-14
文件大小:233kb
提供者:
liujunaseu
vhdl编写的移位器
用vhdl编写的移位器,实现了算术左移何右移,逻辑左移和右移,循环左移和右移。
所属分类:
其它
发布日期:2009-10-23
文件大小:548byte
提供者:
he1hehe
VHDL编写的自动售货机
VHDL编写的自动售货机 设计FPGA模块模拟自动售货机的工作过程,要求如下(1)售货机有两个进币孔, 可以输入硬币和纸币,售货机有两个进币孔,一个是输入硬币,一个是输入纸币, 硬币的识别范围是5角和1 元的硬币,纸币的识别范围是1 元、5 元,10 元,20 元,50元,100元。乘客可以连续多次投入钱币。(2)顾客可以选择的商品种类 有16种,价格分别为1-16元,顾客可以通过输入商品的编号来实现商品的选择。 即有一个小键盘(0-9按键)来完成,比如输入15时要先输入1,再输入5。(3)
所属分类:
硬件开发
发布日期:2010-02-28
文件大小:7mb
提供者:
crosswater
串行adtlc_549,通过lcd显示,vhdl编写
串行adtlc_549,通过lcd显示,vhdl编写,lcd程序有注释
所属分类:
C/C++
发布日期:2010-03-09
文件大小:3mb
提供者:
cc810610186
使用verilog以及VHDL编写的将串口数据转换为32位并口数据,作为FPGA和DSP接口使用
使用verilog以及VHDL编写的将串口数据转换为32位并口数据,作为FPGA和DSP接口使用
所属分类:
硬件开发
发布日期:2010-04-10
文件大小:823kb
提供者:
wdd1yx
用vhdl编写的移位寄存器的程序
应用vhdl编写的移位寄存器的程序,对于制作可编程逻辑器件有一定的帮助
所属分类:
专业指导
发布日期:2010-04-17
文件大小:657byte
提供者:
xieyunhui123456789
VHDL编写的16位计数器
利用VHDL编写的16位数字计数器,另外可在程序中修改为任意的2N分频器
所属分类:
专业指导
发布日期:2010-04-25
文件大小:175kb
提供者:
flovef4ever
verilog和vhdl编写的串口通信代码
verilog和vhdl编写的串口通信代码,可综合
所属分类:
其它
发布日期:2010-06-09
文件大小:288kb
提供者:
htao33
用VHDL编写的计算器
用VHDL编写的计算器用VHDL编写的计算器
所属分类:
专业指导
发布日期:2010-07-30
文件大小:22kb
提供者:
ltjliao
vhdl编写的程序,初学EDA的使用
vhdl编写的程序,对于初学EDA的有很大用处!
所属分类:
嵌入式
发布日期:2011-05-30
文件大小:137kb
提供者:
wxf_420
VHDL编写16*16点阵
用VHDL编写的16*16点阵,学校布置的课程设计
所属分类:
专业指导
发布日期:2011-12-21
文件大小:43kb
提供者:
qinshuixi
用 Verilog 和 VHDL 编写的 uart 通信代码(可综合)
拿verilog和vhdl编写的串口通信代码(可综合) (with vhdl and verilog prepared by the serial communication code (can be synthesized))
所属分类:
电信
发布日期:2020-05-17
文件大小:287kb
提供者:
weixin_43870101
使用verilog以及VHDL编写的将串口数据转换为32位并口数据,作为FPGA和DSP接口使用
使用verilog以及VHDL编写的将串口数据转换为32位并口数据,作为FPGA和DSP接口使用 使用verilog以及VHDL编写的将串口数据转换为32位并口数据,作为FPGA和DSP接口使用
所属分类:
硬件开发
发布日期:2020-03-01
文件大小:800kb
提供者:
asdfghjkl7890123
使用verilog以及VHDL编写的将串口数据转换为32位并口数据,作为FPGA和DSP接口使用
使用verilog以及VHDL编写的将串口数据转换为32位并口数据,作为FPGA和DSP接口使用 使用verilog以及VHDL编写的将串口数据转换为32位并口数据,作为FPGA和DSP接口使用
所属分类:
硬件开发
发布日期:2020-01-31
文件大小:800kb
提供者:
weixin_42565716
RISCV_VHDL:开发简单的RV32I指令集流水线处理器内核。 代码将以VHDL编写-源码
RISCV_VHDL 简单的RV32I指令集流水线处理器核心的开发代码将以VHDL编写。 RV32I-基本整数指令集,32位寄存器
所属分类:
其它
发布日期:2021-02-20
文件大小:35kb
提供者:
weixin_42131633
第四CPU:基于VHDL编写的基于J1的Forth CPU和片上系统-源码
第四CPU:基于VHDL编写的基于J1的Forth CPU和片上系统
所属分类:
其它
发布日期:2021-01-30
文件大小:201kb
提供者:
weixin_42168555
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