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EDA/PLD中的用作嵌入式处理器定制外围器件的FPGA
用作嵌入式处理器定制外围器件的FPGA 数字外围器件可以被定义为一块电路,将信号从外部(相对于处理器而言)脉冲源转换为一种可由处理器进行存取的形式。这种外部脉冲源有可能只是一个机械开关,也可能很复杂,比如一个运行高级通信协议的高速数据链路。不管外部信号的形式如何,数据都必须以处理器能够接受的形式来提供。这可以通过一个简单的系统地址/数据总线接口来实现,也可以根据目标系统的所需数据带宽通过某些具有较高速度(或者是专用)的数据链路来实现。现场可编程门阵列(FPGA)具有大量的逻辑电路、存储器和布
所属分类:
其它
发布日期:2020-12-09
文件大小:90112
提供者:
weixin_38565818
ST 第一款可配置系统级芯片
意法半导体(STMicro)今天宣布可配置系统芯片IC系列的第一款产品制造成功,该产品适合各种应用,包括打印机、扫描仪和其它嵌入式控制应用的数字引擎,同时ST还为客户提供了一个覆盖现在和未来需求的完整的产品开发计划。 新器件基于ST的“结构化处理器增强型体系结构”(SPEAr),集成一个ARM核心和一整套IP(知识产权)模块和一个可配置逻辑模块,快速定制关键的功能只需全定制化设计方法的一小部分时间和成本,而且灵活性与性能可与全定制化设计方法媲美。 这个产品系列基于工业标准的ARM核心,最大化了现
所属分类:
其它
发布日期:2020-12-09
文件大小:54272
提供者:
weixin_38616359
元器件应用中的用作测试负载的数字可编程电阻
图1所示的数字可编程精密电阻可在定制设计的 ATE(自动测试设备)中 用作微处理器驱动的电源负载。IC1 是一个 8 位 电流输出型 DAC,即DAC08型DAC ,它驱动电流-电压变换器 IC2A,IC2A又驱动功率 MOSFET Q1 的栅极。被测器件连接到 J1 和 J2。在工作时,来自被测器件的电流在采样电阻 R8A 和 R8B 上形成一个电压。放大器 IC2B 驱动 IC1 的基准输入端,并使反馈路径闭合。当 R8A 和 R8B 上的压降达到 Q2 的 VBE
所属分类:
其它
发布日期:2020-12-08
文件大小:78848
提供者:
weixin_38678796
数据可视化--Echarts库.rar
智能看板---数据可视化展示案例---插件动态换算rem值+Echarts库(一个使用 Javascr ipt 实现的开源可视化库,可以流畅的运行在 PC 和移动设备上,兼容当前绝大部分浏览器(IE8/9/10/11XQ,Chrome,Firefox,Safari等),底层依赖矢量图形库 ZRender,提供直观,交互丰富,可高度个性化定制的数据可视化图表。)
所属分类:
HTML5
发布日期:2020-12-08
文件大小:872448
提供者:
qq_40440961
PDMS ISO 图定制.pdf
本文档为PDF格式,针对PDMS单线图的OPTION定制进行讲解,内容较为详细,用admin及以上权限的账户名进入ISO模块,针对OPTION>MODIFY选择相应的模板文件进行选择修改。每个MODIFY选项均有相应的文字详解及图片介绍,用户可针对自身要求进行修改及定制。
所属分类:
咨询
发布日期:2020-12-06
文件大小:543744
提供者:
williwaw15
单片机与DSP中的一种基于NiosⅡ的可重构DSP系统设计
摘 要:应用Nios II嵌入式软核处理器所具有的可自定义指令的特点,本文提出了一种具有常规DSP功能的Nios II系统SOPC解决方案。用户可通过Matlab和DSP Builder或VHDL语言来设计复数乘法器、整数乘法器、浮点乘法器等硬件模块,再将它们定制为相应的指令,从而实现软件的灵活性和硬件高速性的结合。关键词:SOPC;Nios II嵌入式软核处理器;FPGA;DSP 引言 为了解决传统DSP所面临的速度低、硬件结构不可重构、开发升级周期长和不可移植等问题,本文应用Altera
所属分类:
其它
发布日期:2020-12-06
文件大小:92160
提供者:
weixin_38653385
Cypress推出完全可配置型时钟发生器CY22800
Cypress为其独特的InstaClock时序解决方案系列新添了一款可配置、可编程时钟发生器。新推出的CY22801时钟进一步增强了赛普拉斯InstaClock系列的灵活性。该系列时钟可在一分钟之内完成编程,用户从此可以不必再因等待定制编程部件或改变掩码而耽搁时间。用户可以使用易用的CyClocksRT软件生成任何所需的频率。新型InstaClock芯片支持以太网、PCI、USB、CPU、高清电视和音频系统等消费电子产品和通信应用中所使用的各种频率。 除此之外,赛普拉斯还为此前推出的Inst
所属分类:
其它
发布日期:2020-12-04
文件大小:81920
提供者:
weixin_38545463
嵌入式系统/ARM技术中的赛普拉斯推出完全可配置型时钟发生器
赛普拉斯半导体公司为其独特的InstaClock?时序解决方案系列新添了一款可配置、可编程时钟发生器。新推出的CY22801时钟进一步增强了赛普拉斯InstaClock?系列的灵活性。该系列时钟可在一分钟之内完成编程,用户从此可以不必再因等待定制编程部件或改变掩码而耽搁时间。用户可以使用易用的CyClocksRT?软件生成任何所需的频率。新型InstaClock芯片支持以太网、PCI、USB、CPU、高清电视和音频系统等消费电子产品和通信应用中所使用的各种频率。 除此之外,赛普拉斯还
所属分类:
其它
发布日期:2020-12-03
文件大小:90112
提供者:
weixin_38575536
可脚本控制的FLV网页播放器
脚本调用flv视频文件地址在页面上播放,方便使用。 可通过脚本定制界面元素。
所属分类:
其它
发布日期:2009-11-10
文件大小:2097152
提供者:
wszhoho
Django基于Models定制Admin后台实现过程解析
简介 效果预览 Django自带一个Admin后台, 支持用户创建,权限配置和所有模型的增删改查功能, 只需要一些简单的配置就可快速得到一个开箱可用的后台管理系统 操作步骤 1. 更改设置,使用中文/亚洲时区 修改项目下django_shop目录下的settings.py文件 修改以下三行 LANGUAGE_CODE = ‘zh-hans’ TIME_ZONE = ‘Asia/Shanghai’ USE_L10N = False 添加以下两行, 已更改时间显示格式 DATETIM
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其它
发布日期:2020-12-16
文件大小:312320
提供者:
weixin_38514501
可重用MIS用户接口模块的设计
摘 要:通过对MIS通用功能的分析,采用面向对象的继承机制构造窗口和菜单的整体框架,其中,对数据提交时校验结果的中文提示方法、打印预览、用户定制查询等进行了比较详细的研究。有效地解决了界面设计中统一性和特殊需要之间的矛盾。 界面是系统提供给用户的第一感觉,不同开发者制作的界面风格有很大的差异,同一人在不同时间也具有随意性。因此,无论个人独自开发系统还是团队作业,都要对界面进行整体的规划。 制作统一界面的一般方法是具体而强行的规定,本文依据PB开发的经验,实现了MIS系统中窗口和菜单的整体
所属分类:
其它
发布日期:2020-12-13
文件大小:144384
提供者:
weixin_38588394
模拟技术中的用定制测量表达式简化PSpice对最坏情形的模拟
IC 设计期间,最坏情形的模拟可帮助设计师说明 PNP 和 NPN 晶体管以及基极电阻器和多晶硅电阻器的特性变化。仅是这四类器件产生的模拟条件组合就超过 16 种。为了适应温度变化,每个组合都要在 -40℃、+27℃(室温)和 +125℃ 下接受模拟,因此在模拟完成时会产生至少 48 个数据系列供分析。为了帮助 IC 设计师评估模拟波形的特性,PSpice 提供了一个由若干易用并预先定义的测量尺度组成的库,包括带宽、增益/相位余量等等。PSpice 还允许设计师利用预先定义的 YatX 和 Xa
所属分类:
其它
发布日期:2020-12-13
文件大小:160768
提供者:
weixin_38586118
嵌入式系统/ARM技术中的Cypress推出可配置型CY22801可编程时钟发生器
日前,时序技术解决方案提供商赛普拉斯半导体公司(Cypress)为其独特的InstaClock时序解决方案系列新添了一款可配置、可编程时钟发生器。新推出的CY22801时钟进一步增强了赛普拉斯InstaClock系列的灵活性。该系列时钟可在一分钟之内完成编程,用户从此可以不必再因等待定制编程部件或改变掩码而耽搁时间。用户可以使用易用的CyClocksRT软件生成任何所需的频率。新型InstaClock芯片支持以太网、PCI、USB、CPU、高清电视和音频系统等消费电子产品和通信应用中所使用的各种
所属分类:
其它
发布日期:2020-12-04
文件大小:79872
提供者:
weixin_38569722
python实现定制交互式命令行的方法
Python的交互式命令行可通过启动文件来配置。 当Python启动时,会查找环境变量PYTHONSTARTUP,并且执行该变量中所指定文件里的程序代码。该指定文件名称以及地址可以是随意的。按Tab键时会自动补全内容和命令历史。这对命令行的有效增强,而这些工具则是基于readline模块实现的(这需要readline程序库辅助实现)。 此处为大家举一个简单的启动脚本文件例子,它为python命令行添加了按键自动补全内容和历史命令功能。 [pythonpython ~]$ cat .python
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其它
发布日期:2020-12-25
文件大小:44032
提供者:
weixin_38689736
浅谈python可视化包Bokeh
本文研究的主要是python可视化包Bokeh的相关内容,具体如下。 问题:需要把pandas的数据绘图并通过网页显示,matplotlib需要先保存图像,不合适。 解决:在网上搜了一下,找到一篇介绍文章 python可视化工具概述,其中介绍了几个python包,总结如下: Pandas对于简单绘图,可以随手用,但你需要学习定制matplotlib。 Seaborn可以支持更多复杂的可视化方式,但仍然需要matplotlib知识,上色功能是个亮点。 ggplot有很多功能,但还需要发
所属分类:
其它
发布日期:2020-12-23
文件大小:56320
提供者:
weixin_38590309
Python 自由定制表格的实现示例
很多开发者说自从有了 Python/Pandas,Excel 都不怎么用了,用它来处理与可视化表格非常快速。 下面我来举几个例子。 1. 删除重复行和空行 我们直接用dict.fromkeys的方法把当前的数据转为字典,默认的值为None因为用不到,也就无所谓了。然后我们再用list直接对结果进行类型转换,转换为list。 In [135]: for row in rows4: print(row) ('name', 'address') ('tom li', 'beijing') ('t
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其它
发布日期:2020-12-20
文件大小:74752
提供者:
weixin_38745434
EDA/PLD中的Actel新款IP内核可简化FPGA系统设计
Actel公司近日为其FPGA推出一款新的IP内核,该产品为双倍数据率(DDR)的SDRAM存储器提供了高性能的同步接口。 新推的CoreDDR内核具有完全的管道架构,支持1,024MB存储器,能为消费电子、通信、工业和军事应用提供较高的数据率。此外该内核的存储器控制器能根据系统和存储器特性需求进行定制,可设计最大的存储带宽并提高系统性能。 CoreDDR控制器专为Actel基于反熔丝(Antifuse)的Axcelerator与RTAX-S FPGA而设计,支持标准SDRAM芯
所属分类:
其它
发布日期:2020-12-08
文件大小:45056
提供者:
weixin_38620839
一种零NRE的可编程ASIC——eASIC
在激烈的市场竞争中,创新和差异化对产品的成功至关重要。为了达到这一目的,必须寻找能够价格合理的IC解决方案实现特定的差异化应用。随着工艺的提高和市场的变化,标准单元ASIC面临的风险越来越多:一是NRE费用越来越高。而中国IC公司刚起步,力量比较薄弱,往往缺少雄厚的资金来保证;二是定制时间长,而市场的变化又比较快。一个ASIC设计成功以后,当初看到的市场不一定还在;三是用户的需求变化快,产品更新换代频繁,这就要求ASIC也要随着变化。正因为如此,全球ASIC设计新项目的数量逐年下降。而FPGA又
所属分类:
其它
发布日期:2020-12-08
文件大小:207872
提供者:
weixin_38665668
C#利用PrintDocument定制打印单据的小例子
前言 本文是利用PrintDocument定制打印单据的小例子,仅供学习分享使用,如果不足之处,还请指正。 涉及知识点: PrintDocument :从 Windows 窗体应用程序打印时,定义一种可重用的可发送到打印机上的对象。 PrintPreviewControl :表示 Windows 窗体应用程序打印预览的原始预览部分,没有任何对话框或按钮。 Graphics :GDI+绘图对象 PrinterSettings:设置打印机属性,如:设置属性Copies,可以设置打印份
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其它
发布日期:2020-12-31
文件大小:102400
提供者:
weixin_38606811
基于vue实现可搜索下拉框定制组件
实践加深对vue的理解和运用有效途径,本文是基于vue的可搜索下拉框定制组件实现,在此记录. 一、效果 二、组件代码 dropdown.vue <span
所属分类:
其它
发布日期:2020-12-29
文件大小:33792
提供者:
weixin_38564085
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