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数字逻辑实验
投票表决器的设计,四位全加器的设计,列出其对应的真值表,并画出其仿真图像。
所属分类:
Sybase
发布日期:2012-05-24
文件大小:117760
提供者:
xsyuliuyan
基于EDA的半加器设计
加法器是构成算术运算器的基本单元,有来自低位的进位将两个1位二进制数相加,称为半加。实现半加运算的电路叫做半加器。 按照二进制加法运算规则可以列出如表1-1所示的半加器真值表。其中A、B是两个加数,S是相加的和,CO是相加高位的进位。
所属分类:
硬件开发
发布日期:2012-06-02
文件大小:759808
提供者:
mfs1184396251
基于EDA的 硬件电子琴电路设计
PC机,操作系统为Windows2000/XP,本课程所用系统均为WindowsXP(下同),Quartus II 5.1设计平台,GW48系列SOPC/EDA实验开发系统。 三、 实验原理 1、 主系统由3个模块组成,其内部有两个功能模块(如图6-1所示): SPEAKER.VHD (附录6-1)和TONE.VHD(附录6-2)。 2、 模块TONE是音阶发生器,当8位发声控制输入INDEX中某一位为高电平时,则对应某一音阶的数值将从端口TONE输出,作为获得该音阶的分频预置值;同时由COD
所属分类:
硬件开发
发布日期:2012-06-02
文件大小:45056
提供者:
mfs1184396251
Stateflow系统逻辑建模
《Stateflow逻辑系统建模》详细介绍了MATLAB产品体系中用于动态逻辑系统建模仿真的 Stateflow产品的应用方法。《Stateflow逻辑系统建模》的前六章内容是Stateflow的基础,重点介绍了有限状态系统中状态、状态转移、连接节点、历史节点、动作、数据对象、事件等各种概念在Stateflow产品中的实现方法,还着重介绍了层次化系统建模、并行机制、事件广播、隐含事件和时间逻辑等有限状态系统的建模方法。《Stateflow逻辑系统建模》的后三章内容涉及Stateflow的高级话
所属分类:
其它
发布日期:2012-08-30
文件大小:61865984
提供者:
lgmmgl
顺序表的C++程序实现
用模板方式实现顺序表的合并 #include "stdafx.h" #include #define MaxSize 100 template class SeqList { private: T * Mylist; int ListMaxSize; int Length; public: SeqList(int ListMaxSize=MaxSize); //构造函数 ~SeqList(void);// 析构函数 bool SLIsEmpty(void); // 判断表是否为空 bool
所属分类:
C++
发布日期:2012-10-05
文件大小:4096
提供者:
gaoppaaa
74HC00中文资料
该器件的全部资料啦。 真值表,引脚图,电气参数,应用电路等。 很全啦。
所属分类:
嵌入式
发布日期:2012-10-07
文件大小:271360
提供者:
tiandizhijian999
74HC138中文资料
74hc138引脚图,真值表,时序图,及温度,电器特性
所属分类:
C++
发布日期:2012-10-13
文件大小:316416
提供者:
hantingkeji
离散数学简单析取合取程序连接词的运算
1. 从键盘输入两个命题变元P和Q的真值,求它们的合取、析取、条件和双条件的真值。(A) 2. 求任意一个命题公式的真值表(B,并根据真值表求主范式(C))
所属分类:
专业指导
发布日期:2012-10-17
文件大小:362496
提供者:
hyx_116688
74LS系列芯片中文手册
74LS系列芯片中文手册,包括大部分74ls系列芯片的芯片引脚识别、真值表、功能等详细资料。
所属分类:
嵌入式
发布日期:2012-12-13
文件大小:14680064
提供者:
liuchuan14
离散数学程序逻辑推理
离散数学的代码,可用于实现真值表输出,输出主析取主合取范式,逻辑推理等。
所属分类:
C/C++
发布日期:2013-01-12
文件大小:6144
提供者:
piaojinwodeshijie
[原创]STM32源码项目,原理图SCH,PCB文件,CAN UART SPI-Flash 电源 四状态输入检测单元
这个实际上只调到了初步的PCB可运行UART可用,其它还未真正调试,但其中的设计及PCB,若有用,哥们们可参考一下 因没完全调试,源代码工程有部分多余代码,工程文件需要重新整理一下,当然如果板子有用,其实可以完全根据原理自己建工程,压缩包内有完整SCH,PCB,包括电源5V,3.3V,RS232,RS485,CAN,SPI-Flash,USB,IO电路。 主要实现的功能是一个多IO,多个232/485,一个CAN通信。 其中数字Input检测,通过两个IO检测四种状态:高,低,悬空,检测单元有
所属分类:
C
发布日期:2013-01-13
文件大小:8388608
提供者:
xsky
离散数学_屈婉玲_耿素云_张立昂_主编_课后答案详_(
第一章部分课后习题参考答案 16 设p、q的真值为0;r、s的真值为1,求下列各命题公式的真值。 (1)p∨(q∧r) 0∨(0∧1) 0 (2)(p↔r)∧(﹁q∨s) (0↔1)∧(1∨1) 0∧1 0. (3)( p∧ q∧r)↔(p∧q∧﹁r) (1∧1∧1) ↔ (0∧0∧0) 0 (4)( r∧s)→(p∧ q) (0∧1)→(1∧0) 0→0 1 17.判断下面一段论述是否为真:“ 是无理数。并且,如果3是无理数,则 也是无理数。另外6能被2整除,6才能被4整除。” 答:p: 是
所属分类:
专业指导
发布日期:2013-03-02
文件大小:1048576
提供者:
yang79309
7448引脚介绍
7448芯片介绍,包含真值表和芯片引脚图。
所属分类:
专业指导
发布日期:2013-04-08
文件大小:507904
提供者:
u010214487
74ls164的资料
用唠ls164n驱动数码管静态显示,有引脚功能和真值表,很详细的
所属分类:
C
发布日期:2013-05-01
文件大小:260096
提供者:
u010528728
74系列芯片说明总汇
本压缩文件为74系列芯片说明集合,下载之后不用到处找74芯片的资料,里面几乎包含了所有的74芯片,注意,全是英文说明,有一定英语基础的看着会轻松一些,不过大多芯片看真值表就可以明白此芯片的功能
所属分类:
嵌入式
发布日期:2013-05-16
文件大小:25165824
提供者:
u010722381
verilog HDL描述38译码器
EDA技术,verilogHDL描述的38译码器,完全根据真值表编写,并成功验证
所属分类:
软件测试
发布日期:2013-05-24
文件大小:692
提供者:
u010818680
002—第二章计算机硬件系统基础—1
002—第二章计算机硬件系统基础—1 逻辑函数:用于表达逻辑变量之间关系的代数式,使用与、或、非3种基本逻辑运算,可以构造出任何逻辑函数 。 逻辑代数:逻辑代数是研究逻辑函数运算和化简的一种数学系统,也是用来描述、分析、简化数字电路的数学工具。 在数字电路中,表示逻辑变量之间的逻辑关系的方法一般有3种:逻辑代数式、真值表、电路图。 真值表:将所有输入变量的所有可能的取值组合,及其在此情况下输出变量应有的取值罗列出来,所形成的一张表。它最全面、最直观地表达了逻辑关系。
所属分类:
嵌入式
发布日期:2013-06-15
文件大小:4194304
提供者:
jayzch
四人抢答器课程设计报告
用面包板制作四人抢答器 四人智力竞赛抢答器 一、设计目的 1.掌握四人智力竞赛抢答器电路的设计、组装与调试方法。 2.熟悉数字集成电路的设计和使用方法。 二、设计任务与要求 1、设计任务 设计一台可供4名选手参加比赛的智力竞赛抢答器。 用数字显示抢答倒计时间,由“9”倒计到“0”时,无人抢答,蜂鸣器连续响1秒。选手抢答时,数码显示选手组号,同时蜂鸣器响1秒,倒计时停止。 2、设计要求 (1)4名选手编号为:1,2,3,4。各有一个抢答按钮,按钮的编号与选手的编号对应,也分别为1,2,3,4。
所属分类:
其它
发布日期:2013-07-03
文件大小:162816
提供者:
u011287168
逻辑函数化简软件
4变量卡诺图化简软件 根据真值表自动化简成最简与或表达式 电子技术基础 数字部分 课程设计 作业
所属分类:
嵌入式
发布日期:2013-08-20
文件大小:130048
提供者:
z845915715
离散数学公式换算程序
可以求出真值表 查看求真值表的技术 有操作的步骤
所属分类:
C#
发布日期:2013-09-13
文件大小:720896
提供者:
u010300715
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