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搜索资源列表

  1. 单片机 8051的IP核

  2. 单片机 8051的IP核 含单片机的软核，可在FPGA中调用 分享……

  3. 所属分类：硬件开发

    • 发布日期：2009-05-04
    • 文件大小：212992
    • 提供者：tanhaijun2007

  1. 基于Avalon总线的可配置LCD控制器IP核的设计_pdf

  2. 基于NiosII 软核的SOPC（System On Programmable Chip）是Altera 公司提出的片上可编程系统解决方案，它将CPU、存储器、I/O接口、DSP 模块以及锁相环（PLL）的系统设计所必须的模块集成到一片FPGA 上，构成一个可编程的片上系统，使所设计的电路在其规模、可靠性、体积、功耗、功能、上市周期、开发成本、产品维护以及硬件升级等多方面实现最优化。

  3. 所属分类：硬件开发

    • 发布日期：2009-05-06
    • 文件大小：308224
    • 提供者：fujunsen

  1. 78F1203-K0R_IB3基于人体仿生学和嵌入式软核的可编程片上系统SoPC

  2. 基于人体仿生学和嵌入式软核的可编程片上系统SoPC

  3. 所属分类：硬件开发

    • 发布日期：2009-09-03
    • 文件大小：8388608
    • 提供者：junjiao110

  1. MC8051单片机IP核的FPGA实现与应用.doc

  2. 。随着现场可编程逻辑阵列(FPGA)及EDA技术的发展，百万门级的FPGA、可重构的嵌入式MCU核、功能复杂的IP核及各种功能强大的EDA工具的出现，实现将MCU、存储器和一些外围电路集成到一个芯片成为可能。随着IP核技术在FPCA中的应用，特别是MCU IP核技术的发展。出现了性能不同的嵌入式MCU软核。MCS-51系列MCU是目前应用时间最长、最普及、可获得应用资料最多的功能强大的8位MCU，建立805l MCU可综合IP核对于各种嵌入式系统和片上系统(SOC)的应用。

  3. 所属分类：硬件开发

    • 发布日期：2009-09-26
    • 文件大小：708608
    • 提供者：luonaerduo890

  1. nios安装程序 提供nios软核

  2. nios安装程序 提供nios软核 官方版本。

  3. 所属分类：iOS

    • 发布日期：2009-10-29
    • 文件大小：9437184
    • 提供者：cronis

  1. 基于NiosⅡ软核的LED显示屏控制系统

  2. 目前的 LED显示屏控制系统普遍采用单片机+FPGA 的组合形式来实现，此种设计 不便于产品升级和技术更新 NiosⅡ软核的设计 思想，将硬件设计软件化，主要功能集中在一片 FPGA 上来实现，在 SOPC Builder内根据 需要来配置 CPU，设计非常灵活，免去了修改硬件电路的麻烦，从而缩短了开发周期，降 低了成本。本系统主要由显示屏、控制 PC上位机组成，控制板主芯片采用 Altera公司 Cyclone 系列的 EP1C6Q240C8 芯片，图文数据由上位机通过串口发送给控制板，经处

  3. 所属分类：硬件开发

    • 发布日期：2009-11-09
    • 文件大小：285696
    • 提供者：maybeonce

  1. LatticeMico32设计指南（中文）

  2. mico32中文的简单教程 1 建立lever工程 2 建立mico32平台 3 生成bit文件 4 c工程建立 5 ebr存储代码生成 6 mico软核调试

  3. 所属分类：C

    • 发布日期：2009-11-24
    • 文件大小：1048576
    • 提供者：zhaizg

  1. 基于Niosii软核处理的指纹识别系统SOPC设计与实现（系统设计部分）

  2. 研究生论文 基于Niosii软核处理的指纹识别系统SOPC设计与实现（系统设计部分）

  3. 所属分类：iOS

    • 发布日期：2010-01-26
    • 文件大小：3145728
    • 提供者：abbyqwert

  1. NiosII软核配置FPGA的C语言源程序

  2. 本文详细介绍了NiosII软核配置FPGA的C语言源程序的方法和步骤，相信对初学者一定会有很大帮助

  3. 所属分类：C

    • 发布日期：2010-03-09
    • 文件大小：2048
    • 提供者：zhangluxiao

  1. pwm_component例子(NIOS学习用)

  2. 《NiosⅡ嵌入式软核SOPC设计原理及应用》一书中的pwm_component的例子，非常棒的一个例子。此例子在Altera官网中没有找到，我是跟书的作者要来的。

  3. 所属分类：iOS

    • 发布日期：2010-03-10
    • 文件大小：10240
    • 提供者：lau1860

  1. JPEG2000中位平面编码的VLSI设计与软核实现

  2. JPEG2000中位平面编码的VLSI设计与软核实现JPEG2000中位平面编码的VLSI设计与软核实现

  3. 所属分类：硬件开发

    • 发布日期：2010-05-21
    • 文件大小：4194304
    • 提供者：superstar1103

  1. MicroBlaze软核资料

  2. 详细介绍了MicroBlaze软核结构以及工作原理，对于我们加深对基于MicroBlaze的FPGA嵌入式开发具有很大的实际指导意义。

  3. 所属分类：硬件开发

    • 发布日期：2010-05-29
    • 文件大小：3145728
    • 提供者：scucsr528

  1. 8位RISC MCU IP软核仿真的新方法

  2. 本文使用Microchip的PIC系列汇编器MPASM汇编生成HEX文件rom.hex，HEX文件由一条或多条记录组成，每行是一条16进制表示的记录。通过分析HEX文件的格式，可以通过转化HEX文件中的记录得到所需的ROM文件。本文使用VC设计了转化程序HEX2ROM，用来完成HEX文件到ROM文件的自动转化，rom.hex文件经程序转化后生成rom.dat。仿真时在测试文件中读入rom.dat完成对虚拟程序存储器初始化，模拟程序存储器模块对MCU核进行验证。

  3. 所属分类：其它

    • 发布日期：2020-10-22
    • 文件大小：209920
    • 提供者：weixin_38515362

  1. 嵌入式DS80C320单片机软核设计与实现

  2. 在如今的快速嵌入式系统设计中，目前比较流行的方案是在FPGA内集成应用软件或是软IP平台，以简化工序、加速产品面市日程。为此，很多公司推出了自己的开发平台以及相关CPU的IP核，常见的为两种：一种是通用型CPU；还有就是专用型的，常见的为51系列单片机的CPU核。

  3. 所属分类：其它

    • 发布日期：2020-10-20
    • 文件大小：293888
    • 提供者：weixin_38675969

  1. 集成电路中的FPGA开发之IP核：软核、硬核以及固核概念

  2. IP（Intelligent Property）核是具有知识产权核的集成电路芯核总称，是经过反复验证过的、具有特定功能的宏模块，与芯片制造工艺无关，可以移植到不同的半导体工艺中。到了SOC阶段，IP核设计已成为ASIC电路设计公司和FPGA提供商的重要任务，也是其实力体现。对于FPGA开发软件，其提供的IP核越丰富，用户的设计就越方便，其市场占用率就越高。　　IP（Intellectual Property）就是常说的知识产权。美国Dataquest咨询公司将半导体产业的IP定义为用于ASIC、

  3. 所属分类：其它

    • 发布日期：2020-10-19
    • 文件大小：59392
    • 提供者：weixin_38691199

  1. AEMB软核处理器的SoC系统验证平台

  2. 本文采用OpenCores组织所发布的32位微处理器AEMB作为SoC系统的控制中心，通过Wishbone总线互联规范将OpenCores组织发布维护的相关IP核集成在目标SoC系统上，构成了最终的SoC验证平台。

  3. 所属分类：其它

    • 发布日期：2020-10-26
    • 文件大小：196608
    • 提供者：weixin_38608693

  1. 嵌入式系统/ARM技术中的AEMB软核处理器的SoC系统验证平台

  2. 引  言 　　SoC芯片的规模一般远大于普通的ASIC，同时深亚微米工艺带来的设计困难等使得SoC设计的复杂度大大提高。仿真与验证是SoC设计流程中最复杂、最耗时的环节，约占整个芯片开发周期的50％～80％，采用先进的设计与仿真验证方法成为SoC设计成功的关键。一个简单可行的SoC验证平台，可以加快SoC系统的开发与验证过程。FPGA器件的主要开发供应商都针对自己的产品推出了SoC系统的开发验证平台，如基于NiosII微处理器的SOPC系统与基于MicroBlaze微处理器的SOPC系统等。它

  3. 所属分类：其它

    • 发布日期：2020-11-07
    • 文件大小：179200
    • 提供者：weixin_38627104

  1. 基于MicroBlaze软核的FPGA片上系统设计

  2. Xilinx公司的MicroBlaze 32位软处理器核是支持CoreConnect总线的标准外设集合。MicroBlaze处理器运行在150MHz时钟下，可提供125 D-MIPS的性能，非常适合设计针对网络、电信、数据通信和消费市场的复杂嵌入式系统。 1 MicroBlaze的体系结构       MicroBlaze 是基于Xilinx公司FPGA的微处理器IP核，和其它外设IP核一起，可以完成可编程系统芯片（SOPC）的设计。MicroBlaze 处理器采用RISC架构和哈佛结构

  3. 所属分类：其它

    • 发布日期：2020-12-10
    • 文件大小：91136
    • 提供者：weixin_38668274

  1. 嵌入式系统/ARM技术中的基于8051软核的SOPC系统设计与实现

  2. 摘要：介绍了基于IP的可重用的SOC设计方法；选用MC8051 IP核为核心控制器，自主开发了UART IP核、I2C IP核、USB IP核，采用Wishbone片上总线架构，集成了一个MCU系统；同时设计了针对此MCU系统的微机调试软件和硬件调试器，并实现了MCU系统的FPGA验证和整个系统的功能验证。设计中采用了开发8051行为模型的方式，缩短了系统仿真的时间；而USB IP核设计则采肜双缓冲区结果，方便了系统做成，提高了传输速度。 关键词：SOPC IP核 WISHBONE 片上总

  3. 所属分类：其它

    • 发布日期：2020-12-10
    • 文件大小：122880
    • 提供者：weixin_38671628

  1. 软核处理器的先进存储器体系结构的特点

  2. Altera公司的Nios软芯核嵌入式处理器是一种可特许的通用RISC CPU，它可与各种各样的外设、定制指令和硬件加速单元相组合，构成一个定制的SOPC（可编程单片系统）。这种Nios处理器的第三版本利用Altera公司高性能Stratix和Cyclone器件系列的先进存储器功能来提高系统性能。　　       该处理器具有可由用户配置的L1（第一层）指令与数据超高速缓存，而这些超高速缓存可与Stritix器件和廉价Cyclone器件上的双端口存储器体系结构协同工作。Nios处理器可对廉价的S

  3. 所属分类：其它

    • 发布日期：2020-12-08
    • 文件大小：34816
    • 提供者：weixin_38733245
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