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上传时间: 2021-01-12
详细说明：所有的入门的屌丝都是知道处理器中断模式是两种是边沿触发和电平触发。边沿触发用的很少，一般还是以下降沿触发为主。当设备完成一个数据后，会输出一个下降沿，触发处理器。而电平触发，是输出一个电平，并且会保持这个电平， 至到系统处理或者清除该中断后才会输出另外的电平。在fpga经常会遇到AXI总线或者AVALON总线，总线接口经常是电平触发。如果fpga一端是主控一端。需要设计中断触发状态机以及清除中断操作。always（clk）beginif（rst）...else if(irq)state <= irq_state;else case (state)....end上述代码，目测是没有问题，但是问
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