[电信] UVM -beginners guide.rar

说明：The UVM (Universal Verification Methodology) Class Library provides the building blocks needed to quickly develop well-constructed and reusable verification components and test environments in SystemVerilog
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[电信] CPLD_SSPI_DOWN.rar

说明：实现了对Lattice的CPLD在线加载，通过SSPI接口进行下载，使用此功能需要预先开启CPLD的Slave_SPI接口，才能正确的加载版本。代码只能加载到CPLD的SRAM中，断电则代码丢失
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[电信] Weighted Sparse Representation.zip

说明：Weighted Sparse Representation的函数，可以直接调用，对了解Weighted Sparse Representation有一定的帮助
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[电信] 电力系统分析实验simulink仿真（含4个项目）.zip

说明：电力系统暂态分析，电力系统短路故障的MATLAB基于simulink的仿真；电力系统不对称故障的MATLAB基于simulink的仿真分析；电力系统发电机故障的simulink仿真分析；电力系统单机无穷大系统的基于simulink的稳态仿真分析。
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[电信] ZYNQ PL扩展串口_使用UartliteIP核

说明：zynq的PL通过UartliteIP核扩展串口，PS通过中断处理串口数据。开发环境为vivado2018.3，资源里有文档教程，有工程文件。扩展的串口可以发送任意长度的数据，也可以接受任意长度的数据。
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[电信] 多功能数字频率计的设计_论文.pdf

说明：采用了全同步的测频原理在FPGA器件上实现了全同步数字频率计。根据全同步数字频率计的测频原理方框图，采用Verilog语言，成功的编写出了设计程序，并在Vivado2018.1软件环境中，对编写的Verilog程序进行了仿真，得到了很好的效果。对构成全同步数字频率计的每一个模块，给出了较详细的设计方法和完整的程序设计以及仿真结果。 需要技术支持可联系作者，联系方式在文档中。
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[电信] 咪咕盒子MGV2000电视盒子刷机教程.rar

说明：咪咕盒子MGV2000电视盒子刷机教程,咪咕盒子MGV2000电视盒子刷机教程咪咕盒子MGV2000电视盒子刷机教程
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[电信] Understanding Jitter and Phase Noise.pdf

说明：Understanding Jitter and Phase Noise，A Circuits and Systems Perspective
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[电信] 实验九 信号的自然采集与恢复.zip

说明：对于给定带频谱信号f(t),其频谱F（jΩ）=cosΩ （ -0.5π<Ω<0.5π）F（jΩ）=0 其它 1.汇出此信号的频谱图（Ω的取值：-0.5π<Ω<0.5π，精度取0.01rad）。 2.对此频域信号进行傅里叶反变换，得到相应的时域信号，绘出此信号的时域f(t) (t的取值：-20s<t<20s;精度取0.1s) 3.分别用3种不同的采集频率fs=0.2HZ,0.5HZ,1.0HZ,… 4.针对3中采样所得的矩形采样信号，用录波器H（jΩ）…
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[电信] PGA of ISAR.m

说明：ISAR自聚焦算法 Matlab代码实现 参考文献D.E. Wahl, P.H. Eichel, D.C. Ghiglia, C.V. Jakowatz, "Phase gradient autofocus-a robust tool for high resolution SAR phase correction," IEEE Trans. Aero. & Elec. Sys., vol. 30, no. 3, 1994.
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[电信] PGAforSAL.m

说明：This function runs the PGA algorithm on a SAL scene that has already had its range migration fixed
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[电信] QPSK突发信号符号同步方案设计与FPGA实现1.pdf

说明：本文首先阐述了突发信号同步的理论基础，包括通信系统中突发信号同步的特点、插值理论、插值器在定是同步中的应用和前向符号同步。讨论了一种适合于突发通信模式下的数据辅助型符号同步定时偏差估计算法。 最后，本文介绍了在MATLAB对突发模式下QPSK信号的同步算法仿真过程和结果，仿真结果符合预期设计要求，并根据算法流程进行FPGA设计实现，给出了该数字接收机定时同步单元的逻辑结构，并通过仿真测试进一步验证本文前面所介绍的符号同步算法的可行性。FPGA设计语言采用Verilog HDL，开发和仿真测试平台
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