[硬件开发] AM900EV3_MODULE_封装.zip

说明：2G，GPRS，超低功耗，OPEN CPU，GPS，GNSS，多通道，精简AT指令，esim，物联网2G，GPRS，超低功耗，OPEN CPU，GPS，GNSS，多通道，精简AT指令，esim，物联网
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[硬件开发] JLink驱动V612j.rar

说明：JLink_v8烧录器驱动 最后一个可靠版本。 如果手头有淘宝买的JLink_v8烧录器，这个使用很稳定， V614开始多多少少有些适应性问题。 当然JLink_v9烧录器也是可以用的。
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[硬件开发] stm32 gcc 代码编辑工具Ride7 7.70.19.0218

说明：stm32 gcc 代码编辑工具Ride7,可直接配合rlink在线调试stm32,需要安装rkit包配合使用
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[硬件开发] Ride7编译工具包RKit-ARM_1.72.19.0253

说明：Ride7编译arm的工具包RKit-ARM_1.72.19.0253,ride7是编辑器,编译链在rkit里面,必不可少
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[硬件开发] 综合与Design-Compiler(很好-很经典).pdf

说明：综合是前端模块设计中的重要步骤之一，综合的过程是将行为描述的电路、RTL级的电路转换到门级的过程；Design Compiler是Synopsys公司用于做电路综合的核心工具，它可以方便地将HDL语言描述的电路转换到基于工艺库的门级网表。本章将初步介绍综合的原理以及使用Design Compiler做电路综合的全过程
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[硬件开发] 用verilog实现除法器(两种方法）

说明：一、 实验目的与要求： 用verilog语言编写出一个除法器的代码，并在modelsim中进行功能仿真，认真的完成实验报告。 二、 实验设备（环境）及要求： 在modelsim环境下编写代码与测试程序，并仿真； 在synplify pro下编译，设置硬件并综合。 三、 实验内容及步骤： 1、 选择除法器的算法，本实验开始采用的是减法实现除法器的例子（比如十进制中的a/b，可先比较a与b的大小，如果a>b,则商加1，a<=a-b,再进行比较大小，直到a<b,商不变，余数为a）;
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[硬件开发] ads1202 sigma delta ADC.pdf

说明：TI的一款sigma-delta 型ADC ADS1202 模数转换器，这里面有TI提供的VHDL版的sinc3滤波器的源码实现，并且有讲解和滤波器框图
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[硬件开发] eclipse中进行packs安装资源文件以及python批下载相应资源工具

说明：eclipse中进行packs安装资源文件以及python批下载相应资源（改相应路径以及prefix），使用python进行批下载后需放置在相应路径从而在eclipse的packs中install。声明python下载能获得packs中95%以上的pack
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[硬件开发] 2D绘图画的带圆形端点的环形进度条——emWin

说明：这是一个用emWin的2D绘图函数画的一个带圆形端点的环形进度条，压缩包里只有一个.c文件，是在模拟器上跑的。
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[硬件开发] 奋斗STM32开发板ADC例程讲解.pdf

说明：板子加电后，通过串口1显示ADC1的通道11的测量结果，该实验学习了基于DMA专递方式的ADC采集软件的编制及控制流程。12位ADC是一种逐次逼近型模拟数字转换器。它有18个通道，可测量16个外部和2个内部 信号源。各通道的A/D转换可以单次、连续、扫描或间断模式执行。ADC的结果可以左对齐或右对齐方式存储在16位数据寄存器中。
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[硬件开发] 奋斗STM32开发板按键中断_EXTI_例程讲解-V3.pdf

说明：板子加电后，按动板子上K1-K3按键，可控制对应的LED1-LED3的亮灭，该实验学习了外部中断（EXTI）程序的编制及控制流程。 为了优化外设数目，可以把一些复用功能重新映射到其他引脚上。设置复用重映射和调试I/O配置寄存器(AFIO_MAPR)(参见0节)实现引脚的重新映射。这时，复用功能不再映射到它们的原始分配上。
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[硬件开发] 奋斗STM32开发通用IO口例程讲解.pdf

说明：每个GPI/O 端口有两个32 位配置寄存器(GPIOx_CRL，GPIOx_CRH)，两个32位数据寄存器(GPIOx_IDR，GPIOx_ODR)，一个32 位置位/复位寄存器(GPIOx_BSRR)，一个16 位复位寄存器(GPIOx_BRR)和一个32 位锁定寄存器(GPIOx_LCKR)。根据数据手册中列出的每个I/O 端口的特定硬件特征， GPIO 端口的每个位可以由软件分别配置成多种模式。
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