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文件名称: Verilog VHDL硬件描述语言教程
  所属分类: 其它
  开发工具:
  文件大小: 3mb
  下载次数: 0
  上传时间: 2009-09-01
  提 供 者: xiaopi******
 详细说明: Verilog HDL是一种硬件描述语言,用于从算法级、门级到开关级的多种抽象设计层次的 数字系统建模。被建模的数字系统对象的复杂性可以介于简单的门和完整的电子数字系统之 间。数字系统能够按层次描述,并可在相同描述中显式地进行时序建模。
(系统自动生成,下载前可以参看下载内容)

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