文件名称:
基于流水线技术的并行高效FIR滤波器设计
开发工具:
文件大小: 119kb
下载次数: 0
上传时间: 2020-08-11
详细说明：本文介绍了并行高效数字滤波器的设计方法,给出了电路的仿真结果。利用ＶＨＤＬ语言,采用可重复配置的ＦＰＧＡ,降低了设计成本,提高了系统的适用性。由于ＦＩＲ滤波器的系数是常数,可以保存在ＲＯＭ中,在运算时通过查找表的方法可以很快得到乘法输出,减少了使用的资源和布线延时,节省了运算时间。在设计中,充分利用先进的ＥＤＡ软件,大大提高了设计效率。
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