文件名称:
采用CPLD/FPGA的VHDL语言电路优化原理设计
开发工具:
文件大小: 92kb
下载次数: 0
上传时间: 2020-08-31
详细说明：使用VHDL进行CPLD/FPGA电路设计时，要根据实际项目的具体情况，合理地划分项目功能，并用VHDL实现相应的功能模块。用模块来构建系统，可有效地优化模块间的结构和减少系统的冗余度，并在模块设计过程中始终贯彻以上的优化设计原则，借助于强大的综合开发软件进行优化，才能达到最优化电路的目的。
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