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文件名称: 在赛灵思FPGA设计中保留可重复结果
  所属分类: 其它
  开发工具:
  文件大小: 200kb
  下载次数: 0
  上传时间: 2020-10-22
  提 供 者: weixin_********
 详细说明:满足设计的时序要求本身已非易事,而要实现某项设计的整体时序具有完全可重复性有时候却是不可能的任务。幸运的是,设计人员可以借助有助于实现可重复时序结果的设计流程概念。影响最大的四个方面分别是HDL设计实践、综合优化、平面布局和实施方案。
(系统自动生成,下载前可以参看下载内容)

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