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嵌入式系统/ARM技术中的FPGA的静态功耗分析与降低技术（一）
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文件大小: 117kb
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上传时间: 2020-10-20
详细说明：摘 要：FPGA已经被广泛用于实现大规模的数字电路和系统，随着CMOS工艺发展到深亚微米，芯片的静态功耗已成为关键挑战之一。文章首先对FPGA的结构和静态功耗在FPGA中的分布进行了介绍。接下来提出了晶体管的漏电流模型，并且重点对FPGA中漏电流单元亚阈值漏电流和栅漏电流进行了详细的分析。最后根据FPGA的特点采用双阈值电压晶体管，关键路径上的晶体管采用低阈值电压栅的晶体管，非关键路径上的晶体管采用高阈值电压栅的晶体管，以此来降低芯片的静态功耗。
1 引言
FPGA因其可以降低成本和设计周期，已经被广泛用于实现大规模的数字电路和系统。随着数字电路规模越来越大，时钟频率越来越高，也增
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