文件名称:
EDA/PLD中的如何采用FPGA协处理器实现算法加速
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文件大小: 104kb
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上传时间: 2020-12-08
详细说明：当今的设计工程师受到面积、功率和成本的约束，不能采用GHz级的计算机实现嵌入式设计。在嵌入式系统中，通常是由相对数量较少的算法决定最大的运算需求。使用设计自动化工具可以将这些算法快速转换到硬件协处理中。然后，协处理器可以有效地连接到处理器，产生“GHz”级的性能。
本文主要研究了代码加速和代码转换到硬件协处理器的方法。我们还分析了通过一个涉及到基于辅助处理器单元(APU)的实际图像显示案例的基准数据均衡决策的过程。该设计使用了在一个平台FPGA中实现的一个嵌入式PowerPC。 协处理器的意义
协处理器是一个处理单元，该处理单元与一个主处理单元一起使用来承担通常
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