文件名称:
嵌入式系统/ARM技术中的基于DBL结构的嵌入式64kb SRAM的低功耗设计
开发工具:
文件大小: 175kb
下载次数: 0
上传时间: 2020-12-05
详细说明：摘要: 针对嵌入式系统的低功耗要求，采用位线分割结构和存储阵列分块译码结构，完成了64 kb低功耗SRAM模块的设计。 与一般布局的存储器相比，采用这两种技术使存储器的功耗降低了43% ，而面积仅增加了18%。 关键词：存储器；SRAM；位线分割；分块译码 嵌入式存储器的容量及其在系统芯片中所占的面积越来越大，对其操作所带来的动态功耗成为系统芯片功耗中重要的组成部分，因此，必须寻求有效的低功耗设计技术，以降低嵌入式存储器对整个系统的影响。为了降低存储器的功耗，人们采用了字线分割、分级字线译码以及字线脉冲产生等技术，大大降低了存储器的动态功耗。 另外一种能有效降低存储器动态功耗的技术就
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