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上传时间: 2021-03-18
详细说明：设计了一种具有容错能力的可重构阵列,它以2D-Mesh型片上网络(Network-on-Chip,No C)路由器作为互连单元,以精简指令集的处理器为计算单元,这种结构适用于数字信号处理等应用领域。对于阵列互连结构中的瞬态故障,采用三模冗余、扩展海明码和检错重传的方法对其进行容错,使用连线内建自测试(build-in self-test)与自修复及自适应路由的方法对互连结构中的永久故障进行容错。对于计算单元失效的情况,模仿生物体胚胎细胞的分化机制,通过调整相关配置信息实现计算任务的重新分配,从而实现容错。将一个19阶的音频FIR带通滤波器映射到3×3的容错可重构阵列上,分别对其运算和容错能力进行了验证,结果表明系统可以实现预期的运算功能,且具有较强的容错能力。
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