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  1. 多功能数字钟----数字电路实验报告

  2. 多功能数字钟 【摘 要】数字钟是采用数字电路实现对时,分,秒。数字显示的计时装置,广泛用于个人家庭,车站, 码头办公室等公共场所,成为人们日常生活中不可少的必需品,由于数字集成电路的发展和石英晶体振荡器的广泛应用,使得数字钟的精度,运运超过老式钟表, 钟表的数字化给人们生产生活带来了极大的方便而且大大地扩展了钟表原先的报时功能。因此，研究数字钟及扩大其应用，有着非常现实的意义。 数字钟计时的标准信号应该是频率相当稳定的1HZ秒脉冲，所以要设置标准时间源。 数字钟计时周期是24小时，因此必须设置

  3. 所属分类：专业指导

    • 发布日期：2009-05-18
    • 文件大小：698368
    • 提供者：jayzf0503

  1. 多功能数字钟电路原理图

  2. 多功能数字钟电路原理图多功能数字钟电路原理图多功能数字钟电路原理图多功能数字钟电路原理图

  3. 所属分类：专业指导

    • 发布日期：2009-06-12
    • 文件大小：39936
    • 提供者：guopeng1987

  1. 数电课程设计多功能数字钟

  2. 数电课程设计多功能数字钟 课程设计专用，24页WORD，格式保证好，下了觉不后悔

  3. 所属分类：专业指导

    • 发布日期：2009-09-14
    • 文件大小：1048576
    • 提供者：lzg0179

  1. 2004年山东省大学生电子设计竞赛一等奖 多功能数字钟

  2. 2004年山东省大学生电子设计竞赛一等奖 多功能数字钟（B题）

  3. 所属分类：专业指导

    • 发布日期：2009-12-29
    • 文件大小：263168
    • 提供者：marsfgl06

  1. 多功能数字钟课程设计

  2. 多功能数字钟课程设计，定时控制； 仿广播电台正点报时； 报整点时数； 触摸报整点时数 附带仿真

  3. 所属分类：嵌入式

    • 发布日期：2010-01-05
    • 文件大小：701440
    • 提供者：taolei372817455

  1. 数字逻辑 课程设计 VHDL 多功能数字钟（1）

  2. 数字逻辑 课程设计 VHDL 多功能数字钟 这个数字钟是我根据我老师的设计自己改编的，内部结构变化挺大的，功能也比较全。 1、具有以二十四小时制计时、显示、整点报时、时间设置和闹钟的功能。 2、设计精度要求为1秒。 （一）计时：正常工作状态下，每日按24h计时制计时并显示，蜂鸣器无声，逢整点报时。 （二）校时：在计时显示状态下，k=1，进入“小时”校准状态，之后按下“k=1”则进入“分”校准状态，继续按下“k=1”则进入“调秒”状态，第三次按下“k键”又恢复到正常计时显示状态。 （1）“小时”

  3. 所属分类：专业指导

    • 发布日期：2010-01-06
    • 文件大小：233472
    • 提供者：ktboy0502

  1. 数字逻辑 课程设计 VHDL 多功能数字钟（2）

  2. 数字逻辑 课程设计 VHDL 多功能数字钟 这个数字钟是我同学根据老师那个改编的，功能很强大！同时免费赠送设计报告以及.scf .vhd文件 1、具有以二十四小时制计时、显示、整点报时、时间设置和闹钟的功能。 2、设计精度要求为1秒 （一）计时：正常工作状态下，每日按24h计时制计时并显示，蜂鸣器无声，逢整点报时。 （二）校时：在计时显示状态下，按下“set键”，进入“小时”校准状态，之后按下“k键”则进入“分”校准状态，继续按下“k键”则进入“秒复零”状态，第三次按下“k键”又恢复到正常计时

  3. 所属分类：专业指导

    • 发布日期：2010-01-06
    • 文件大小：154624
    • 提供者：ktboy0502

  1. 数字逻辑 课程设计 VHDL 多功能数字钟

  2. 数字逻辑 课程设计 VHDL 多功能数字钟 这个数字钟是我老师的设计，网上很难找到，但设计的很绝！已有设计报告 1、具有以二十四小时制计时、显示、整点报时、时间设置和闹钟的功能。 2、设计精度要求为1秒 （一）计时：正常工作状态下，每日按24h计时制计时并显示，蜂鸣器无声，逢整点报时。 （二）校时：在计时显示状态下，按下“set键”，进入“小时”校准状态，之后按下“k键”则进入“分”校准状态，继续按下“k键”则进入“秒复零”状态，第三次按下“k键”又恢复到正常计时显示状态。 （1）“小时”校准

  3. 所属分类：专业指导

    • 发布日期：2010-01-06
    • 文件大小：98304
    • 提供者：ktboy0502

  1. 多功能数字钟设计多功能数字钟设计

  2. 多功能数字钟设计多功能数字钟设计多功能数字钟设计

  3. 所属分类：专业指导

    • 发布日期：2010-01-12
    • 文件大小：4194304
    • 提供者：sixbit

  1. 多功能数字钟计时校时扩展功能的仿真与调试

  2. 本实验为多功能数字钟的设计与仿真调试。数字钟的基本功能包括1、准确计时，以数字形式显示时、分、秒的时间；2、小时的计时要求为“12翻1”、分和秒的计时要求为60进位；3、校时功能。扩展功能包括：1、定时控制；2、仿广播电台整点报时。此数字钟电路由振荡器、分频器、校时电路、显示译码电路和功能扩展电路组成。本是实验采用Proteus软件进行仿真。仿真结果显示此电路能完成上述要求，可实现上述一系列功能。

  3. 所属分类：嵌入式

    • 发布日期：2010-01-17
    • 文件大小：672768
    • 提供者：wl422485596

  1. VHDL多功能数字钟设计

  2. 基于VHDL的多功能数字钟设计 基于VHDL的多功能数字钟设计

  3. 所属分类：专业指导

    • 发布日期：2010-05-05
    • 文件大小：157696
    • 提供者：hongchen1

  1. 简易多功能数字钟设计

  2. 简易多功能数字钟设计 简易多功能数字钟设计 简易多功能数字钟设计

  3. 所属分类：专业指导

    • 发布日期：2010-05-25
    • 文件大小：54272
    • 提供者：AP513

  1. 多功能数字钟设计PPT

  2. 多功能数字钟设计PPT，包括校时、整点报时等各部分的电路及详细说明

  3. 所属分类：专业指导

    • 发布日期：2010-05-28
    • 文件大小：435200
    • 提供者：wdalfred

  1. ds1302多功能数字钟

  2. ds1302和89s52做的多功能数字钟 keil C调试多功能数字钟

  3. 所属分类：C

    • 发布日期：2010-06-27
    • 文件大小：26624
    • 提供者：zouzichun

  1. 多功能数字钟的设计与制作

  2. 多功能数字钟，有校时功能，分和秒六十进制，时十二进制

  3. 所属分类：专业指导

    • 发布日期：2010-07-10
    • 文件大小：473088
    • 提供者：luotao0711

  1. 多功能数字钟电路设计

  2. 很好的多功能数字钟电路设计，包括自动手动校时，闹钟等

  3. 所属分类：专业指导

    • 发布日期：2010-12-07
    • 文件大小：1048576
    • 提供者：Insomina0701

  1. Verilog多功能数字钟的设计— 毕业设计VHDL

  2. Verilog多功能数字钟的设计— 毕业设计VHDL

  3. 所属分类：专业指导

    • 发布日期：2010-12-09
    • 文件大小：1048576
    • 提供者：ziyouren2008

  1. 多功能数字钟设计，课程设计报告

  2. 大二多功能数字钟课程设计报告,内容详细有借鉴意义

  3. 所属分类：专业指导

    • 发布日期：2010-12-27
    • 文件大小：31744
    • 提供者：no1wudi2010

  1. 基于Verilog HDL设计的多功能数字钟

  2. 本文利用Verilog HDL 语言自顶向下的设计方法设计多功能数字钟，突出了其作为硬件描述语言的良好的可读性、可移植性和易理解等优点，并通过Altera QuartusⅡ 4.1 和ModelSim SE 6.0 完成综合、仿真。此程序通过下载到FPGA 芯片后，可应用于实际的数字钟显示中。

  3. 所属分类：嵌入式

    • 发布日期：2011-02-22
    • 文件大小：124928
    • 提供者：zhlyz2003

  1. 数字逻辑 多功能数字钟 详尽，完全实现

  2. 数字逻辑 多功能数字钟 详尽，完全实现 包括计时，校时，定时，闹钟的修改，显示，整点报时

  3. 所属分类：专业指导

    • 发布日期：2011-04-22
    • 文件大小：261120
    • 提供者：love_me_2010
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