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  1. 2019上半年网络工程师真题及答案+刷题.pdf

  2. 网络工程师2019上半年真题及答案、刷题 1.计算机执行指令的过程中，需要由（1）产生每条指令的操作信号并将信号送往相应的部件进行处理，已完成指定的操作。 A、CPU 的控制器 B、CPU 的运算器 C、DMA 控制器 D、Cache 控制器 参考答案【A】 2.DMA 控制方式是在（2）之间直接建立数据通路进行数据的交换处理。 A、CPU 与主存 B、CPU 与外设 C、主存与外设 D、外设与外设 参考答案【C】 3.在（3）校验方法中，采用模2 运算来构造校

  3. 所属分类：软考等考

    • 发布日期：2020-01-13
    • 文件大小：374784
    • 提供者：qq_35963344

  1. 计算机等级考试四级嵌入式系统开发工程师复习要点汇总.pdf

  2. 计算机等级考试四级嵌入式系统开发工程师复习要点汇总O随光 评enku.sui.me (1)调度:给定一组实时任务和系统资源,确定每个任务何时何地执行的整 个过程。 (2)抢占式调度:通常是优先级驱动的调度,如uCOS。优点是实时性好 反应快,调度算法相对简单,可以保证高优先级任务的时间约束;缺点是上下文 切换多 (3)非抢占式调度:通常是按时间片分配的调度,不允许任务在执行期间被 中断,仟务一旦占用处理器就必须执行完毕或自愿放弃,如 Wince。优点是上 下文切换少;缺点是处理器有效资源利用率低

  3. 所属分类：嵌入式

    • 发布日期：2019-08-17
    • 文件大小：392192
    • 提供者：qq_33211808

  1. 一种基于FPGA的航空总线容错机制设计

  2. 航天应用中，单粒子翻转引发SRAM型FPGA的错误最多，而EDAC设计在纠错模块中有着广泛的应用。将依据扩展海明码设计的[40，32]EDAC模块嵌入到ARINC 659的双口数据DPRAM和指令SRAM中，提高了总线控制器的容错处理能力。

  3. 所属分类：其它

    • 发布日期：2020-10-17
    • 文件大小：481280
    • 提供者：weixin_38635996

  1. 计算机系统基础知识（软考）

  2. 已知数据信息为16位，最少应附加（ ）位校验位，以实现海明码纠错。 A 3 B 4 C 5 D 6 答案C 解析 该题目暂无解析,点击添加解析

  3. 所属分类：软考等考

    • 发布日期：2020-10-24
    • 文件大小：561152
    • 提供者：qq_37729171

  1. 基于SoC的实时信号处理系统中存储系统

  2. 本文针对潜入式实时数字信号处理系统的特点，重新组织DDR存储颗粒的结构，添加冗余颗粒和相关寄存器，改写控制IP，设计了一种新的具有容错纠错自适应功能的二级冗余存储体系结构。它仅需增加少量的冗余器件就可以容忍系统中较多数目的器件故障。在系统没有故障的情况下，存储颗粒可以采用海明码等EDAC码进行纠错；当系统中部分器件出现故障时，系统可以通过软件配置或硬件自动检测，自动利用冗余模块进行容错；

  3. 所属分类：其它

    • 发布日期：2020-10-23
    • 文件大小：210944
    • 提供者：weixin_38592548

  1. 片上可重构阵列容错方法研究

  2. 设计了一种具有容错能力的可重构阵列,它以2D-Mesh型片上网络(Network-on-Chip,No C)路由器作为互连单元,以精简指令集的处理器为计算单元,这种结构适用于数字信号处理等应用领域。对于阵列互连结构中的瞬态故障,采用三模冗余、扩展海明码和检错重传的方法对其进行容错,使用连线内建自测试(build-in self-test)与自修复及自适应路由的方法对互连结构中的永久故障进行容错。对于计算单元失效的情况,模仿生物体胚胎细胞的分化机制,通过调整相关配置信息实现计算任务的重新分配,从而

  3. 所属分类：其它

    • 发布日期：2021-03-18
    • 文件大小：481280
    • 提供者：weixin_38520192
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