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资源分类
搜索资源列表
VerilogHDL关于硬件描述语言
VerilogHDL关于硬件描述语言,由于太大压缩文件
所属分类:
软件测试
发布日期:2011-04-01
文件大小:4194304
提供者:
huangyx223
VerilogHDL(中文版)
IC设计开发语言verilogHDL中文版,详细介绍了VerilogHDL进行IC开发的基本方法,适合微电子专业学生。
所属分类:
硬件开发
发布日期:2011-04-07
文件大小:14680064
提供者:
mapledove
采用verilogHDL编写的数字跑表
本代码采用verilogHDL编写,实现的是数字跑表功能
所属分类:
嵌入式
发布日期:2011-04-08
文件大小:156672
提供者:
akydx2
VerilogHDL实现的状态机
本代码采用VerilogHDL编写,实现的是状态机功能
所属分类:
嵌入式
发布日期:2011-04-08
文件大小:833536
提供者:
akydx2
基于VerilogHDL设计的多功能数字钟
基于VerilogHDL设计的多功能数字钟 基于VerilogHDL设计的多功能数字钟 实例讲解
所属分类:
电信
发布日期:2011-06-06
文件大小:215040
提供者:
wyf200913866
verilogHDL初级程序130多例
verilogHDL初级程序130多例,教你怎么学习verilogHDL初级程序,简单实用,欢迎下载。
所属分类:
硬件开发
发布日期:2011-06-21
文件大小:151552
提供者:
summerminge
VerilogHDL设计实例-CPU设计
可综合的VerilogHDL设计实例--简化的RISC CPU设计简介
所属分类:
硬件开发
发布日期:2011-06-30
文件大小:715776
提供者:
mokui_whut
运用VerilogHDL实现AD7862的数据采集设计
运用VerilogHDL实现AD7862的数据采集设计
所属分类:
硬件开发
发布日期:2011-07-12
文件大小:290816
提供者:
dq6502011
VerilogHDL那些事儿
VerilogHDL那些事儿V1.0.pdf verilog入门 全力推荐
所属分类:
电信
发布日期:2011-07-20
文件大小:10485760
提供者:
q463421460
VerilogHDL那些事儿V3.0.rar
VerilogHDL那些事儿V3.0.rar
所属分类:
硬件开发
发布日期:2011-11-10
文件大小:10485760
提供者:
zzyzytc
精通VerilogHDL:IC设计核心技术实例详解
精通VerilogHDL:IC设计核心技术实例详解 -部分习题源码
所属分类:
其它
发布日期:2011-11-20
文件大小:185344
提供者:
xiaoxiaoyuwu
VerilogHDL那些事儿.REV3.0
VerilogHDL那些事儿.REV3.0VerilogHDL
所属分类:
硬件开发
发布日期:2011-11-27
文件大小:17825792
提供者:
luoweilai
VerilogHDL那些事儿配置笔记
VerilogHDL那些事儿配置笔记
所属分类:
硬件开发
发布日期:2011-11-28
文件大小:1048576
提供者:
luoweilai
VerilogHDL那些事儿
VerilogHDL那些事儿
所属分类:
其它
发布日期:2011-11-29
文件大小:17825792
提供者:
wlj_come
VerilogHDL的135个经典设计实例-EDA
VerilogHDL的135个经典设计实例-EDA
所属分类:
硬件开发
发布日期:2011-11-30
文件大小:151552
提供者:
byhmilyf
verilogHDL源代码
verilogHDL源代码,FPGA,硬件开发,verilogHDL源代码,FPGA,硬件开发
所属分类:
硬件开发
发布日期:2011-12-11
文件大小:135168
提供者:
ahhfdkx
xilinx ISE 源代码verilogHDL源代码
verilogHDL源代码,FPGA,硬件开发,xilinx ISE 源代码,verilogHDL源代码,FPGA,硬件开发,xilinx ISE 源代码
所属分类:
硬件开发
发布日期:2011-12-11
文件大小:361472
提供者:
ahhfdkx
基于FPGA用verilogHDL设计的CRC32模块
本人设计的一个基于FPGA用verilogHDL设计的CRC32模块,供FPGA学习者参考
所属分类:
硬件开发
发布日期:2011-12-26
文件大小:593
提供者:
yuanshishi163
基于FPGA用verilogHDL设计的bayer转RGB模块
本人设计的一个基于FPGA用verilogHDL设计的bayer转RGB模块,算法是双线性插值,模块是64X64
所属分类:
硬件开发
发布日期:2011-12-26
文件大小:10240
提供者:
yuanshishi163
基于FPGA用verilogHDL设计的DES加密模块
基于FPGA用verilogHDL设计的DES加密模块,本人设计,供FPGA学习者参考学习
所属分类:
硬件开发
发布日期:2011-12-28
文件大小:4096
提供者:
yuanshishi163
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