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资源分类
搜索资源列表
MATLAB维特比算法卷积码译码
对《通信原理》第七版(3,1,3)卷积码,进行维特比译码,适合参考。
所属分类:
专业指导
发布日期:2018-05-24
文件大小:4096
提供者:
u010627377
纠错码技术之卷积码实现
在实际研究中,经常需要对传输数据进行纠错,而现有的纠错技术中,卷积码是一种非常高效的技术,但是其实现原理并不简单,本资源是将写好的(2,1,2)卷积码用C++封装成类,程序接口适合不同项目的调用,是一个很好的学习和应用资料,其中程序附有详细的注释,非常适合学习。
所属分类:
编解码
发布日期:2018-06-03
文件大小:1048576
提供者:
qq_26464039
维特比译码+卷积码编码程序C/C++实现
卷积码的编码和维特比译码程序,使用C/C++编写,可在Ubuntu和Windows操作系统上运行,经过修改可在嵌入式系统中运行。适合新手学习卷积码编码和维特比译码算法,也可供工程师参考。
所属分类:
C++
发布日期:2018-01-14
文件大小:18432
提供者:
lan1cao2
CDMA系统中卷积码的性能分析.pdf
CDMA系统中卷积码的性能分析pdf,CDMA系统中卷积码的性能分析
所属分类:
其它
发布日期:2019-10-12
文件大小:417792
提供者:
weixin_38744207
卷积码硬判决 含编解码.zip
C语言实现了卷积码的不同约束长度下的编译码,使用维特比译码方法进行译码,经code::block测试通过,欢迎下载
所属分类:
C
发布日期:2019-07-03
文件大小:29696
提供者:
unio__
matlab卷积码编译码 维特比软判决(2,1,3)
用matlab实现的(2,1,3)卷积码编译码程序,译码使用维特比译码,欢迎大家下载
所属分类:
其它
发布日期:2019-03-23
文件大小:6144
提供者:
unio__
卷积码的Systerm+View实现.pdf
基于Systemview软件实现卷积码编码论文参考。介绍了卷积码的概念和编译码原理。以(2, 1, 6)卷积码为例, 介绍了卷积码的部分并利用Systerm V iew 软件将整个(2, 1, 6)卷积码实现。仿真运行后参照纠错理论对波形图进行分析
所属分类:
其它
发布日期:2020-06-16
文件大小:616448
提供者:
zsevennight
卷积码编译码器matlab仿真验证.rar
213卷积码编译码器matlab验证 文件里面主要有: 213卷积码编译码的基础波形生成文件 213卷积码的性能验证文件——有无卷积码编译码的信道误码率对比;不同码率的信道误码率对比;不同约束长度的信道误码率对比;维特比译码不同约束长度的信道误码率对比 信道验证用的是BPSK调制解调,还有一个BPSK调制解调信道的理论值验证 matlab的使用版本是2017a,因为产生的数据随机,而且验证的信噪比跨度和原始数据都很大,所以要多编译几次才能得到比较理想的曲线,里面我也保存了我觉得比较合格的波形图供
所属分类:
专业指导
发布日期:2020-06-22
文件大小:394240
提供者:
xiangziling
213卷积码编译码器实现例程.rar
这个是我自己写的例程,调试环境是CCSv8.3 一共有三个工程文件,将文件夹复制到软件的工作文件夹里面就可以正常调试了 程序只做过仿真调试运行,模拟输入方法是读取dat文件到内存,再将内存区域的输出数组导出到dat文件里面。 程序是213卷积码的编译码器设计,三个工程文件夹一个是编码器一个是译码器,最后一个编译码的程序都有,可以整体观察编译码过程的数据变化。
所属分类:
C
发布日期:2020-07-20
文件大小:176128
提供者:
xiangziling
基于FPGA的移动通信中卷积码编码器设计
卷积码是一种性能优良的差错控制编码。介绍了卷积码编码原理,基于FPGA利用VHDL硬件描述语言实现了一个(2,1,9)卷积码编码器。给出了仿真结果,并在FPGA器件上验证实现。仿真及测试结果表明,达到了预期的设计要求,并用于实际项目中。
所属分类:
其它
发布日期:2020-08-07
文件大小:305152
提供者:
weixin_38743391
基于CPLD的卷积码编解码器设计
卷积码是一种性能优良的差错控制编码。本文阐述了卷积码编解码器的基本工作原理,在MAX+PLUS2软件平台上,给出了利用复杂可编程逻辑器件设计的(2,1,6)卷积码编解码器电路,并进行了编译和波形仿真。
所属分类:
其它
发布日期:2020-08-05
文件大小:96256
提供者:
weixin_38547151
基于FPGA的卷积码译码器的方案
本文基于FPGA技术设计了一种(2,1,8)卷积码的硬判决维特比译码器。该译码器以FPGA片内的寄存器作为路径度量和幸存路径的存储单元,经分析得出了路径度量单元的最小位宽,有效降低了对芯片资源的消耗。采用截短译码算法,降低了硬件的复杂度。采取了一种巧妙的方法实现了译码器的启动过程单元。
所属分类:
其它
发布日期:2020-08-05
文件大小:74752
提供者:
weixin_38560502
matlab 卷积码
MATLAB实现线性卷积码的编码和译码。先把图像进行卷积码编码,然后经过信道,在进行分组码纠错后,还原成原始图像。
所属分类:
其它
发布日期:2020-08-17
文件大小:121856
提供者:
huangweijian95
基于FPGA的卷积码编译码器
由于卷积码具有较好的纠错性能,因而在通信系统中被广泛使用。采用硬件描述语言VerilogHDL或VHDL和FPGA(Field Programmable Gate Array——现场可编程门阵列)进行数字通信系统设计,可在集成度、可靠性和灵活性等方面达到比较满意的效果。
所属分类:
其它
发布日期:2020-08-28
文件大小:288768
提供者:
weixin_38735101
利用c语言实现卷积码编码器示例
主要介绍了利用c语言实现卷积码编码器示例,需要的朋友可以参考下
所属分类:
其它
发布日期:2020-09-04
文件大小:25600
提供者:
weixin_38551070
基于CPLD的卷积码编解码器的设计
卷积码是一种性能优良的差错控制编码。本文阐述了卷积码编解码器的基本工作原理,在MAX+PLUS2软件平台上,给出了利用复杂可编程逻辑器件设计的(2,1,6)卷积码编解码器电路,并进行了编译和波形仿真。
所属分类:
其它
发布日期:2020-08-30
文件大小:253952
提供者:
weixin_38710578
217卷积码编译实现
217卷积码编译实现
所属分类:
其它
发布日期:2016-10-28
文件大小:37888
提供者:
youwanname
通信与网络中的基于FPGA的卷积码译码器的方案
卷积码是深度空间通信系统和无线通信系统中常用的一种差错控制编码。它克服了分组码由于以码块为单位编译码而使分组间的相关信息丢失的缺点。(2,1,8)卷积码在2G、3G通信系统中得到了广泛的运用。CDMA/IS-95系统的前向信道[3]、CDMA20001x的前反向链路都使用了生成多项式为(561,753)码率为1/2的(2,1,8)卷积码。针对目前卷积码译码器占用资源较多,最高工作频率较低的缺点,本文设计了一种新的基于FPGA的(2,1,8)卷积码译码器。该译码器工作频率高,输出时延小,占用资源少
所属分类:
其它
发布日期:2020-10-23
文件大小:123904
提供者:
weixin_38624519
水声OFDM系统中卷积码译码设计及其DSP实现
纠错编码是水声OFDM通信系统必须采用的关键技术。本文从译码性能和工程实现角度出发,采用卷积交织、卷积编码和Viterbi软译码相结合的差错控制方案,通过仿真和水池实验确定其参数,并在TMS320DM642上实现。在DSP实现时,卷积交织采用查表法,Viterbi译码采用蝶形运算宏定义等处理方法,极大地提升了运算速度,保证了卷积码的实时性。最后通过海洋实验验证了其译码性能。
所属分类:
其它
发布日期:2020-10-23
文件大小:215040
提供者:
weixin_38693589
卷积码SIMULINK仿真
卷积码的仿真,可以运行出结果,放心下载。
所属分类:
电信
发布日期:2012-06-09
文件大小:261120
提供者:
zhoutaolll
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