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MCU的流水线操作(流水线技术)
流水线技术是一种将每条指令分解为多步,并让各步操作重叠,从而实现几条指令并行处 理的技术。程序中的指令仍是一条条顺序执行,但可以预先取若干条指令,并在当前指令 尚未执行完时,提前启动后续指令的另一些操作步骤。这样显然可加速一段程序的运行过程。
所属分类:
专业指导
发布日期:2009-03-23
文件大小:61440
提供者:
eddiegao2009
ARML流水线
ARML流水线ARML流水线ARML流水线ARML流水线
所属分类:
硬件开发
发布日期:2007-07-23
文件大小:129024
提供者:
fpga2006
IEEE图像处理流水线论文(2005-2008)
IEEE图像处理流水线论文(2005-2008)都是新论文。
所属分类:
专业指导
发布日期:2009-04-15
文件大小:14680064
提供者:
vwzhd
用动态规划法求解流水线调度问题
在VC++6。0下用C++语言描述用动态规划法求解流水线调度问题,是学习算法的很好参考。
所属分类:
C++
发布日期:2009-04-15
文件大小:7168
提供者:
suyuqin
流水线与几种模数(AD)转换技术的比较
流水线与几种模数(AD)转换技术的比较 很先进的技术啊
所属分类:
专业指导
发布日期:2009-04-20
文件大小:143360
提供者:
tiantsmart
一个MIPS流水线设计实验
一个MIPS流水线设计实验,考虑了各种相关的因素。逻辑设计验证
所属分类:
专业指导
发布日期:2009-04-22
文件大小:101376
提供者:
xuzhanyi
devops全开源端到端部署流水线
devops流水线视频,高校运维社区制作,讲解devops端到端持续交付流水线1.0
所属分类:
平台管理
发布日期:2018-03-14
文件大小:32505856
提供者:
huangclyz
Verilog实现MIPS流水线模拟
计算机组成原理实验作业,利用modelsim实现CPU流水线工作流程的模拟工作,能够支持加载指令、分支指令、跳转指令的冒险处理,希望给初学者带来一定的帮助。
所属分类:
专业指导
发布日期:2018-03-27
文件大小:18874368
提供者:
vicurt
流水线CPU代码设计
北航计算机组成课程设计 支持20条指令的流水线CPU的Verilog代码实现,内包含源代码和相应的测试文件
所属分类:
硬件开发
发布日期:2018-05-08
文件大小:31744
提供者:
boy560
流水线CPU设计(50条指令)
北航计算机组成课程设计 支持50条指令的流水线CPU的Verilog代码实现,内包含源代码和相应的测试文件
所属分类:
硬件开发
发布日期:2018-05-08
文件大小:58368
提供者:
boy560
流水线中的冲突实验
加深对计算机流水线基本概念的理解; 理解MIPS结构如何用5段流水线来实现,理解各段的功能和基本操作; 加深对结构冲突/数据冲突/控制冲突的理解; 进一步理解解决数据冲突的方法,掌握如何应用定向技术来减少数据冲突引起的停顿,并加深对指令调度技术和延迟分支技术的理解
所属分类:
专业指导
发布日期:2018-05-11
文件大小:488448
提供者:
qq_36616309
轻量级算法HIGHT使用流水线的verilog实现
轻量级算法HIGHT使用流水线的verilog实现,这是加密算法,使用4级流水,已验证过
所属分类:
其它
发布日期:2018-05-11
文件大小:6144
提供者:
qq_20767669
流水线乘法器verilog HDL代码设计
多级流水线结构,是一种并行的方式,将相邻的两个部分的结果再加到最终的输出乘积上,即排列成一个二叉树形式的结构。
所属分类:
硬件开发
发布日期:2018-05-15
文件大小:1024
提供者:
reborn_lee
五级流水线MIPS指令集cpu设计,verilog语言,通过modelsim与ISE并下载FPGA验证(计算机组成原理)
五级流水线MIPS指令集cpu设计,verilog语言,通过modelsim与ISE并下载FPGA验证(计算机组成原理)
所属分类:
硬件开发
发布日期:2018-05-31
文件大小:9437184
提供者:
weixin_38072246
北邮 计算机系统结构实验二流水线及流水线中的冲突
北邮 计算机系统结构实验二——流水线及流水线中的冲突
所属分类:
专业指导
发布日期:2018-06-01
文件大小:499712
提供者:
nicholas1328
Verilog流水线ppt(英文)
流水线简介以及产生的冲突类型及解决方案 • Conflict for use of a resource • MIPS pipeline with a single memory? – Load/Store requires memory access for data – InstrucOon fetch would have to stall for that cycle • Causes a pipeline “bubble” • Hence, pipelined datapaths r
所属分类:
讲义
发布日期:2018-06-14
文件大小:1048576
提供者:
weixin_39788977
MIPS多周期流水线CPU设计
计算机组成原理课程作业:使用verilog完成 1、完成四十余条MIPS指令; 2、使用五级流水线; 3、单发射,无cache,无分支预测,使用延迟槽; 4、含测试代码和说明文档。
所属分类:
嵌入式
发布日期:2018-06-29
文件大小:8388608
提供者:
weixin_38363081
MIPS五级流水线CPU+cache设计
verilog编写的MIPS五级流水线,实现四十余条指令,使用512B的一级数据cache(高速缓存)。附带测试程序与说明文档。
所属分类:
嵌入式
发布日期:2018-06-29
文件大小:369664
提供者:
weixin_38363081
mips 五级流水线 带转发 带汇编代码 带二进制文件 带使用说明
mips 五级流水线 带转发 带汇编代码 带二进制文件 带使用说明
所属分类:
软件测试
发布日期:2018-07-14
文件大小:1028096
提供者:
qq_42613078
单功能非线性流水线的调度程序 福州大学
一、大作业要求 使用java语言编写一个单功能非线性流水线的调度程序。输入为预约表,输出为最优调度方案。 二、大作业总体设计方案 1.根据预约表计算冲突向量 2.BFS建立向量图 3.DFS找出向量图中的环,最短环即为最佳方案
所属分类:
Java
发布日期:2018-09-22
文件大小:2048
提供者:
qq_41032243
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