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搜索资源列表

  1. 高速PCB设计指南

  2. 高速PCB设计指南：一、 1、PCB布线 2、PCB布局 3、高速PCB设计 二、 1、高密度（HD）电路设计 2、抗干扰技术 3、PCB的可靠性设计 4、电磁兼容性和PCB设计约束 三、 1、改进电路设计规程提高可测性 2、混合信号PCB的分区设计 3、蛇形走线的作用 4、确保信号完整性的电路板设计准则 四、 1、印制电路板的可靠性设计 五、 1、DSP系统的降噪技术 2、POWERPCB在PCB设计中的应用技术 3、PCB互连设计过程中最大程度降低RF效应的基本方法 六、 1、混合信号电路

  3. 所属分类：硬件开发

    • 发布日期：2017-10-17
    • 文件大小：230400
    • 提供者：t252143

  1. VLSI_design

  2. ic设计的流程大致为： 逻辑设计--子功能分解--详细时序框图--分块逻辑仿真--电路设计(RTL级描述)--功能仿真--综合(加时序约束和设计库)--电路网表--网表仿真) 预布局布线(SDF文件)--网表仿真(带延时文件)--静态时序分析--布局布线--参数提取 --SDF文件--后仿真--静态时序分析--测试向量生成 --工艺设计与生产--芯片测试--芯片应用 在验证过程中出现的时序收敛，功耗，面积问题，应返回前端的代码输入进行重新修改，再仿真，再综合，再验证，一般要反复好几次才能最后送

  3. 所属分类：嵌入式

    • 发布日期：2009-02-16
    • 文件大小：68608
    • 提供者：tjpulx

  1. 高速PCB 设计指南

  2. 高速PCB设计指南之一 第一篇 PCB布线 第二篇 PCB布局 第三篇 高速PCB设计 高速PCB设计指南之二 第一篇 高密度(HD)电路的设计 第二篇 抗干扰3（部分） 第三篇 印制电路板的可靠性设计-去耦电容配置 第四篇 电磁兼容性和PCB设计约束（缺具体数据） 高速PCB设计指南之三 第一篇 改进电路设计规程提高可测试性 第二篇 混合信号PCB的分区设计 第三篇 蛇形走线有什么作用? 第四篇 确保信号完整性的电路板设计准则 高速PCB设计指南之四 第一篇 印制电路板的可靠性设计 高速PC

  3. 所属分类：硬件开发

    • 发布日期：2009-03-11
    • 文件大小：921600
    • 提供者：woocooking

  1. DDR2Layout指导手册

  2. DDR2Layout指导手册 DDR布线通常是一款硬件产品设计中的一个重要的环节，也正是因为其重要性，网络上也有大把的人在探讨DDR布线规则，有很多同行故弄玄虚，把DDR布线说得很难，我在这里要反其道而行之，讲一讲DDR布线最简规则与过程。 如果不是特别说明，每个步骤中的方法同时适用于DDR1，DDR2和DDR3。PCB设计软件以Cadence Allgro 16.3为例。 第一步，确定拓补结构（仅在多片DDR芯片时有用） 首先要确定DDR的拓补结构，一句话，DDR1/2采用星形结构，DDR3

  3. 所属分类：硬件开发

    • 发布日期：2018-04-20
    • 文件大小：2097152
    • 提供者：fanpeng314

  1. allegro环境介绍

  2. 为了适应不同用户的需要，Cadence软件包中提供了Allegro PCB Designer、OrCAD PCB Designer Standard和OrCAD PCB Designer Professional 3种PCB设计软件版本。 （1）Allegro PCB Designer：是应用最广泛的一种版本。产品由Base模块和Option附加模块组成，通过一个完全集成式的设计流程进行PCB Layout设计。 （2）OrCAD PCB Designer：分为Professional和Sta

  3. 所属分类：硬件开发

    • 发布日期：2018-06-21
    • 文件大小：435200
    • 提供者：weixin_42487037

  1. xilinx_ISE_教程

  2. 使用ISE13.1完成一个数字系统的设计，其内容包括： 工程的建立； 三位计数器的设计； 设计综合和查看综合结果； 三位计数器设计仿真； 分频器的设计； 用户约束的添加和设计实现； 布局布线结果的查看； 设计下载到FPGA芯片 PROM文件的生成和下载到PROM中

  3. 所属分类：硬件开发

    • 发布日期：2018-07-26
    • 文件大小：3145728
    • 提供者：zhouxinlin2009

  1. 最新北京大学verilog课件（500页）

  2. 课程内容1：介绍verilogHDL 2.candence verilog仿真 3.逻辑综合 4.设计约束 5.自动布线

  3. 所属分类：其它

    • 发布日期：2018-09-04
    • 文件大小：63963136
    • 提供者：denghp5

  1. vivado从此开始

  2. 本书为指导使用vivado软件进行FPGA调试的必备用书，包括了综合，布局布线，生成下载文件，以及时序约束等等

  3. 所属分类：讲义

    • 发布日期：2019-01-09
    • 文件大小：44040192
    • 提供者：sinat_25326461

  1. FPGA设计时序收敛.ppt

  2. 提高设计的工作频率 通过附加约束可以控制逻辑的综合、映射、布局和布线，以减小逻辑和布线延时，从而提高工作频率。 获得正确的时序分析报告 FPGA设计平台包含静态时序分析工具，可以获得映射或布局布线后的时序分析报告，从而对设计的性能做出评估。 静态时序分析工具以约束作为判断时序是否满足设计要求的标准。 指定FPGA引脚位置与电气标准 FPGA的可编程特性使电路板设计加工和FPGA设计可以同时进行，而不必等FPGA引脚位置完全确定，从而节省了系统开发时间。 通过约束还可以指定I/O引脚所支持的接口

  3. 所属分类：硬件开发

    • 发布日期：2019-05-19
    • 文件大小：3145728
    • 提供者：drjiachen

  1. ISE_-使用教程.ppt

  2. 使用ISE13.1完成一个数字系统的设计，其内容包括： 工程的建立； 三位计数器的设计； 设计综合和查看综合结果； 三位计数器设计仿真； 分频器的设计； 用户约束的添加和设计实现； 布局布线结果的查看； 设计下载到FPGA芯片 PROM文件的生成和下载到PROM中

  3. 所属分类：硬件开发

    • 发布日期：2019-05-21
    • 文件大小：3145728
    • 提供者：drjiachen

  1. 熟练掌握AltiumDesigner电路设计的教程.rar

  2. 通过本课程的学习，要求学生能够熟练地掌握Altium Designer 软件的设计环境、原理图设计、层次原理图设计、多通道设计、印制电路板（PCB）设计、三维PCB 设计、PCB 规则约束及校验、交互式布线、原理图库、PCB 库、集成库的创建、电路设计与仿真， Protel99SE 与Altium Designer的转换等相关技术内容。学会用该软件解决在电路设计中的各种问题，多掌握一种技能，为以后的毕业设计、工作打下坚实的基础。

  3. 所属分类：其它

    • 发布日期：2019-07-23
    • 文件大小：13631488
    • 提供者：weixin_39841848

  1. A04_vivado2017.1使用说明_v0.2.pdf

  2. 详细描述了vivado的使用全流程，从综合，布局布线，生成比特流到约束的编写

  3. 所属分类：硬件开发

    • 发布日期：2019-10-24
    • 文件大小：1048576
    • 提供者：yy921598

  1. Xilinx的ISE软件高级设计功能的使用.pdf

  2. 第十章 FPGA 设计技巧――ISE 高级设计工具 10.1 结构向导（Architecture Wizard） 10.2 管脚约束（PACE） 10.3 设计约束（Constrain Editor） 10.4 功耗分析（Xpower） 10.5 手工布局工具（Floorplanner） 10.6 手工布线工具（FPGA Editor） 10.7 下载工具（iMPACT） 10.8 PROM 文件生成（PROM File Format） 10.9 模块化设计工具（Modular Design）

  3. 所属分类：硬件开发

    • 发布日期：2020-03-24
    • 文件大小：470016
    • 提供者：DuobleWei

  1. 高速PCB设计指南.rar

  2. 高速PCB设计指南之（一~八 ）目录 2001/11/21 CHENZHI/LEGENDSILICON 一、 1、PCB布线 2、PCB布局 3、高速PCB设计 二、 1、高密度（HD）电路设计 2、抗干扰技术 3、PCB的可靠性设计 4、电磁兼容性和PCB设计约束 三、 1、改进电路设计规程提高可测性 2、混合信号PCB的分区设计 3、蛇形走线的作用 4、确保信号完整性的电路板设计准则 四、 1、印制电路板的可靠性设计 五、 1、

  3. 所属分类：专业指导

    • 发布日期：2020-02-10
    • 文件大小：212992
    • 提供者：drjiachen

  1. ADI JTAG 仿真技术参考.pdf

  2. ADI JTAG 仿真技术参考pdf,ADI JTAG 仿真技术参考ANALOG DEVICES JTAG仿真器接口设计 GND1 2EMU no pin(key)3 4GND ADI TAG仿真器与DSP的接口是一个有14个 BTMSWDDIO5 6 TMS 引脚的JIAG仿真器插头。它与JTAG仿真器接 BTCK7 8 TCK 头相连。如果它没有连着JTAG仿真器的话,也 BTRST9 10 TRST BTDI 11 12 TDI 可以通过一个可选的局部(固定在用户板上)扫描 GND 13

  3. 所属分类：其它

    • 发布日期：2019-10-14
    • 文件大小：465920
    • 提供者：weixin_38743602

  1. verilog代码风格VerilogCodingStyle

  2. verilog代码风格VerilogCodingStyle目录 Verilog hdl程序风格指导 目录 1.引言. 般的指导方针 命名规则 注释 格式 ·· 有限状态机实现风格 文件和目录结构 13444566777 3.逻辑实现.. 设计方法 组合逻辑… 时序逻辑 4. Verilog结构 赋值 always块 ······:4·····.·····.+·::·:···+·4··· ..···· 语句 if-then-else语句 端口声明 13 函数( function)和任务(task)

  3. 所属分类：硬件开发

    • 发布日期：2019-09-02
    • 文件大小：477184
    • 提供者：drjiachen

  1. Verilog 代码编写

  2. 数字IC培训课程体系 课程 内容 课时（每课时两节课） 第一阶段，语言及工具基础。 Verilog/VHDL 复习基本编程语言，熟练掌握基本模块的RTL设计流程。 2课时 ISE/vivado 工具的使用， coregenerator、DCM等功能使用，top文件编写，基本的综合、布局布线、约束、错误排查，bit文件生成/下载。 3课时 Modsim/VCS 仿真工具基本功能介绍，仿真程序编写，仿真时序分析 2课时 Synplify/DC 熟悉基本综合工具使用，讲解FPGA与ASIC的区别（cl

  3. 所属分类：硬件开发

    • 发布日期：2019-09-01
    • 文件大小：199680
    • 提供者：drjiachen

  1. LATTICE开发板原理图测试代码软件使用以及中文资料2.pdf

  2. [原创] LATTICE开发板原理图测试代码软件使用以及中文资料 [复制链接]器件的主要特性 非易失,无限次重构 瞬时上电,数微秒 单片,无外部配置存储器 很高的设计安全性,不能戳取位流 用数毫秒重构基于SRM的逻辑 通过系统配置和JTAG口对SRM和非易失存储器编程 支持非易失存储跽的后台编程 睡眠模式 静态电流减小100倍 TransFR重构 系统正常工作时,可进行现场更新逻辑 大量I/0 -256到2280查找表 73到271个I/(0,有多种封装选择 支持密度迂移 无铅的、符合ROHS标

  3. 所属分类：专业指导

    • 发布日期：2019-08-31
    • 文件大小：456704
    • 提供者：drjiachen

  1. FPGA入门教程.pdf

  2. 1、数字电路设计入门 2、FPGA简介 3、FPGA开发流程 4、RTL设计 5、Quartus II 设计实例 6、ModelSim和Testbench112时序逻辑电路 时序逻辑电路由时钟的上升沿或下降沿驱动工作,其实真正被时钟沿驱动的是电路中的 触发器( Register),也称为寄存器。触发器的工作原理和参数如下图 Register的原理和参数 T DQ Clk Clk old tsu:建立时间,在时钟有效沿到来之前触发器数据输入应保持稳定的时间,如果建立时 间不够,数据将不能在这个时钟

  3. 所属分类：硬件开发

    • 发布日期：2019-07-28
    • 文件大小：6291456
    • 提供者：smart_devil

  1. ​工程师PCB Layout总结

  2. PCB Layout作为硬件设计中的一个重要环节，在硬件电路设计合理的情况下，它是影响性能的一个绝对重要的指标。很多的PCB Layout工程师都是按照硬件工程师或者PI SI工程师给出的约束规则来完成布局布线，这些就是俗称的“拉线工”。

  3. 所属分类：其它

    • 发布日期：2020-07-18
    • 文件大小：84992
    • 提供者：weixin_38567873
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